CRC校驗(yàn)碼并行計(jì)算的FPGA實(shí)現(xiàn),PDF打開(kāi)
標(biāo)簽： FPGA CRC 校驗(yàn)碼
上傳時(shí)間： 2013-08-18
上傳用戶(hù)：vmznxbc
基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog FPGA HDL 多功能
上傳用戶(hù)：問(wèn)題問(wèn)題
FPGA/CPLD 初級(jí)教程 適合與初學(xué)者
標(biāo)簽： FPGA CPLD 教程 與初學(xué)者
上傳用戶(hù)：sjy1991
FPGA設(shè)計(jì)流程，相當(dāng)經(jīng)典，好東西大家分享
標(biāo)簽： FPGA 設(shè)計(jì)流程
上傳用戶(hù)：daguogai
基于FPGA的JPEG圖像壓縮芯片設(shè)計(jì)
標(biāo)簽： FPGA JPEG 圖像壓縮 芯片設(shè)計(jì)
上傳用戶(hù)：木子葉1
這是一本介紹FPGA設(shè)計(jì)過(guò)程中關(guān)鍵問(wèn)題的資料書(shū),對(duì)參加面試或工程設(shè)計(jì)有一定幫助
標(biāo)簽： FPGA 過(guò)程
上傳用戶(hù)：wangdean1101
lab1——FPGA這個(gè)文件中體統(tǒng)了如何如何使用verilog Hdl以及如何使其在FPGA開(kāi)發(fā)板上實(shí)現(xiàn)
標(biāo)簽： verilog FPGA Hdl 如何使用
上傳用戶(hù)：qwe1234
FPGA-based link layer chip S19202 configuration
標(biāo)簽： configuration FPGA-based S19202 layer
上傳用戶(hù)：xsnjzljj
FPGA設(shè)計(jì)常用資料大全，內(nèi)含一些代碼，還算比較全吧
標(biāo)簽： FPGA 常用資料
上傳用戶(hù)：Togetherheronce
FPGA控制VGA接口顯示漢字!VHDL源碼!喜歡的朋友可以看看!
標(biāo)簽： FPGA VGA 控制 接口
上傳時(shí)間： 2013-08-19
上傳用戶(hù)：gundamwzc
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