便攜式電子器件(如智能手機(jī)、GPS導(dǎo)航系統(tǒng)和平板電腦)的電源可以來(lái)自低壓太陽(yáng)能電池板、電池或AC/DC電源。電池供電系統(tǒng)通常將電池串聯(lián)疊置以實(shí)現(xiàn)更高的電壓，但由于空間不足，此技術(shù)未必總是可行。開(kāi)關(guān)轉(zhuǎn)換器使用電感的磁場(chǎng)來(lái)交替地存儲(chǔ)電能，并以不同電壓釋放至負(fù)載。因?yàn)閾p耗很低，所以開(kāi)關(guān)轉(zhuǎn)換器是個(gè)不錯(cuò)的高效率選擇。連接至轉(zhuǎn)換器輸出端的電容可減少輸出電壓紋波。升壓轉(zhuǎn)換器提供較高的輸出電壓；而應(yīng)用筆記AN-1125(如何運(yùn)用DC-DC降壓調(diào)節(jié)器)所討論的降壓轉(zhuǎn)換器則提供較低的輸出電壓。內(nèi)置fet作為開(kāi)關(guān)的開(kāi)關(guān)轉(zhuǎn)換器稱為開(kāi)關(guān)調(diào)節(jié)器，需要外部fet的開(kāi)關(guān)轉(zhuǎn)換器則稱為開(kāi)關(guān)控制器。
標(biāo)簽： DC-DC 如何運(yùn)用 升壓調(diào)節(jié)器
上傳時(shí)間： 2013-11-04
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采用雙極型開(kāi)關(guān)管的逆變器，基極驅(qū)動(dòng)電流基本上為開(kāi)關(guān)電流的1/β，因此大電流開(kāi)關(guān)電路必須采用多級(jí)放大，不僅使電路復(fù)雜化，可靠性也變差而且隨著輸出功率的增大，開(kāi)關(guān)管驅(qū)動(dòng)電流需大于集電極電流的1/β，致使普通驅(qū)動(dòng)IC無(wú)法直接驅(qū)動(dòng)。雖說(shuō)采用多級(jí)放大可以達(dá)到目的，但是波形失真卻明顯增大，從而導(dǎo)致開(kāi)關(guān)管的導(dǎo)通/截止損耗也增大。目前解決大功率逆變電源及UPS的驅(qū)動(dòng)方案，大多采用MOS fet管作開(kāi)關(guān)器件。
上傳時(shí)間： 2013-10-20
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介紹一種無(wú)極可調(diào)交流電子負(fù)載設(shè)計(jì)的新方法，由ATmega48單片機(jī)輸出PWM波，通過(guò)上位機(jī)設(shè)定不同的占空比控制場(chǎng)效應(yīng)管的通斷時(shí)間，即改變流過(guò)場(chǎng)效應(yīng)管的平均電流。根據(jù)電流的大小，可以等效為相應(yīng)的負(fù)載，并將采集的電流值顯示在上位機(jī)上。文中對(duì)該系統(tǒng)的軟﹑硬件設(shè)計(jì)思路作了詳細(xì)的分析，闡述了其設(shè)計(jì)原理。 Abstract: A new type electronic load is introduced.Due to ATmega48 microcomputer output PWM wave.The different duty is set ratio through PC to control fet turn-on time.We can equivalent homologous load according the current and display the current at PC.The hardware and software designing are analysed in detail. The principle is explained and the output is also given.
標(biāo)簽： ATmega 48 單片機(jī) 交流電子
上傳時(shí)間： 2013-11-23
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The MSP-fet430PIF is a Parallel Port interface (does not include target board) that is used to program and debug MSP430 fet tools and test boards through the JTAG interface. This interface is included in our fet tools, but sold without the development board. This interface uses a Parallel PC Port to communicate to the Debugger Software (IAR Kickstart software included) running on the PC. The interface uses the standard 14 pin header to communicate to the MSP430 device using the standard JTAG protocol. The flash memory can be erased and programmed in seconds with only a few keystrokes, and since the MSP430 flash is extremely low power, no external power supply is required. The tool has an integrated software environment and connects directly to the PC which greatly simplifies the set-up and use of the tool. The flash development tool supports development with all MSP430 flash parts. Features MSP430 debugging interface to connect a MSP430-Flash-device to a Parallel port on a PC Supports JTAG debug protocol (NO support for Spy-Bi-Wire (2-wire JTAG) debug protocol, Spy-Bi-Wire (2-wire JTAG) is supported by MSP-fet430UIF) Parallel Port cable and a 14-conductor target cable Full documentation on CD ROM Integrated IAR Kickstart user interface which includes: Assembler Linker Limulator Source-level debugger Limited C-compiler Technical specifications: Backwardly compatable with existing fet tool boards.
上傳時(shí)間： 2013-10-26
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MSP430是德州公司新開(kāi)發(fā)的一類具有16位總線的帶FLASH的單片機(jī),由于其性價(jià)比和集成度高,受到廣大技術(shù)開(kāi)發(fā)人員的青睞.它采用16位的總線,外設(shè)和內(nèi)存統(tǒng)一編址,尋址范圍可達(dá)64K,還可以外擴(kuò)展存儲(chǔ)器.具有統(tǒng)一的中斷管理,具有豐富的片上外圍模塊,片內(nèi)有精密硬件乘法器、兩個(gè)16位定時(shí)器、一個(gè)14路的12位的模數(shù)轉(zhuǎn)換器、一個(gè)看門(mén)狗、6路P口、兩路USART通信端口、一個(gè)比較器、一個(gè)DCO內(nèi)部振蕩器和兩個(gè)外部時(shí)鐘,支持8M的時(shí)鐘.由于為FLASH型,則可以在線對(duì)單片機(jī)進(jìn)行調(diào)試和下載,且JTAG口直接和fet(FLASHEMULATION TOOL)的相連,不須另外的仿真工具,方便實(shí)用,而且,可以在超低功耗模式下工作,對(duì)環(huán)境和人體的輻射小,測(cè)量結(jié)果為100mw左右的功耗(電流為14mA左右),可靠性能好,加強(qiáng)電干擾運(yùn)行不受影響，適應(yīng)工業(yè)級(jí)的運(yùn)行環(huán)境,適合與做手柄之類的自動(dòng)控制的設(shè)備.我們相信MSP430單片機(jī)將會(huì)在工程技術(shù)應(yīng)用中得以廣泛應(yīng)用,而且,它是通向DSP系列的橋梁,隨著自動(dòng)控制的高速化和低功耗化,MSP430系列將會(huì)得到越來(lái)越多人的喜愛(ài).通過(guò)兩過(guò)多月的畢業(yè)設(shè)計(jì),我對(duì)MSP430有了初步了解,對(duì)內(nèi)部的硬件資源和自身的匯編語(yǔ)法進(jìn)行了實(shí)驗(yàn),并開(kāi)發(fā)了一個(gè)應(yīng)用板,并進(jìn)行了調(diào)試.鑒于時(shí)間和能力有限,沒(méi)能對(duì)所有的應(yīng)用一一實(shí)驗(yàn).
上傳時(shí)間： 2013-11-21
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關(guān)于PCB封裝的資料收集整理. 大的來(lái)說(shuō),元件有插裝和貼裝.零件封裝是指實(shí)際零件焊接到電路板時(shí)所指示的外觀和焊點(diǎn)的位置。是純粹的空間概念.因此不同的元件可共用同一零件封裝，同種元件也可有不同的零件封裝。像電阻，有傳統(tǒng)的針插式，這種元件體積較大，電路板必須鉆孔才能安置元件，完成鉆孔后，插入元件，再過(guò)錫爐或噴錫（也可手焊），成本較高，較新的設(shè)計(jì)都是采用體積小的表面貼片式元件（SMD）這種元件不必鉆孔，用鋼膜將半熔狀錫膏倒入電路板，再把SMD 元件放上，即可焊接在電路板上了。晶體管是我們常用的的元件之一，在DEVICE。LIB庫(kù)中，簡(jiǎn)簡(jiǎn)單單的只有NPN與PNP之分，但實(shí)際上，如果它是NPN的2N3055那它有可能是鐵殼子的TO—3，如果它是NPN的2N3054，則有可能是鐵殼的TO-66或TO-5，而學(xué)用的CS9013，有TO-92A，TO-92B，還有TO-5，TO-46，TO-52等等，千變?nèi)f化。還有一個(gè)就是電阻，在DEVICE 庫(kù)中，它也是簡(jiǎn)單地把它們稱為RES1 和RES2，不管它是100Ω 還是470KΩ都一樣，對(duì)電路板而言，它與歐姆數(shù)根本不相關(guān)，完全是按該電阻的功率數(shù)來(lái)決定的我們選用的1/4W 和甚至1/2W 的電阻，都可以用AXIAL0.3 元件封裝，而功率數(shù)大一點(diǎn)的話，可用AXIAL0.4,AXIAL0.5等等。現(xiàn)將常用的元件封裝整理如下：電阻類及無(wú)極性雙端元件：AXIAL0.3-AXIAL1.0無(wú)極性電容：RAD0.1-RAD0.4有極性電容：RB.2/.4-RB.5/1.0二極管：DIODE0.4及DIODE0.7石英晶體振蕩器：XTAL1晶體管、fet、UJT：TO-xxx(TO-3,TO-5)可變電阻（POT1、POT2）：VR1-VR5這些常用的元件封裝，大家最好能把它背下來(lái)，這些元件封裝，大家可以把它拆分成兩部分來(lái)記如電阻AXIAL0.3 可拆成AXIAL 和0.3，AXIAL 翻譯成中文就是軸狀的，0.3 則是該電阻在印刷電路板上的焊盤(pán)間的距離也就是300mil（因?yàn)樵陔姍C(jī)領(lǐng)域里，是以英制單位為主的。同樣的，對(duì)于無(wú)極性的電容，RAD0.1-RAD0.4也是一樣；對(duì)有極性的電容如電解電容，其封裝為RB.2/.4，RB.3/.6 等，其中“.2”為焊盤(pán)間距，“.4”為電容圓筒的外徑。對(duì)于晶體管，那就直接看它的外形及功率，大功率的晶體管，就用TO—3，中功率的晶體管，如果是扁平的，就用TO-220，如果是金屬殼的，就用TO-66，小功率的晶體管，就用TO-5，TO-46，TO-92A等都可以，反正它的管腳也長(zhǎng)，彎一下也可以。對(duì)于常用的集成IC電路，有DIPxx，就是雙列直插的元件封裝，DIP8就是雙排，每排有4個(gè)引腳，兩排間距離是300mil,焊盤(pán)間的距離是100mil。SIPxx 就是單排的封裝。等等。值得我們注意的是晶體管與可變電阻，它們的包裝才是最令人頭痛的，同樣的包裝，其管腳可不一定一樣。例如，對(duì)于TO-92B之類的包裝，通常是1 腳為E（發(fā)射極），而2 腳有可能是B 極（基極），也可能是C（集電極）；同樣的，3腳有可能是C，也有可能是B，具體是那個(gè)，只有拿到了元件才能確定。因此，電路軟件不敢硬性定義焊盤(pán)名稱（管腳名稱），同樣的，場(chǎng)效應(yīng)管，MOS 管也可以用跟晶體管一樣的封裝，它可以通用于三個(gè)引腳的元件。Q1-B，在PCB 里，加載這種網(wǎng)絡(luò)表的時(shí)候，就會(huì)找不到節(jié)點(diǎn)（對(duì)不上）。在可變電阻
上傳時(shí)間： 2013-11-03
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MSP430系列flash型超低功耗16位單片機(jī)MSP430系列單片機(jī)在超低功耗和功能集成等方面有明顯的特點(diǎn)。該系列單片機(jī)自問(wèn)世以來(lái)，頗受用戶關(guān)注。在2000年該系列單片機(jī)又出現(xiàn)了幾個(gè)FLASH型的成員，它們除了仍然具備適合應(yīng)用在自動(dòng)信號(hào)采集系統(tǒng)、電池供電便攜式裝置、超長(zhǎng)時(shí)間連續(xù)工作的設(shè)備等領(lǐng)域的特點(diǎn)外，更具有開(kāi)發(fā)方便、可以現(xiàn)場(chǎng)編程等優(yōu)點(diǎn)。這些技術(shù)特點(diǎn)正是應(yīng)用工程師特別感興趣的。《MSP430系列FLASH型超低功耗16位單片機(jī)》對(duì)該系列單片機(jī)的FLASH型成員的原理、結(jié)構(gòu)、內(nèi)部各功能模塊及開(kāi)發(fā)方法與工具作詳細(xì)介紹。MSP430系列FLASH型超低功耗16位單片機(jī) 目錄 第1章 引 論1.1 MSP430系列單片機(jī)1.2 MSP430F11x系列1.3 MSP430F11x1系列1.4 MSP430F13x系列1.5 MSP430F14x系列第2章 結(jié)構(gòu)概述2.1 引 言2.2 CPU2.3 程序存儲(chǔ)器2.4 數(shù)據(jù)存儲(chǔ)器2.5 運(yùn)行控制2.6 外圍模塊2.7 振蕩器與時(shí)鐘發(fā)生器第3章 系統(tǒng)復(fù)位、中斷及工作模式3.1 系統(tǒng)復(fù)位和初始化3.1.1 引 言3.1.2 系統(tǒng)復(fù)位后的設(shè)備初始化3.2 中斷系統(tǒng)結(jié)構(gòu)3.3 MSP430 中斷優(yōu)先級(jí)3.3.1 中斷操作--復(fù)位/NMI3.3.2 中斷操作--振蕩器失效控制3.4 中斷處理 3.4.1 SFR中的中斷控制位3.4.2 中斷向量地址3.4.3 外部中斷3.5 工作模式3.5.1 低功耗模式0、1（LPM0和LPM1）3.5.2 低功耗模式2、3（LPM2和LPM3）3.5.3 低功耗模式4（LPM4）22 3.6 低功耗應(yīng)用的要點(diǎn)23第4章 存儲(chǔ)空間4.1 引 言4.2 存儲(chǔ)器中的數(shù)據(jù)4.3 片內(nèi)ROM組織4.3.1 ROM 表的處理4.3.2 計(jì)算分支跳轉(zhuǎn)和子程序調(diào)用4.4 RAM 和外圍模塊組織4.4.1 RAM4.4.2 外圍模塊--地址定位4.4.3 外圍模塊--SFR4.5 FLASH存儲(chǔ)器4.5.1 FLASH存儲(chǔ)器的組織4.5.2 FALSH存儲(chǔ)器的數(shù)據(jù)結(jié)構(gòu)4.5.3 FLASH存儲(chǔ)器的控制寄存器4.5.4 FLASH存儲(chǔ)器的安全鍵值與中斷4.5.5 經(jīng)JTAG接口訪問(wèn)FLASH存儲(chǔ)器39第5章 16位CPU5.1 CPU寄存器5.1.1 程序計(jì)數(shù)器PC5.1.2 系統(tǒng)堆棧指針SP5.1.3 狀態(tài)寄存器SR5.1.4 常數(shù)發(fā)生寄存器CG1和CG25.2 尋址模式5.2.1 寄存器模式5.2.2 變址模式5.2.3 符號(hào)模式5.2.4 絕對(duì)模式5.2.5 間接模式5.2.6 間接增量模式5.2.7 立即模式5.2.8 指令的時(shí)鐘周期與長(zhǎng)度5.3 指令組概述5.3.1 雙操作數(shù)指令5.3.2 單操作數(shù)指令5.3.3 條件跳轉(zhuǎn)5.3.4 模擬指令的簡(jiǎn)短格式5.3.5 其他指令第6章 硬件乘法器6.1 硬件乘法器6.2 硬件乘法器操作6.2.1 無(wú)符號(hào)數(shù)相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.2 有符號(hào)數(shù)相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.3 無(wú)符號(hào)數(shù)乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.2.4 有符號(hào)數(shù)乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.3 硬件乘法器寄存器6.4 硬件乘法器的軟件限制6.4.1 尋址模式6.4.2 中斷程序6.4.3 MACS第7章 基礎(chǔ)時(shí)鐘模塊7.1 基礎(chǔ)時(shí)鐘模塊7.2 LFXT1與XT27.2.1 LFXT1振蕩器7.2.2 XT2振蕩器7.2.3 振蕩器失效檢測(cè)7.2.4 XT振蕩器失效時(shí)的DCO7.3 DCO振蕩器7.3.1 DCO振蕩器的特性7.3.2 DCO調(diào)整器7.4 時(shí)鐘與運(yùn)行模式7.4.1 由PUC啟動(dòng)7.4.2 基礎(chǔ)時(shí)鐘調(diào)整7.4.3 用于低功耗的基礎(chǔ)時(shí)鐘特性7.4.4 選擇晶振產(chǎn)生MCLK7.4.5 時(shí)鐘信號(hào)的同步7.5 基礎(chǔ)時(shí)鐘模塊控制寄存器7.5.1 DCO時(shí)鐘頻率控制7.5.2 振蕩器與時(shí)鐘控制寄存器7.5.3 SFR控制位第8章 輸入輸出端口8.1 引 言8.2 端口P1、P28.2.1 P1、P2的控制寄存器8.2.2 P1、P2的原理8.2.3 P1、P2的中斷控制功能8.3 端口P3、P4、P5和P68.3.1 端口P3、P4、P5和P6的控制寄存器8.3.2 端口P3、P4、P5和P6的端口邏輯第9章 看門(mén)狗定時(shí)器WDT9.1 看門(mén)狗定時(shí)器9.2 WDT寄存器9.3 WDT中斷控制功能9.4 WDT操作第10章 16位定時(shí)器Timer_A10.1 引 言10.2 Timer_A的操作10.2.1 定時(shí)器模式控制10.2.2 時(shí)鐘源選擇和分頻10.2.3 定時(shí)器啟動(dòng)10.3 定時(shí)器模式10.3.1 停止模式10.3.2 增計(jì)數(shù)模式10.3.3 連續(xù)模式10.3.4 增/減計(jì)數(shù)模式10.4 捕獲/比較模塊10.4.1 捕獲模式10.4.2 比較模式10.5 輸出單元10.5.1 輸出模式10.5.2 輸出控制模塊10.5.3 輸出舉例10.6 Timer_A的寄存器10.6.1 Timer_A控制寄存器TACTL10.6.2 Timer_A寄存器TAR10.6.3 捕獲/比較控制寄存器CCTLx10.6.4 Timer_A中斷向量寄存器10.7 Timer_A的UART應(yīng)用 第11章 16位定時(shí)器Timer_B11.1 引 言11.2 Timer_B的操作11.2.1 定時(shí)器長(zhǎng)度11.2.2 定時(shí)器模式控制11.2.3 時(shí)鐘源選擇和分頻11.2.4 定時(shí)器啟動(dòng)11.3 定時(shí)器模式11.3.1 停止模式11.3.2 增計(jì)數(shù)模式11.3.3 連續(xù)模式11.3.4 增/減計(jì)數(shù)模式11.4 捕獲/比較模塊11.4.1 捕獲模式11.4.2 比較模式11.5 輸出單元11.5.1 輸出模式11.5.2 輸出控制模塊11.5.3 輸出舉例11.6 Timer_B的寄存器11.6.1 Timer_B控制寄存器TBCTL11.6.2 Timer_B寄存器TBR11.6.3 捕獲/比較控制寄存器CCTLx11.6.4 Timer_B中斷向量寄存器第12章 USART通信模塊的UART功能12.1 異步模式12.1.1 異步幀格式12.1.2 異步通信的波特率發(fā)生器12.1.3 異步通信格式12.1.4 線路空閑多機(jī)模式12.1.5 地址位多機(jī)通信格式12.2 中斷和中斷允許12.2.1 USART接收允許12.2.2 USART發(fā)送允許12.2.3 USART接收中斷操作12.2.4 USART發(fā)送中斷操作12.3 控制和狀態(tài)寄存器12.3.1 USART控制寄存器UCTL12.3.2 發(fā)送控制寄存器UTCTL12.3.3 接收控制寄存器URCTL12.3.4 波特率選擇和調(diào)整控制寄存器12.3.5 USART接收數(shù)據(jù)緩存URXBUF12.3.6 USART發(fā)送數(shù)據(jù)緩存UTXBUF12.4 UART模式，低功耗模式應(yīng)用特性12.4.1 由UART幀啟動(dòng)接收操作12.4.2 時(shí)鐘頻率的充分利用與UART的波特率12.4.3 多處理機(jī)模式對(duì)節(jié)約MSP430資源的支持12.5 波特率計(jì)算 第13章 USART通信模塊的SPI功能13.1 USART同步操作13.1.1 SPI模式中的主模式13.1.2 SPI模式中的從模式13.2 中斷與控制功能 13.2.1 USART接收/發(fā)送允許位及接收操作13.2.2 USART接收/發(fā)送允許位及發(fā)送操作13.2.3 USART接收中斷操作13.2.4 USART發(fā)送中斷操作13.3 控制與狀態(tài)寄存器13.3.1 USART控制寄存器13.3.2 發(fā)送控制寄存器UTCTL13.3.3 接收控制寄存器URCTL13.3.4 波特率選擇和調(diào)制控制寄存器13.3.5 USART接收數(shù)據(jù)緩存URXBUF13.3.6 USART發(fā)送數(shù)據(jù)緩存UTXBUF第14章 比較器Comparator_A14.1 概 述14.2 比較器A原理14.2.1 輸入模擬開(kāi)關(guān)14.2.2 輸入多路切換14.2.3 比較器14.2.4 輸出濾波器14.2.5 參考電平發(fā)生器14.2.6 比較器A中斷電路14.3 比較器A控制寄存器14.3.1 控制寄存器CACTL114.3.2 控制寄存器CACTL214.3.3 端口禁止寄存器CAPD14.4 比較器A應(yīng)用14.4.1 模擬信號(hào)在數(shù)字端口的輸入14.4.2 比較器A測(cè)量電阻元件14.4.3 兩個(gè)獨(dú)立電阻元件的測(cè)量系統(tǒng)14.4.4 比較器A檢測(cè)電流或電壓14.4.5 比較器A測(cè)量電流或電壓14.4.6 測(cè)量比較器A的偏壓14.4.7 比較器A的偏壓補(bǔ)償14.4.8 增加比較器A的回差第15章 模數(shù)轉(zhuǎn)換器ADC1215.1 概 述15.2 ADC12的工作原理及操作15.2.1 ADC內(nèi)核15.2.2 參考電平15.3 模擬輸入與多路切換15.3.1 模擬多路切換15.3.2 輸入信號(hào)15.3.3 熱敏二極管的使用15.4 轉(zhuǎn)換存儲(chǔ)15.5 轉(zhuǎn)換模式15.5.1 單通道單次轉(zhuǎn)換模式15.5.2 序列通道單次轉(zhuǎn)換模式15.5.3 單通道重復(fù)轉(zhuǎn)換模式15.5.4 序列通道重復(fù)轉(zhuǎn)換模式15.5.5 轉(zhuǎn)換模式之間的切換15.5.6 低功耗15.6 轉(zhuǎn)換時(shí)鐘與轉(zhuǎn)換速度15.7 采 樣15.7.1 采樣操作15.7.2 采樣信號(hào)輸入選擇15.7.3 采樣模式15.7.4 MSC位的使用15.7.5 采樣時(shí)序15.8 ADC12控制寄存器15.8.1 控制寄存器ADC12CTL0和ADC12CTL115.8.2 轉(zhuǎn)換存儲(chǔ)寄存器ADC12MEMx15.8.3 控制寄存器ADC12MCTLx15.8.4 中斷標(biāo)志寄存器ADC12IFG.x和中斷允許寄存器ADC12IEN.x15.8.5 中斷向量寄存器ADC12IV15.9 ADC12接地與降噪第16章 FLASH型芯片的開(kāi)發(fā)16.1 開(kāi)發(fā)系統(tǒng)概述16.1.1 開(kāi)發(fā)技術(shù)16.1.2 MSP430系列的開(kāi)發(fā)16.1.3 MSP430F系列的開(kāi)發(fā)16.2 FLASH型的fet開(kāi)發(fā)方法16.2.1 MSP430芯片的JTAG接口16.2.2 FLASH型仿真工具16.3 FLASH型的BOOT ROM16.3.1 標(biāo)準(zhǔn)復(fù)位過(guò)程和進(jìn)入BSL過(guò)程16.3.2 BSL的UART協(xié)議16.3.3 數(shù)據(jù)格式16.3.4 退出BSL16.3.5 保護(hù)口令16.3.6 BSL的內(nèi)部設(shè)置和資源附錄A 尋址空間附錄B 指令說(shuō)明B.1 指令匯總B.2 指令格式B.3 不增加ROM開(kāi)銷的模擬指令B.4 指令說(shuō)明（字母順序）B.5 用幾條指令模擬的宏指令附錄C MSP430系列單片機(jī)參數(shù)表附錄D MSP430系列單片機(jī)封裝形式附錄E MSP430系列器件命名
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自制單片機(jī)MSP-fet430仿真器 前言：本想到市場(chǎng)買(mǎi)個(gè)自制的MSP-fet430仿真工具，但看其做工可不敢恭維。于是打開(kāi)當(dāng)時(shí)千元購(gòu)買(mǎi)的fet（1個(gè)不夠用啊），又參網(wǎng)上提供的自制fet的資料，依南士接插件的外殼尺寸繪制了自認(rèn)為布板較合理的PCB使用。上圖為電路參考原型，注意圖中fet 的連接形式（25 針屏蔽電纜轉(zhuǎn)接線，長(zhǎng)度小于20 厘米的扁平線），這樣的連接更利于下載調(diào)試的可靠性。.....
標(biāo)簽： MSP-fet 430 單片機(jī) 仿真器
上傳時(shí)間： 2013-11-20
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Xilinx UltraScale™ 架構(gòu)針對(duì)要求最嚴(yán)苛的應(yīng)用，提供了前所未有的ASIC級(jí)的系統(tǒng)級(jí)集成和容量。 UltraScale架構(gòu)是業(yè)界首次在All Programmable架構(gòu)中應(yīng)用最先進(jìn)的ASIC架構(gòu)優(yōu)化。該架構(gòu)能從20nm平面fet結(jié)構(gòu)擴(kuò)展至16nm鰭式fet晶體管技術(shù)甚至更高的技術(shù)，同 時(shí)還能從單芯片擴(kuò)展到3D IC。借助Xilinx Vivado®設(shè)計(jì)套件的分析型協(xié)同優(yōu)化，UltraScale架構(gòu)可以提供海量數(shù)據(jù)的路由功能，同時(shí)還能智能地解決先進(jìn)工藝節(jié)點(diǎn)上的頭號(hào)系統(tǒng)性能瓶頸。 這種協(xié)同設(shè)計(jì)可以在不降低性能的前提下達(dá)到實(shí)現(xiàn)超過(guò)90%的利用率。 UltraScale架構(gòu)的突破包括： • 幾乎可以在晶片的任何位置戰(zhàn)略性地布置類似于ASIC的系統(tǒng)時(shí)鐘，從而將時(shí)鐘歪斜降低達(dá)50% • 系統(tǒng)架構(gòu)中有大量并行總線，無(wú)需再使用會(huì)造成時(shí)延的流水線，從而可提高系統(tǒng)速度和容量 • 甚至在要求資源利用率達(dá)到90%及以上的系統(tǒng)中，也能消除潛在的時(shí)序收斂問(wèn)題和互連瓶頸 • 可憑借3D IC集成能力構(gòu)建更大型器件，并在工藝技術(shù)方面領(lǐng)先當(dāng)前行業(yè)標(biāo)準(zhǔn)整整一代 • 能在更低的系統(tǒng)功耗預(yù)算范圍內(nèi)顯著提高系統(tǒng)性能，包括多Gb串行收發(fā)器、I/O以及存儲(chǔ)器帶寬 • 顯著增強(qiáng)DSP與包處理性能 賽靈思UltraScale架構(gòu)為超大容量解決方案設(shè)計(jì)人員開(kāi)啟了一個(gè)全新的領(lǐng)域。
標(biāo)簽： UltraScale Xilinx 架構(gòu)
上傳時(shí)間： 2013-11-17
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本資料是TI（德州儀器）推出的用于Xilinx和Altera FPGA的電源管理解決方案介紹。其主要內(nèi)容包括：低失真調(diào)整器、步減控制器、集成fet轉(zhuǎn)換器、低功率集成fet轉(zhuǎn)換器等。
標(biāo)簽： Xilinx Altera FPGA 電源管理
上傳時(shí)間： 2013-11-07
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