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fifo

FirstInputFirstOutput的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

fifo級聯(lián)

fifo級聯(lián)，利用verilog語言實(shí)現(xiàn)Xilinx fifo18單元的多個級聯(lián)，增大fifo深度。

標(biāo)簽： fifo 級聯(lián)

上傳時間： 2017-01-28

上傳用戶：skfreeman
操作系統(tǒng)實(shí)驗(yàn) 頁面置換 fifo LRU 最優(yōu)頁面調(diào)度算法opT

操作系統(tǒng)實(shí)驗(yàn) 頁面置換 fifo LRU 最優(yōu)頁面調(diào)度算法opT

標(biāo)簽： fifo LRU opT 頁

上傳時間： 2013-12-23

上傳用戶：lifangyuan12
一個用VHDL源碼編寫的先進(jìn)先出(fifo)緩沖器模塊.可以進(jìn)行fifo的仿真驗(yàn)證

一個用VHDL源碼編寫的先進(jìn)先出(fifo)緩沖器模塊.可以進(jìn)行fifo的仿真驗(yàn)證

標(biāo)簽： fifo VHDL 源碼模塊

上傳時間： 2014-02-28

上傳用戶：lunshaomo
另外一個用VHDL源碼編寫的fifo模塊程序,可以比較一下和fifo有什么區(qū)別.

另外一個用VHDL源碼編寫的fifo模塊程序,可以比較一下和fifo有什么區(qū)別.

標(biāo)簽： fifo VHDL 源碼模塊

上傳時間： 2017-02-05

上傳用戶：xlcky
fifo vhdl源碼

fifo vhdl源碼，高可靠性，帶有格雷碼同步，有需要可依進(jìn)行參考！

標(biāo)簽： fifo vhdl 源碼

上傳時間： 2014-01-20

上傳用戶：manking0408
EZ-USB的CY7C68013A實(shí)現(xiàn)Slave fifo的AutoIN。關(guān)鍵配置見TD_Init函數(shù)。

EZ-USB的CY7C68013A實(shí)現(xiàn)Slave fifo的AutoIN。關(guān)鍵配置見TD_Init函數(shù)。

標(biāo)簽： TD_Init EZ-USB 68013A C68013

上傳時間： 2014-12-01

上傳用戶：ynsnjs
VERILOG Synchronous fifo. 4 x 16 bit words.

VERILOG Synchronous fifo. 4 x 16 bit words.

標(biāo)簽： Synchronous VERILOG words fifo

上傳時間： 2017-02-18

上傳用戶：410805624
USB 2.0 fifo 工作模式 C語言編程 CY7C68013單片機(jī)

USB 2.0 fifo 工作模式 C語言編程 CY7C68013單片機(jī)

標(biāo)簽： C68013 68013 fifo USB

上傳時間： 2017-02-19

上傳用戶：baiom
fifo和計數(shù)器以及時鐘控制

fifo和計數(shù)器以及時鐘控制，用于程控交換機(jī)教學(xué)，與DSP和ADDA芯片配合完成程控交換機(jī)功能

標(biāo)簽： fifo 計數(shù)器時鐘控制

上傳時間： 2013-11-28

上傳用戶：410805624
fifo example vhdl code

fifo example vhdl code

標(biāo)簽： example fifo code vhdl

上傳時間： 2014-11-11

上傳用戶：康郎

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fifo

fifo級聯(lián)

操作系統(tǒng)實(shí)驗(yàn) 頁面置換 fifo LRU 最優(yōu)頁面調(diào)度算法opT

一個用VHDL源碼編寫的先進(jìn)先出(fifo)緩沖器模塊.可以進(jìn)行fifo的仿真驗(yàn)證

另外一個用VHDL源碼編寫的fifo模塊程序,可以比較一下和fifo有什么區(qū)別.

fifo vhdl源碼

EZ-USB的CY7C68013A實(shí)現(xiàn)Slave fifo的AutoIN。關(guān)鍵配置見TD_Init函數(shù)。

VERILOG Synchronous fifo. 4 x 16 bit words.

USB 2.0 fifo 工作模式 C語言編程 CY7C68013單片機(jī)

fifo和計數(shù)器以及時鐘控制

fifo example vhdl code