基于嵌入式技術(shù)的遠(yuǎn)程監(jiān)控系統(tǒng)可以達(dá)到動(dòng)態(tài)、無死角的監(jiān)控目的，可以對(duì)一些特殊環(huán)境進(jìn)行遠(yuǎn)程監(jiān)視和控制，且不受濕度、溫度等條件的影響，廣泛應(yīng)用于軍事、交通、智能家居、醫(yī)療監(jiān)護(hù)等多個(gè)領(lǐng)域。可以解決傳統(tǒng)監(jiān)控系統(tǒng)將圖像采集設(shè)備固定在一個(gè)地方而使監(jiān)控范圍有限，適用場(chǎng)合少等弊端。 本文設(shè)計(jì)了一款基于ARM和FPGA的遠(yuǎn)程監(jiān)控系統(tǒng)。首先在對(duì)遠(yuǎn)程監(jiān)控系統(tǒng)功能分析的基礎(chǔ)上，設(shè)計(jì)了以ARM為主控制器和FPGA為輔助控制器的硬件電路，采用ARM芯片控制圖像采集、速度采集、網(wǎng)絡(luò)傳輸?shù)雀蓴_小的模塊，采用FPGA芯片控制電機(jī)驅(qū)動(dòng)、舵機(jī)驅(qū)動(dòng)、電池監(jiān)控等干擾大的模塊，大大提高了系統(tǒng)的穩(wěn)定性；其次設(shè)計(jì)了基于WinCE操作系統(tǒng)的圖像采集、GPIO、PWM、外中斷EINT-19的流接口驅(qū)動(dòng)程序；同時(shí)設(shè)計(jì)了基于WinCE操作系統(tǒng)的圖像采集及壓縮、網(wǎng)絡(luò)通信、車模速度采集的應(yīng)用程序；FPGA內(nèi)部邏輯電路采用Verilog語言完成電源監(jiān)控、舵機(jī)控制、直流電機(jī)控制等功能。 本系統(tǒng)集圖像采集和壓縮、運(yùn)動(dòng)控制、網(wǎng)絡(luò)傳輸于一體。其圖像采集速度達(dá)30幀/秒，圖像分辨率達(dá)640x480，JPEG壓縮比達(dá)10：1，控制命令響應(yīng)時(shí)間為1s，網(wǎng)絡(luò)傳輸速率達(dá)10Mbps。其功能擴(kuò)展容易，功耗低，體積小，抗干擾能力強(qiáng)，具有很好的市場(chǎng)前景。
標(biāo)簽： FPGA ARM 遠(yuǎn)程監(jiān)控 系統(tǒng)設(shè)計(jì)
上傳時(shí)間： 2013-06-18
上傳用戶：heart520beat
利用FPGA來實(shí)現(xiàn)一個(gè)簡(jiǎn)單的醫(yī)療呼叫系統(tǒng)，使用語言VERILOG
標(biāo)簽： FPGA 呼叫系統(tǒng)
上傳時(shí)間： 2013-08-06
上傳用戶：kytqcool
書籍“無線通信fpga設(shè)計(jì)”里的源代碼實(shí)例，里面有verilog和MATLAB兩種語言實(shí)例
上傳時(shí)間： 2013-08-07
上傳用戶：jackandlee
華為內(nèi)部的FPGA設(shè)計(jì)培訓(xùn)教程，詳細(xì)闡述了設(shè)計(jì)流程圖、Verilog HDL設(shè)計(jì)、邏輯仿真、邏輯綜合。對(duì)大家的學(xué)習(xí)一定有幫助的。
上傳時(shí)間： 2013-08-08
上傳用戶：q123321
文章介紹了系統(tǒng)的硬件電路原理與具體實(shí)現(xiàn)方法，其中主要包括載波恢\r\n復(fù)電路，PN 碼捕獲電路和跟蹤電路，并針對(duì)Xilinx 公司FPGA 的特點(diǎn)，對(duì)各電\r\n路的實(shí)現(xiàn)進(jìn)行優(yōu)化設(shè)計(jì)，在不影響系統(tǒng)穩(wěn)定性和精度的前提下，減少硬件資源\r\n消耗，提高硬件利用率。設(shè)計(jì)利用Verilog 硬件描述語言完成，通過后仿真驗(yàn)證\r\n電路正確性，并給出綜合結(jié)果。
上傳時(shí)間： 2013-08-09
上傳用戶：qiaoyue
基于FPGA的紅外接收模塊，內(nèi)含代碼，采用VERILOG編寫。
上傳時(shí)間： 2013-08-10
上傳用戶：lyy1234
FPGA與USB通信的測(cè)試代碼，包括FPGA中的程序（Verilog編寫）和PC機(jī)上的主控程序以及USB固件程序。
標(biāo)簽： FPGA USB 通信 測(cè)試代碼
上傳時(shí)間： 2013-08-11
上傳用戶：acwme
《FPGA數(shù)字電子系統(tǒng)設(shè)計(jì)與開發(fā)實(shí)例導(dǎo)航》的配套光盤，Verilog編寫，USB、I2C、MAC的接口設(shè)計(jì)
標(biāo)簽： FPGA 數(shù)字電子 開發(fā)實(shí)例 導(dǎo)航
上傳時(shí)間： 2013-08-12
上傳用戶：xa_lgy
FPGA&SOPC快速入門教程(PDF)，基于Verilog HDL語言，開發(fā)環(huán)境Quartus
上傳時(shí)間： 2013-08-14
上傳用戶：半熟1994
東南大學(xué)Verilog講義.rar\\\\r\\\\n高級(jí)FPGA教學(xué)實(shí)驗(yàn)指導(dǎo)書－邏輯設(shè)計(jì)部分.pdf\\\\r\\\\n...
標(biāo)簽： Verilog 東南大學(xué) 講義
上傳時(shí)間： 2013-08-15
上傳用戶：黃華強(qiáng)
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