FPGA開(kāi)發(fā)板上寫(xiě)的Verilog代碼：\r\n功能是從電腦端發(fā)送一個(gè)字節(jié)，然后把它接收回來(lái)。\r\n
標(biāo)簽： Verilog FPGA 開(kāi)發(fā)板 代碼
上傳時(shí)間： 2013-08-15
上傳用戶：copu
采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路
標(biāo)簽： Altera FPGA HDLC plus
上傳時(shí)間： 2013-08-16
上傳用戶：ommshaggar
matlab在fpga中的應(yīng)用的三個(gè)具體事例，。
標(biāo)簽： matlab fpga 中的應(yīng)用
上傳用戶：從此走出陰霾
DSP2812開(kāi)發(fā)板板上的CPLD源代碼
標(biāo)簽： 2812 CPLD DSP 開(kāi)發(fā)板
上傳用戶：小草123
Xilinx的FPGA 中的matlab simulink建模，內(nèi)有幾種調(diào)制方式，比如QPSK等
標(biāo)簽： simulink Xilinx matlab FPGA
上傳用戶：zhishenglu
ＲＳ編碼在ＦＰＧＡ上實(shí)現(xiàn)的理論和方法，對(duì)設(shè)計(jì)ＲＳ編碼很有幫助，且ＦＯＧＡ資源占有少
標(biāo)簽： 編碼
上傳用戶：chens000
無(wú)線通信的FPGA實(shí)現(xiàn)及Matlab程序
標(biāo)簽： Matlab FPGA 無(wú)線通信 程序
上傳時(shí)間： 2013-08-17
上傳用戶：lifangyuan12
USB在FPGA上的實(shí)現(xiàn)，包括源碼測(cè)試平臺(tái)，測(cè)試向量，很實(shí)用。
標(biāo)簽： FPGA USB
上傳時(shí)間： 2013-08-18
上傳用戶：guojin_0704
lab1——FPGA這個(gè)文件中體統(tǒng)了如何如何使用verilog Hdl以及如何使其在FPGA開(kāi)發(fā)板上實(shí)現(xiàn)
標(biāo)簽： verilog FPGA Hdl 如何使用
上傳用戶：qwe1234
一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個(gè)典型VRILOGHDL的FPGA實(shí)驗(yàn),有幫助,
標(biāo)簽： VRILOGHDL SPATAN XILIX FPGA
上傳時(shí)間： 2013-08-19
上傳用戶：偷心的海盜
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