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mpEG-I

  • MPEG-2傳送流特殊信息處理的FPGA實(shí)現(xiàn)研究

      本文介紹了如何利用FPGA(FieldProgrammableGateArray)技術(shù)來實(shí)現(xiàn)傳送流特殊信息的處理,其主要內(nèi)容如下:1.介紹了MPEG-2傳送流系統(tǒng)層的語法規(guī)范;2.描述了傳送流特殊信息之間的結(jié)構(gòu)關(guān)系;3.簡要介紹了傳送流復(fù)用的原理和實(shí)現(xiàn)方法;4.詳細(xì)討論了如何用FPGA技術(shù)來實(shí)現(xiàn)對特殊信息的處理;整個(gè)項(xiàng)目的設(shè)計(jì)采用VHDL作為程序設(shè)計(jì)語言,都是以Xilinx的FPGA芯片及其ISE5.2i作為開發(fā)系統(tǒng)進(jìn)行的。

    標(biāo)簽: MPEG FPGA 傳送 信息處理

    上傳時(shí)間: 2013-06-11

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  • MPEG-4解碼關(guān)鍵技術(shù)研究及FPGA實(shí)現(xiàn)

      本論文將在對MPEG-4解碼中的幾種關(guān)鍵技術(shù)的充分理解和算法分析的基礎(chǔ)之上,結(jié)合FPGA的靈活性,采用VHDL語言對幾種關(guān)鍵技術(shù)在應(yīng)用層面上進(jìn)行結(jié)構(gòu)設(shè)計(jì)并仿真驗(yàn)證。 本文討論了一種高吞吐量流水方式構(gòu)建的MPEG-4可變長解碼器的設(shè)計(jì)。在這種解碼器中,我們采用了基于PLA的并行  解碼算法,這種算法能夠?qū)崿F(xiàn)每個(gè)時(shí)鐘解碼一個(gè)碼字。同時(shí),為了提高解碼的效率,降低操作的延遲,我們在設(shè)計(jì)中還引入了流水線操作方式、碼表分割等技術(shù),這些技術(shù)有利于并行操作的實(shí)現(xiàn)。 本論文的設(shè)計(jì)充分利用IDCT算法對稱性,用高度的并行結(jié)構(gòu)來加速處理,采用一維IDCT單元復(fù)用的方式來實(shí)現(xiàn)二維IDCT運(yùn)算,并提出一種基于加法操作的結(jié)構(gòu)來取代乘法操作,實(shí)現(xiàn)了一種高效二維逆DCT變換處理器。  

    標(biāo)簽: MPEG FPGA 解碼 關(guān)鍵技術(shù)

    上傳時(shí)間: 2013-06-02

    上傳用戶:MATAIYES

  • 一種8 位I O口的單片機(jī)顯示器和鍵盤接口

    一種8 位I/O口的單片機(jī)顯示器和鍵盤接口

    標(biāo)簽: 單片機(jī) 顯示器 鍵盤接口

    上傳時(shí)間: 2013-07-29

    上傳用戶:標(biāo)點(diǎn)符號

  • 一種面向無線視頻傳感器網(wǎng)絡(luò)的低復(fù)雜度視頻編碼算法及其在ARM平臺上的實(shí)現(xiàn)

    隨著21世紀(jì)的到來,計(jì)算機(jī)技術(shù),信息處理技術(shù),半導(dǎo)體技術(shù)和網(wǎng)絡(luò)技術(shù)不斷發(fā)展,人類社會進(jìn)入了信息化時(shí)代。與此同時(shí),無線視頻傳感器網(wǎng)絡(luò)也得到了突飛猛進(jìn)的發(fā)展,成為當(dāng)今國際上備受關(guān)注的熱點(diǎn)研究領(lǐng)域。無線視頻傳感器網(wǎng)絡(luò)有著很多的優(yōu)點(diǎn)和十分廣泛的應(yīng)用前景。在軍事,工業(yè),城市管理和監(jiān)控系統(tǒng)等重要領(lǐng)域都有潛在的使用價(jià)值。 無線視頻傳感器網(wǎng)絡(luò)有著顯著的特征,例如:網(wǎng)絡(luò)節(jié)點(diǎn)能源有限;網(wǎng)絡(luò)帶寬有限;對處理速度要求較高等。由此可見,傳統(tǒng)的視頻編碼標(biāo)準(zhǔn)無法應(yīng)用于無線視頻傳感器網(wǎng)絡(luò)。MPEG-4,H.263,H.264等視頻編碼標(biāo)準(zhǔn),全是基于運(yùn)動估計(jì)補(bǔ)償實(shí)現(xiàn)的,計(jì)算量十分巨大,在能量,存儲空間和處理能力均有限的節(jié)點(diǎn)難以實(shí)現(xiàn)這類高復(fù)雜度的編碼算法。 本文針對無線視頻傳感器網(wǎng)絡(luò)對視頻編碼算法的具體需求,提出一種基于運(yùn)動檢測的低復(fù)雜度視頻編碼算法。該算法只對當(dāng)前編碼幀中的運(yùn)動對象進(jìn)行編碼,并且以面向?qū)ο蟮慕Y(jié)構(gòu)輸出碼流。實(shí)驗(yàn)結(jié)果表明,與H.264全I(xiàn)幀編碼相比,本文提出的算法編碼速度提高了約3倍,編碼性能提高了約2dB。與H.264基本檔次相比,雖然編碼性能略有下降,但是編碼速度平均提高了8倍左右。因此,本文提出的算法可以在編碼效率和編碼速度之間獲得很好的折衷,在一定程度上可以滿足無線視頻傳感器網(wǎng)絡(luò)的需求。 本文選用ALDVK_270作為硬件實(shí)驗(yàn)平臺。在分析算法結(jié)構(gòu)的同時(shí),結(jié)合嵌入式系統(tǒng)的特點(diǎn),從算法,內(nèi)存,高級語言和匯編語言等幾個(gè)方面提出優(yōu)化方案,最終在ARM嵌入式平臺下實(shí)現(xiàn)了面向無線視頻傳感器網(wǎng)絡(luò)的低復(fù)雜度視頻編碼算法。測試結(jié)果表明,與優(yōu)化前相比,優(yōu)化后的編碼速度有了很大的提高,對于CIF格式的監(jiān)控視頻序列能夠滿足實(shí)時(shí)處理的要求。

    標(biāo)簽: ARM 無線視頻 傳感器網(wǎng)絡(luò) 復(fù)雜度

    上傳時(shí)間: 2013-07-26

    上傳用戶:小小小熊

  • I/O并行口直接驅(qū)動LED顯示的電路圖及源程序

    I/O并行口直接驅(qū)動LED顯示1. 實(shí)驗(yàn)任務(wù) 如圖13所示,利用AT89S51單片機(jī)的P0端口的P0.0-P0.7連接到一個(gè)共陰數(shù)碼管的a-h(huán)的筆段上,數(shù)碼管的公共端接地。在數(shù)碼

    標(biāo)簽: LED 并行口 直接驅(qū)動 電路圖

    上傳時(shí)間: 2013-06-15

    上傳用戶:kytqcool

  • 一種簡單高效的MPEG-2 MP@HL視頻解碼器

    本文基于數(shù)據(jù)驅(qū)動原理提出并用 FPGA 實(shí)現(xiàn)了MPEG-2 MP@HL 的視頻解碼器。該解碼器中的各個(gè)模塊具有高內(nèi)聚,低耦合的特點(diǎn)。只要各個(gè)模塊符合數(shù)據(jù)驅(qū)動的工作方式,模塊就能自我正常工作。由

    標(biāo)簽: MPEG 視頻解碼器

    上傳時(shí)間: 2013-06-19

    上傳用戶:y562413679

  • 基于FPGA的MPEG4編解碼芯片開發(fā)系統(tǒng)設(shè)計(jì)研究

    MPEG-4是目前非常流行的視頻壓縮標(biāo)準(zhǔn),基于MPEG-4的視頻處理系統(tǒng)有兩種體系結(jié)構(gòu):可編程結(jié)構(gòu)和專用結(jié)構(gòu).可編程結(jié)構(gòu)靈活,適用范圍廣,易于升級,但電路復(fù)雜,電路功耗大.專用視頻編解碼器結(jié)構(gòu)硬件開銷小,處理速度高.該文主要研究專用的MPEG-4視頻編解碼芯片設(shè)計(jì)方法.目前市場上MPEG-4視頻編解碼芯片主要是Simple Profile級別的,而我們設(shè)計(jì)的芯片要實(shí)現(xiàn)Advanced Simple Profile級別.該文采用了一種基于大規(guī)模FPGA的軟硬件相結(jié)的芯片設(shè)計(jì)方案,我們設(shè)計(jì)了基于FPGA的MPEG-4芯片設(shè)計(jì)開發(fā)平臺,完成算法的硬件仿真與測試.論文圍繞基于FPGA的MPEG-4芯片開發(fā)系統(tǒng)設(shè)計(jì),分為兩個(gè)部分.第一部分介紹了目前國內(nèi)外實(shí)現(xiàn)MPEG-4視頻處理系統(tǒng)的主要方法和應(yīng)用,概述了國際上MPEG-4視頻編解碼芯片設(shè)計(jì)的一般方法及其發(fā)展趨勢,詳細(xì)描述了我們的基于FPGA的MPEG-4編解碼芯片開發(fā)系統(tǒng)的結(jié)構(gòu).第二部分重點(diǎn)講述了基于FPGA的MPEG-4芯片開發(fā)系統(tǒng)各個(gè)電路模塊的設(shè)計(jì),包括電源模塊、FPGA配置模塊、時(shí)鐘生成模塊、視頻輸入/輸出模塊、RS232串口模塊、以太網(wǎng)接口模塊、USB接口模塊等.同時(shí)也介紹了I

    標(biāo)簽: MPEG4 FPGA 編解碼芯片 開發(fā)系統(tǒng)

    上傳時(shí)間: 2013-06-15

    上傳用戶:it男一枚

  • 用FPGA實(shí)現(xiàn)MPEG-2數(shù)字圖像傳輸流語義分析和協(xié)議解析功能

    本文首先分析數(shù)字圖像壓縮技術(shù)的實(shí)際應(yīng)用情況,相關(guān)的DVB技術(shù)標(biāo)準(zhǔn)和測試標(biāo)準(zhǔn)ETR290,進(jìn)而提出了一個(gè)可適用于實(shí)際工作環(huán)境的語義分析模型框架;并在FPGA開發(fā)環(huán)境ISE中按照這個(gè)語義分析模型框架構(gòu)造了一個(gè)具體的VHDL模型;同時(shí)利用工具軟件Synplify和modelsim完成軟件功能和時(shí)序仿真;然后設(shè)計(jì)相應(yīng)的硬件測試平臺來驗(yàn)證模塊功能。針對數(shù)字圖像技術(shù)實(shí)際應(yīng)用環(huán)境的特點(diǎn),本文提出了一種構(gòu)建在嵌入式硬件平臺上的分析模塊,可實(shí)時(shí)分析MPEG-2傳輸流語法。通過連接TCP/IP網(wǎng)絡(luò)可實(shí)現(xiàn)24小時(shí)/7天長時(shí)間工作。模塊化的設(shè)計(jì),使其可以安裝于各種設(shè)備或?qū)嶋H應(yīng)用環(huán)境中的各關(guān)鍵節(jié)點(diǎn),通過網(wǎng)絡(luò)傳輸?shù)浇y(tǒng)一的服務(wù)器;同時(shí)該模塊可設(shè)置成不同的硬件觸發(fā)模式,使之成為故障傳感器。因此,該模塊適用于工程開通、快速故障監(jiān)測、長時(shí)間監(jiān)控等。通過與市場上專業(yè)測試設(shè)備性能進(jìn)行比較,在測試精確性方面不占優(yōu)勢,但在達(dá)到一定數(shù)量級的測試精度后,其廉價(jià)、簡易和無需維護(hù)的特點(diǎn)將呈現(xiàn)巨大的優(yōu)勢。

    標(biāo)簽: FPGA MPEG 數(shù)字圖像 傳輸流

    上傳時(shí)間: 2013-04-24

    上傳用戶:源弋弋

  • USBCAN-I/II智能CAN接口卡驅(qū)動庫

    USBCAN-I/II 智能CAN接口卡驅(qū)動庫 V1.3

    標(biāo)簽: USBCAN-I CAN II 接口卡

    上傳時(shí)間: 2013-07-11

    上傳用戶:semi1981

  • MPEG-4編解碼的實(shí)現(xiàn)(包括MPEG4視音頻編解碼)

    ·詳細(xì)說明:MPEG-4編解碼的實(shí)現(xiàn)(包括MPEG4視音頻編解碼)-MPEG-4 arranges the decoding the realization. Regards the audio frequency including MPEG4 to arrange the decoding. 文件列表:   7   .\MPEG-4IP   .\........\a

    標(biāo)簽: MPEG4 MPEG 編解碼 視音頻編解碼

    上傳時(shí)間: 2013-05-16

    上傳用戶:natopsi

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