減小電磁干擾的印刷電路板設計原則 內 容 摘要……1 1 背景…1 1.1 射頻源.1 1.2 表面貼裝芯片和通孔元器件.1 1.3 靜態引腳活動引腳和輸入.1 1.4 基本回路……..2 1.4.1 回路和偶極子的對稱性3 1.5 差模和共模…..3 2 電路板布局…4 2.1 電源和地…….4 2.1.1 感抗……4 2.1.2 兩層板和四層板4 2.1.3 單層板和二層板設計中的微處理器地.4 2.1.4 信號返回地……5 2.1.5 模擬數字和高壓…….5 2.1.6 模擬電源引腳和模擬參考電壓.5 2.1.7 四層板中電源平面因該怎么做和不應該怎么做…….5 2.2 兩層板中的電源分配.6 2.2.1 單點和多點分配.6 2.2.2 星型分配6 2.2.3 格柵化地.7 2.2.4 旁路和鐵氧體磁珠……9 2.2.5 使噪聲靠近磁珠……..10 2.3 電路板分區…11 2.4 信號線……...12 2.4.1 容性和感性串擾……...12 2.4.2 天線因素和長度規則...12 2.4.3 串聯終端傳輸線…..13 2.4.4 輸入阻抗匹配...13 2.5 電纜和接插件……...13 2.5.1 差模和共模噪聲……...14 2.5.2 串擾模型……..14 2.5.3 返回線路數目..14 2.5.4 對板外信號I/O的建議14 2.5.5 隔離噪聲和靜電放電ESD .14 2.6 其他布局問題……...14 2.6.1 汽車和用戶應用帶鍵盤和顯示器的前端面板印刷電路板...15 2.6.2 易感性布局…...15 3 屏蔽..16 3.1 工作原理…...16 3.2 屏蔽接地…...16 3.3 電纜和屏蔽旁路………………..16 4 總結…………………………………………17 5 參考文獻………………………17
上傳時間： 2013-10-22
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PCB設計問題集錦 問：PCB圖中各種字符往往容易疊加在一起，或者相距很近，當板子布得很密時，情況更加嚴重。當我用Verify Design進行檢查時，會產生錯誤，但這種錯誤可以忽略。往往這種錯誤很多，有幾百個，將其他更重要的錯誤淹沒了，如何使Verify Design會略掉這種錯誤，或者在眾多的錯誤中快速找到重要的錯誤。 答：可以在顏色顯示中將文字去掉,不顯示后再檢查;并記錄錯誤數目。但一定要檢查是否真正屬于不需要的文字。 問： What’s mean of below warning:(6230,8330 L1) Latium Rule not checked: COMPONENT U26 component rule.答：這是有關制造方面的一個檢查，您沒有相關設定，所以可以不檢查。 問： 怎樣導出jop文件？答：應該是JOB文件吧？低版本的powerPCB與PADS使用JOB文件。現在只能輸出ASC文件，方法如下STEP：FILE/EXPORT/選擇一個asc名稱/選擇Select ALL/在Format下選擇合適的版本/在Unit下選Current比較好/點擊OK/完成然后在低版本的powerPCB與PADS產品中Import保存的ASC文件，再保存為JOB文件。 問： 怎樣導入reu文件？答：在ECO與Design 工具盒中都可以進行，分別打開ECO與Design 工具盒，點擊右邊第2個圖標就可以。 問： 為什么我在pad stacks中再設一個via:1(如附件）和默認的standardvi(如附件）在布線時V選擇1，怎么布線時按add via不能添加進去這是怎么回事，因為有時要使用兩種不同的過孔。答：PowerPCB中有多個VIA時需要在Design Rule下根據信號分別設置VIA的使用條件，如電源類只能用Standard VIA等等，這樣操作時就比較方便。詳細設置方法在PowerPCB軟件通中有介紹。 問：為什么我把On-line DRC設置為prevent..移動元時就會彈出(圖2),而你們教程中也是這樣設置怎么不會呢?答：首先這不是錯誤,出現的原因是在數據中沒有BOARD OUTLINE.您可以設置一個,但是不使用它作為CAM輸出數據. 問：我用ctrl+c復制線時怎設置原點進行復制，ctrl+v粘帖時總是以最下面一點和最左邊那一點為原點 答： 復制布線時與上面的MOVE MODE設置沒有任何關系,需要在右鍵菜單中選擇,這在PowerPCB軟件通教程中有專門介紹. 問：用(圖4)進行修改線時拉起時怎總是往左邊拉起(圖5)，不知有什么辦法可以輕易想拉起左就左，右就右。答： 具體條件不明,請檢查一下您的DESIGN GRID,是否太大了. 問： 好不容易拉起右邊但是用(圖6)修改線怎么改怎么下面都會有一條不能和在一起，而你教程里都會好好的(圖8)答：這可能還是與您的GRID 設置有關,不過沒有問題,您可以將不需要的那段線刪除.最重要的是需要找到布線的感覺,每個軟件都不相同,所以需要多練習。 問： 尊敬的老師:您好！這個圖已經畫好了，但我只對（如圖1）一種的完全間距進行檢查，怎么錯誤就那么多，不知怎么改進。請老師指點。這個圖在附件中請老師幫看一下，如果還有什么問題請指出來，本人在改進。謝！！！！！答：請注意您的DRC SETUP窗口下的設置是錯誤的,現在選中的SAME NET是對相同NET進行檢查,應該選擇NET TO ALL.而不是SAME NET有關各項參數的含義請仔細閱讀第5部教程. 問： U101元件已建好，但元件框的拐角處不知是否正確，請幫忙CHECK 答：元件框等可以通過修改編輯來完成。問： U102和U103元件沒建完全，在自動建元件參數中有幾個不明白：如：SOIC--》silk screen欄下spacing from pin與outdent from first pin對應U102和U103元件應寫什么數值，還有這兩個元件SILK怎么自動設置，以及SILK內有個圓圈怎么才能畫得與該元件參數一致。 答：Spacing from pin指從PIN到SILK的Y方向的距離,outdent from first pin是第一PIN與SILK端點間的距離.請根據元件資料自己計算。
上傳時間： 2014-01-03
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隨著高頻微波在日常生活上的廣泛應用，例如行動電話、無線個人計算機、無線網絡等，高頻電路的技術也日新月異。良好的高頻電路設計的實現與改善，則建立在于精確的組件模型的基礎上。被動組件如電感、濾波器等的電路模型與電路制作的材料、制程有緊密的關系，而建立這些組件等效電路模型的方法稱為參數萃取。 早期的電感制作以金屬繞線為主要的材料與技術，而近年來，由于高頻與高速電路的應用日益廣泛，加上電路設計趨向輕薄短小，電感制作的材質與技術也不斷的進步。例如射頻機體電路（RFIC）運用硅材質，微波集成電路則廣泛的運用砷化鎵（GaAs）技術；此外，在低成本的無線通訊射頻應用上，如混合（Hybrid）集成電路則運用有機多芯片模塊（MCMs）結合傳統的玻璃基板制程，以及低溫共燒陶瓷（LTCC）技術，制作印刷式平面電感等，以提升組件的質量與效能，并減少體積與成本。 本章的重點包涵探討電感的原理與專有名詞，以及以常見的電感結構，并分析影響電感效能的主要因素與其電路模型，最后將以電感的模擬設計為例，說明電感參數的萃取。
上傳時間： 2014-06-16
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I2C總線器件在高抗干擾系統中的應用: 摘要：本文先對I2C總線協議進行了簡要敘述，然后介紹了一些常用的抗干擾措施，最后提供了一個利用I2C總線器件24WC01組成的高抗干擾應用方案。 一、I2C總線概述 I2C總線是一雙線串行總線，它提供一小型網絡系統為總線上的電路共享公共的總線。總線上的器件有單片機LCD驅動器以及E2PROM器等。型號有：PCF8566T、SAA1064T、24WC01等。 兩根雙向線中，一根是串行數據線（SDA），另一根是串行時鐘線（SCL）。總線和器件間的數據傳送均由這根線完成。每一個器件都有一個唯一的地址，以區別總線上的其它器件。當執行數據傳送時，誰是主器件，誰是從器件詳見表1。主器件是啟動數據發送并產生時鐘信號的器件。被尋址的任何器件都可看作從器件。I2C總線是多主機總線，意思是可以兩個或更多的能夠控制總線的器件與總線連接。
上傳時間： 2013-11-17
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半導體的產品很多，應用的場合非常廣泛，圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別，圖一中不同類別的英文縮寫名稱原文為 PDID：Plastic Dual Inline Package SOP：Small Outline Package SOJ：Small Outline J-Lead Package PLCC：Plastic Leaded Chip Carrier QFP：Quad Flat Package PGA：Pin Grid Array BGA：Ball Grid Array 雖然半導體元件的外型種類很多，在電路板上常用的組裝方式有二種，一種是插入電路板的銲孔或腳座，如PDIP、PGA，另一種是貼附在電路板表面的銲墊上，如SOP、SOJ、PLCC、QFP、BGA。 從半導體元件的外觀，只看到從包覆的膠體或陶瓷中伸出的接腳，而半導體元件真正的的核心，是包覆在膠體或陶瓷內一片非常小的晶片，透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件，從上方的玻璃窗可看到內部的晶片，圖三是以顯微鏡將內部的晶片放大，可以看到晶片以多條銲線連接四周的接腳，這些接腳向外延伸並穿出膠體，成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂，那是使用不當引發過電流而燒毀，致使晶片失去功能，這也是一般晶片遭到損毀而失效的原因之一。 圖四是常見的LED，也就是發光二極體，其內部也是一顆晶片，圖五是以顯微鏡正視LED的頂端，可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線，若以LED二支接腳的極性來做分別，晶片是貼附在負極的腳上，經由銲線連接正極的腳。當LED通過正向電流時，晶片會發光而使LED發亮，如圖六所示。 半導體元件的製作分成兩段的製造程序，前一段是先製造元件的核心─晶片，稱為晶圓製造；後一段是將晶中片加以封裝成最後產品，稱為IC封裝製程，又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟，在本章節中將簡介這兩段的製造程序。
上傳時間： 2013-11-04
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基于分析因俯仰角、滾轉角、偏航角等無人機姿態角變化對下視景象余輝處理圖產生的影響，在構建下視景象成像幾何畸變數學模型的基礎上，本文闡述了一種下視景像姿態畸變的余輝處理的模擬仿真方法，以獲得規律性變化的余輝線段。通過對隨機亮點圖進行不同姿態角的余輝仿真，得到余輝仿真圖。仿真實驗結果驗證了該方法的正確性，不同無人機姿態的余輝仿真得到特征各異的余輝圖。
上傳時間： 2013-11-08
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針對在xPC平臺下開發的實時仿真系統依賴于MATLAB環境，影響其在工程實踐中推廣應用的問題，提出了一種基于xPC Target和LabWindows/CVI的實時仿真系統設計方法。采用該方法設計的仿真系統，實現了獨立的宿主機程序，同時利用LabWindows/CVI虛擬儀器技術開發出了主控臺仿真軟件。經仿真驗證，該系統具備仿真步長1 ms，數據通訊周期20 ms，顯示更新周期20 ms的實時仿真能力。仿真系統界面友好且易于操作，為xPC平臺下的實時仿真系統在工程實際的應用提供了有益參考。
上傳時間： 2013-10-10
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根據紅外遙控芯片BA5104的編碼格式，探討使用AVR單片機ATmega16進行軟件解碼的兩種方法：外部中斷解碼法和輸入捕獲功能解碼法。詳細闡述這兩種解碼方法的思路，并給出相應的解碼中斷服務子程序。分析這2種解碼方法的優缺點，得出輸入捕獲功能解碼法比外部中斷解碼法效率更高、解出的遙控碼更穩定、可靠的結論。
上傳時間： 2013-11-21
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基于探索電容濾波電路工作波形仿真實驗技術的目的，采用Multisim10仿真軟件對電容濾波電路的工作波形進行了仿真實驗測試，給出了Multisim仿真實驗方案，仿真分析了濾波電容選取不同數值時電路工作波形、電路性能的變化情況。結論是仿真實驗可直觀形象地描述電容濾波電路的工作特性，有利于系統地研究電路的構成及電路元件參數的選擇。
上傳時間： 2015-01-02
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介紹了以RC串并聯選頻網絡為主振電路的電子琴設計方法，給出了八音階電子琴電路參數的設計方法和一組參數值。 并采用Multisim10對RC串并聯正弦波振蕩電路進行了設計仿真。結果證明，用模擬電路方法制作電子琴結構簡單，而且成本低廉，符合C音調基準音標準。
上傳時間： 2014-01-16
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