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ucTCP/IP

  • altera的FFT IP核的用戶手冊

    altera的FFT IP核的用戶手冊,介紹了如何使用ALTERA IP核生成FFT核,如何設(shè)置參數(shù)并講述了如何仿真,適用于通信方面的FPGA設(shè)計(jì)工程師,學(xué)生

    標(biāo)簽: altera FFT IP核 用戶手冊

    上傳時(shí)間: 2013-04-24

    上傳用戶:wanqunsheng

  • 免費(fèi)的TCP/IP協(xié)議棧uIP規(guī)范文本

    本文是免費(fèi)的TCP/IP協(xié)議棧uIP的規(guī)范文本,英文版。

    標(biāo)簽: TCP uIP IP 協(xié)議棧

    上傳時(shí)間: 2013-04-24

    上傳用戶:hrzx1234

  • 免費(fèi)的TCP/IP協(xié)議棧uIP源碼

    壓縮包內(nèi)是免費(fèi)的TCP/IP協(xié)議棧uIP源碼。

    標(biāo)簽: TCP uIP IP 協(xié)議棧

    上傳時(shí)間: 2013-06-25

    上傳用戶:關(guān)外河山

  • fpga的spi的IP核

    ALTERA的spi的ip核,里面有詳細(xì)的過程歡迎下載

    標(biāo)簽: fpga spi IP核

    上傳時(shí)間: 2013-04-24

    上傳用戶:z1191176801

  • IP核實(shí)現(xiàn)與單片機(jī)和ARM的串口通信(FPGA的51)

    利用FPGA的51 ,IP核實(shí)現(xiàn)與單片機(jī)和ARM的串口通信

    標(biāo)簽: FPGA ARM 51 IP核

    上傳時(shí)間: 2013-08-05

    上傳用戶:lalaruby

  • 在測控系統(tǒng)中用IP核實(shí)現(xiàn)DA轉(zhuǎn)換

    在測控系統(tǒng)中用IP核實(shí)現(xiàn)DA轉(zhuǎn)換.doc

    標(biāo)簽: 測控系統(tǒng) IP核 DA轉(zhuǎn)換

    上傳時(shí)間: 2013-08-13

    上傳用戶:13736136189

  • Run Pac-man Game Based on 8086/8088 FPGA IP Core

    Run Pac-man Game Based on 8086/8088 FPGA IP Core

    標(biāo)簽: Pac-man Based Game 8086

    上傳時(shí)間: 2013-08-23

    上傳用戶:JamesB

  • arm9_fpga2_verilog是一個(gè)可以綜合的用verilog寫的arm9的ip軟核

    arm9_fpga2_verilog是一個(gè)可以綜合的用verilog寫的arm9的ip軟核,對學(xué)習(xí)arm和FPGA開發(fā)有幫助。

    標(biāo)簽: verilog fpga arm9 arm

    上傳時(shí)間: 2013-08-23

    上傳用戶:xlcky

  • FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼

    關(guān)于FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼。

    標(biāo)簽: FPGA VHDL 常識(shí) IP核

    上傳時(shí)間: 2013-09-03

    上傳用戶:tsfh

  • 充分利用IP以及拓?fù)湟?guī)劃提高PCB設(shè)計(jì)效率

    本文探討的重點(diǎn)是PCB設(shè)計(jì)人員利用IP,并進(jìn)一步采用拓?fù)湟?guī)劃和布線工具來支持IP,快速完成整個(gè)PCB設(shè)計(jì)。從圖1可以看出,設(shè)計(jì)工程師的職責(zé)是通過布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計(jì)人員,由他們完成剩余的設(shè)計(jì)。 圖1:設(shè)計(jì)工程師獲取IP,PCB設(shè)計(jì)人員進(jìn)一步采用拓?fù)湟?guī)劃和布線工具支持IP,快速完成整個(gè)PCB設(shè)計(jì)。現(xiàn)在無需再通過設(shè)計(jì)工程師和PCB設(shè)計(jì)人員之間的交互和反復(fù)過程來獲取正確的設(shè)計(jì)意圖,設(shè)計(jì)工程師已經(jīng)獲取這些信息,并且結(jié)果相當(dāng)精確,這對PCB設(shè)計(jì)人員來說幫助很大。在很多設(shè)計(jì)中,設(shè)計(jì)工程師和PCB設(shè)計(jì)人員要進(jìn)行交互式布局和布線,這會(huì)消耗雙方許多寶貴的時(shí)間。從以往的經(jīng)歷來看交互操作是必要的,但很耗時(shí)間,且效率低下。設(shè)計(jì)工程師提供的最初規(guī)劃可能只是一個(gè)手工繪圖,沒有適當(dāng)比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計(jì)人員參與到設(shè)計(jì)中來,雖然采用拓?fù)湟?guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過,這個(gè)設(shè)計(jì)可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計(jì)人員需要采用拓?fù)湟?guī)劃,并與經(jīng)過布局的和尚未布局的元件進(jìn)行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計(jì)效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓?fù)湟?guī)劃被獲取,布局可能先于最終拓?fù)湟?guī)劃完成。因此,一些拓?fù)渎窂娇赡鼙仨毰c現(xiàn)有布局一起工作。雖然它們的優(yōu)先級較低,但仍需要進(jìn)行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級規(guī)劃可能需要更多細(xì)節(jié)來為其它信號(hào)提供必要的優(yōu)先級。

    標(biāo)簽: PCB 利用IP 拓?fù)湟?guī)劃

    上傳時(shí)間: 2013-10-12

    上傳用戶:sjyy1001

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