verilog行為建模PDF中文版本 verilog行為建模PDF中文版本
標簽： verilog 建模 版本
上傳時間： 2014-01-27
上傳用戶：daguda
verilog結構PDF中文版本 verilog結構PDF中文版本
標簽： verilog 版本
上傳時間： 2016-02-11
上傳用戶：semi1981
用Verilog編寫crc校驗碼，包括8位，12位，16位，32位，非常實用
標簽： Verilog crc 編寫 校驗碼
上傳用戶：asddsd
Synchronous read write RAM verilog。經過modelsim se仿真。
標簽： Synchronous modelsim verilog write
上傳時間： 2013-12-19
上傳用戶：zhenyushaw
Content Addressable Memory 的verilog源代碼。經過modelsim仿真。
標簽： Addressable modelsim Content verilog
上傳時間： 2013-12-31
上傳用戶：czl10052678
Verilog HDL 高級數字設計源碼 _chapter4
標簽： Verilog chapter HDL 數字設計
上傳時間： 2014-01-03
上傳用戶：cooran
Verilog HDL 高級數字設計源碼 _chapter5
上傳時間： 2013-12-26
上傳用戶：agent
VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高級數字設計源碼ch6
標簽： VerilogHDL_advanced_digital_desig n_code_Ch Verilog HDL
上傳時間： 2016-02-12
上傳用戶：lmeeworm
VerilogHDL_advanced_digital_design_code_Ch7 Verilog HDL 高級數字設計 源碼ch7
上傳時間： 2013-12-23
上傳用戶：ghostparker
verilog golden reference guide.pdf
標簽： reference verilog golden guide
上傳時間： 2014-01-25
上傳用戶：ma1301115706
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