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virtex

  • UG203-virtex-5 PCB設(shè)計指南

    UG203-virtex-5 PCB設(shè)計指南

    標(biāo)簽： virtex 203 PCB UG

    上傳時間： 2014-01-23

    上傳用戶：sc965382896

  • UG190 virtex-5 用戶指南

    UG190 virtex-5 用戶指南

    標(biāo)簽： virtex 190 UG 用戶

    上傳時間： 2013-11-23

    上傳用戶：1583060504

  • 2.1.4 virtex-ⅡPRO和和virtex-ⅡPROX系列產(chǎn)品

    2.1.4 virtex-ⅡPRO和和virtex-ⅡPROX系列產(chǎn)品。

    標(biāo)簽： virtex PROX PRO

    上傳時間： 2013-11-04

    上傳用戶：jackgao

  • 2.1.3 virtex-Ⅱ系列產(chǎn)品

    2.1.3 virtex-Ⅱ系列產(chǎn)品。

    標(biāo)簽： virtex

    上傳時間： 2014-01-20

    上傳用戶：2728460838

  • XAPP228 -virtex器件內(nèi)的四端口存儲器

    This application note describes how the existing dual-port block memories in the Spartan™-IIand virtex™ families can be used as Quad-Port memories. This essentially involves a dataaccess time (halved) versus functionality (doubled) trade-off. The overall bandwidth of the blockmemory in terms of bits per second will remain the same.

    標(biāo)簽： virtex XAPP 228 器件

    上傳時間： 2014-01-24

    上傳用戶：15527161163

  • WP245 - 使用virtex-5系列FPGA獲得更高系統(tǒng)性能

    virtex™-5 器件包括基于第二代高級硅片組合模塊 (ASMBL™) 列架構(gòu)的多平臺 FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設(shè)計的若干新型架構(gòu)元件，virtex-5 器件達(dá)到了比以往更高的系統(tǒng)性能水平。

    標(biāo)簽： virtex FPGA 245 WP

    上傳時間： 2013-10-19

    上傳用戶：giraffe

  • DS306-PPC405 virtex-4 Wrapper

    The PPC405 virtex-4 is a wrapper around the virtex-4PowerPC™ 405 Processor Block primitive. For detailsregarding the PowerPC 405, see the PowerPC 405 ProcessorBlock Reference Guide.

    標(biāo)簽： Wrapper virtex 306 405

    上傳時間： 2015-01-02

    上傳用戶：JIUSHICHEN

  • WWP248 - 移植到virtex-5 FPGA的指南

      由于virtex-5 器件的基礎(chǔ)架構(gòu)與以往的FPGA 器件不同，因此，要為特定設(shè)計選擇合適的virtex-5 器件并非易事。大多數(shù)情況下，設(shè)計應(yīng)采用類似的陣列大小（器件數(shù)量）并且比以前的目標(biāo)器件至少低一個速度級別（如從中速級別到慢速級別）。但是，這種建議對于有些情況卻并不適用。本節(jié)將介紹一些會影響virtex-5 FPGA 器件選擇標(biāo)準(zhǔn)的設(shè)計風(fēng)格和特征。

    標(biāo)簽： virtex FPGA WWP 248

    上傳時間： 2013-11-02

    上傳用戶：zhuyibin

  • WP373-賽靈思推出virtex-7,Kintex-7,Artix-7三大全新系列FPGA

      　　賽靈思推出的三款全新產(chǎn)品系列不僅發(fā)揮了臺積電28nm 高介電層金屬閘 (HKMG) 高性能低功耗 (HPL) 工藝技術(shù)前所未有的功耗、性能和容量優(yōu)勢，而且還充分利用 FPGA 業(yè)界首款統(tǒng)一芯片架構(gòu)無與倫比的可擴展性，為新一代系統(tǒng)提供了綜合而全面的平臺基礎(chǔ)。目前，隨著賽靈思 7 系列 (virtex®-7、Kintex™-7 和Artix™-7 系列) 的推出，賽靈思將系統(tǒng)功耗、性價比和容量推到了全新的水平，這在很大程度上要歸功于臺積電 28nm HKMG 工藝出色的性價比優(yōu)勢以及芯片和軟件層面上的設(shè)計創(chuàng)新。結(jié)合業(yè)經(jīng)驗證的 EasyPath™成本降低技術(shù)，上述新系列產(chǎn)品將為新一代系統(tǒng)設(shè)計人員帶來無與倫比的價值

    標(biāo)簽： virtex Kintex Artix FPGA

    上傳時間： 2015-01-02

    上傳用戶：shuizhibai

  • virtex-6 的HDL設(shè)計指南

    針對virtex-6 給出了HDL設(shè)計指南，其中，賽靈思為每個設(shè)計元素給出了四個設(shè)計方案元素，并給出了Xilinx認(rèn)為是最適合你的解決方案。這4個方案包括：實例，推理，CORE Generator或者其他Wizards，宏支持.

    標(biāo)簽： virtex HDL 設(shè)計指南

    上傳時間： 2015-01-02

    上傳用戶：pinksun9

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