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xilinx-ISE

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽: FPGA 多路 串并轉換

    上傳時間: 2013-11-03

    上傳用戶:王小奇

  • 在視頻監控系統中使用FPGA進行視頻處理

    在視頻監控系統中使用FPGA進行視頻處理:視頻監控系統是火車站,機場,銀行,娛樂場所,購物中心乃至家庭保安的重要組件。 您可以使用xilinx視頻IP模塊組實現DVR。

    標簽: FPGA 視頻監控系統 視頻處理

    上傳時間: 2014-01-15

    上傳用戶:shus521

  • 8051接口VHDL代碼

    PLD與8051接口的參考設計 Xilinx提供

    標簽: 8051 VHDL 接口 代碼

    上傳時間: 2013-11-14

    上傳用戶:sdfsdfs1

  • LTE系統中RRC連接建立過程的設計

    為了實現LTE系統中RRC連接建立的需求,提出了一種對RRC層連接過程進行設計的方案,并完成系統的軟件設計。該系統將RRC層的空閑狀態和連接狀態均細分為兩個子狀態,有效降低了系統設計的復雜度。軟件采用Xilinx SDK工具集進行開發,通過在PC上分別模擬終端和基站進行測試,終端和基站能夠成功接收到正確的RRC消息。實驗結果表明,該系統能夠成功的建立RRC連接,達到了設計的要求。

    標簽: LTE RRC 連接

    上傳時間: 2013-11-19

    上傳用戶:sjy1991

  • WP324 -采用低成本FPGA的全新高速廣播視頻連接解決方案

    使用 Xilinx Spartan™-3E 或 Spartan-3A FPGA,和National Semiconductor 公司的 PHY,并使用 Xilinx視頻處理 IP 核,提供了一種靈活且極具成本效益的方法來應對多速率廣播方面的挑戰。

    標簽: FPGA 324 WP 廣播

    上傳時間: 2014-11-30

    上傳用戶:muhongqing

  • 帶有SerDes接口的PLB千兆位級以太網MAC

    This application note describes a reference system which illustrates how to build an embeddedPowerPC® system using the Xilinx 1-Gigabit Ethernet Media Access Controller processor core.This system has the PLB_Gemac configured to use Scatter/Gather Direct Memory Access andthe Serializer/Deserializer (SerDes) interface. This application note describes how to set up thespecific clocking structure required for the SerDes interface and the constraints to be added tothe UCF file. This reference system is complete with a standalone software application to testsome of the main features of this core, including access to registers, DMA capabilities, transmitand receive in loopback mode. This reference system is targeted for the ML300 evaluationboard.

    標簽: SerDes PLB MAC 接口

    上傳時間: 2013-11-01

    上傳用戶:truth12

  • 一種片上系統復位電路的設計

    設計了一種片上系統(SoC)復位電路。該電路能對外部輸入信號進行同步化處理以抑制亞穩態,采用多級D觸發器進行濾波提升抗干擾能力,并且控制產生系統所需的復位時序以滿足軟硬件協同設計需求。同時,完成了可測性設計(DFT)。基于Xilinx spartan-6 FPGA進行了驗證。結果表明該電路可以抑制90 ?滋s以下的外部干擾信號,并能正確產生系統所需的復位信號。

    標簽: 片上系統 復位電路

    上傳時間: 2014-12-29

    上傳用戶:guojin_0704

  • 用于Xilinx FPGA的Maxim參考設計

    MAX8686 25A Buck穩壓器

    標簽: Xilinx Maxim FPGA 參考設計

    上傳時間: 2013-11-15

    上傳用戶:旭521

  • 基于AXI總線的MicroBlaze雙核SoPC系統設計

    目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實現基于AXI總線的雙核嵌入式系統設計以及共享實現LED燈的時控.

    標簽: MicroBlaze SoPC AXI 總線

    上傳時間: 2014-12-30

    上傳用戶:stewart·

  • XAPP996-雙處理器參考設計套件

    This is the Xilinx Dual Processor Reference Designs suite. The designs illustrate a few differentdual-core architectures based on the MicroBlaze™ and PowerPC™ processors. The designsillustrate various concepts described in the Xilinx White Paper WP262 titled, “DesigningMultiprocessor Systems in Platform Studio”. There are simple software applications includedwith the reference designs that show various forms of interaction between the two processors.

    標簽: XAPP 996 雙處理器 參考設計

    上傳時間: 2013-10-29

    上傳用戶:旭521

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