本設(shè)計采用Verilog實現(xiàn)(4200,4096,17)的BCH 編碼設(shè)計。
資源簡介:本設(shè)計采用Verilog實現(xiàn)(4200,4096,17)的BCH 編碼設(shè)計。
上傳時間: 2016-09-22
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資源簡介:stanford開發(fā)的LDPCA(LDPC碼的改進(jìn))的編碼器和解碼器,以及幾個碼字。
上傳時間: 2013-12-28
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資源簡介:BCH編碼器并行8路實現(xiàn),速率達(dá)到300M以上
上傳時間: 2014-01-26
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資源簡介:簡單時鐘校時(僅秒位)設(shè)置功能的基本設(shè)計,時鐘本身的計時顯示方法用秒表說爍顯
上傳時間: 2014-01-01
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資源簡介:未來的時代是信息時代,信息需要通過媒體來進(jìn)行記錄、傳播和獲取。視頻數(shù)據(jù)的壓縮技術(shù)和解壓縮技術(shù)成了多媒體技術(shù)中的關(guān)鍵技術(shù)之一,本論文設(shè)計的芯片正是基于FPGA實現(xiàn)視頻編碼器的設(shè)計,主要面向于對音頻和視頻信號進(jìn)行壓縮和解壓縮的廣泛場合。 本論文首先...
上傳時間: 2013-06-28
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資源簡介:現(xiàn)代信息處理應(yīng)用中,對模數(shù)轉(zhuǎn)換器的速度、精度、功耗和動態(tài)性能等關(guān)鍵性能指標(biāo)不斷提出更高的要求。針對模數(shù)轉(zhuǎn)換的實際應(yīng)用,提出并設(shè)計了一種基于TI公司生產(chǎn)的雙通道14 位 250MSPS 低功耗A / D轉(zhuǎn)換器 ADS4249的RGB視頻編碼器電路設(shè)計。這款A(yù) / D轉(zhuǎn)換器的技...
上傳時間: 2013-10-28
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資源簡介:JSP設(shè)計(第三版)一書源代碼 JSP設(shè)計(第三版)》得到了充分的修訂和更新,以涵蓋JSP 2.0和JSTL 1.1規(guī)范。其中詳細(xì)介紹了JSP 2.0中新增的表達(dá)式語言(EL)、JSTL 1.1標(biāo)記庫和新的函數(shù)庫、支持定制標(biāo)記庫開發(fā)(而無須Java代碼)的新標(biāo)記文件格式、簡化的Java...
上傳時間: 2015-05-10
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資源簡介:并行AVS實時編解碼器設(shè)計與實現(xiàn) 介紹了一種并行AVS實時編碼器的設(shè)計,它包括音視頻數(shù)據(jù)輸入、音視頻編碼、傳輸流系統(tǒng)復(fù)用器、輸出和控制部分,其 中重點介紹了視頻編碼器和傳輸流系統(tǒng)復(fù)用器的設(shè)計和實現(xiàn)。實驗結(jié)果證明,實現(xiàn)標(biāo)清AVS實時編碼器是可行的。
上傳時間: 2015-11-27
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資源簡介:ECC(橢圓曲線密碼)的標(biāo)準(zhǔn)C語言設(shè)計與實現(xiàn)
上傳時間: 2016-04-28
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資源簡介:循環(huán)碼編碼器verilog實現(xiàn),里面包含有源程序和仿真圖。
上傳時間: 2016-05-31
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資源簡介:機(jī)械優(yōu)化設(shè)計作業(yè)(鮑威爾) 說明:學(xué)完優(yōu)化設(shè)計,老師說要做作業(yè),全班分為5個小組,分別用最速下降法,牛頓法,鮑威爾法,共軛.DHF 法完成: f(x)=x1^2+x2^2-x1*x2-10*x1-4*x2+60.小弟采用的是用計算方法選出d的表達(dá)式后迭代得到。分別用最速下降法,牛頓法...
上傳時間: 2014-12-02
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資源簡介:8位優(yōu)先編碼器 verilog CPLD EPM1270 源代碼
上傳時間: 2013-12-18
上傳用戶:gtf1207
資源簡介:學(xué)生成績管理系統(tǒng)(包含實驗報告) C#實現(xiàn) 本系統(tǒng)設(shè)計有如下功能模塊:  輸入學(xué)生信息  顯示學(xué)生信息  按學(xué)號排序  按成績升序排序  按成績降序排序  成績分段
上傳時間: 2013-12-25
上傳用戶:懶龍1988
資源簡介:移動通信系統(tǒng)中交織編碼器的設(shè)計的源代碼。
上傳時間: 2014-01-01
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資源簡介:基于TM1300的嵌入式網(wǎng)絡(luò)視頻編碼器的設(shè)計
上傳時間: 2013-12-26
上傳用戶:caozhizhi
資源簡介:劉金琨老師版本的滑模變結(jié)構(gòu)控制MATLAB仿真(第3版):基本理論與設(shè)計方法 仿真程序源碼
上傳時間: 2020-07-13
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資源簡介:78-7-302-40256-5滑模變結(jié)構(gòu)控制MATLAB仿真(第3版):基本理論與設(shè)計方法 仿真程序, 0 , 2019-01-05978-7-302-40256-5滑模變結(jié)構(gòu)控制MATLAB仿真(第3版):基本理論與設(shè)計方法 仿真程序\slprj, 0 , 2019-01-05978-7-302-40256-5滑模變結(jié)構(gòu)控制MATLAB仿真(第...
上傳時間: 2022-05-10
上傳用戶:kent
資源簡介:遙感圖像在人類生活和軍事領(lǐng)域的應(yīng)用日益廣泛,適合各種要求的遙感圖像編碼技術(shù)具有重要的現(xiàn)實意義。基于小波變換的內(nèi)嵌編碼技術(shù)已成為當(dāng)前靜止圖像編碼領(lǐng)域的主流,其中就包括基于分層樹集合分割排序(Set Partitioning inHierarchical Trees,SPIHT)的內(nèi)嵌編...
上傳時間: 2013-06-17
上傳用戶:abc123456.
資源簡介:介紹了符合CCSDS標(biāo)準(zhǔn)的RS(255,223)碼譯碼器的硬件實現(xiàn)結(jié)構(gòu)。譯碼器采用8位并行時域譯碼算法,主要包括了修正后的無逆BM迭代譯碼算法,錢搜索算法和Forney算法。采用了三級流水線結(jié)構(gòu)實現(xiàn),減小了譯碼器的時延,提高了譯碼的速率,使用了VHDL語言完成譯碼器...
上傳時間: 2013-10-17
上傳用戶:cc1915
資源簡介:介紹了符合CCSDS標(biāo)準(zhǔn)的RS(255,223)碼譯碼器的硬件實現(xiàn)結(jié)構(gòu)。譯碼器采用8位并行時域譯碼算法,主要包括了修正后的無逆BM迭代譯碼算法,錢搜索算法和Forney算法。采用了三級流水線結(jié)構(gòu)實現(xiàn),減小了譯碼器的時延,提高了譯碼的速率,使用了VHDL語言完成譯碼器...
上傳時間: 2013-12-13
上傳用戶:yzhl1988
資源簡介:Matlab7.0基礎(chǔ)教程 清華大學(xué)
上傳時間: 2013-05-15
上傳用戶:eeworm
資源簡介:最高優(yōu)先級編碼器 8位相等比較器 三人表決器(三種不同的描述方式) 加法器描述 8位總線收發(fā)器:74245 (注2) 地址譯碼(for m68008) 多路選擇器(使用select語句) LED七段譯碼 多路選擇器(使用if-else語句) 雙2-4譯碼器:74139 多路選擇器...
上傳時間: 2015-04-11
上傳用戶:tianyi223
資源簡介:本文詳細(xì)介紹了制作電路板的方法及步驟. 實驗板的功能 這個實驗板可以做如下實驗: 1.可以進(jìn)行運算器(加、減、乘和除法)、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實驗 2.可以進(jìn)行觸發(fā)器、寄存器、計數(shù)器和一般時序電路的實驗 3.可...
上傳時間: 2015-10-02
上傳用戶:colinal
資源簡介:用MATLAB實現(xiàn)哈夫曼編碼的例程(以子函數(shù)形式給出) NORM2HUFF 哈夫曼編碼器 對于輸入向量,NORM2HUFF(X) 返回向量的哈夫曼編碼后的碼串
上傳時間: 2013-12-19
上傳用戶:225588
資源簡介:增量式編碼器數(shù)據(jù)采集及方向識別(原理及實現(xiàn))
上傳時間: 2016-03-20
上傳用戶:維子哥哥
資源簡介:bch(3121)詳細(xì) 編碼,已在radhatlinux下調(diào)試通過
上傳時間: 2016-03-21
上傳用戶:pinksun9
資源簡介:利用verilog實現(xiàn)的一個(2,1,2)卷積碼的編碼器,很有用的喲!
上傳時間: 2016-07-08
上傳用戶:hustfanenze
資源簡介:基于緩沖器的編碼器接口(SSI)擴(kuò)展方法研究
上傳時間: 2014-01-01
上傳用戶:lnnn30
資源簡介:最高優(yōu)先級編碼器 8位相等比較器 三人表決器(三種不同的描述方式) 加法器描述
上傳時間: 2014-01-23
上傳用戶:xymbian
資源簡介:通過編碼開關(guān)(旋轉(zhuǎn)編碼器)控制數(shù)碼管的加減一!程序詳細(xì)的體現(xiàn)了編碼器的編程和數(shù)碼管的單片機(jī)的編程!本程序通過AT89C51和24脈沖編碼器的測試
上傳時間: 2013-12-30
上傳用戶:lnnn30