介紹了符合CCSDS標準的RS(255,223)碼譯碼器的硬件實現結構。譯碼器采用8位并行時域譯碼算法,主要包括了修正后的無逆BM迭代譯碼算法,錢搜索算法和Forney算法。采用了三級流水線結構實現,減小了譯碼器的時延,提高了譯碼的速率,使用了VHDL語言完成譯碼器的設計與實現。測試表明,該譯碼器性能優良,適用于高速通信。
資源簡介:介紹了符合CCSDS標準的RS(255,223)碼譯碼器的硬件實現結構。譯碼器采用8位并行時域譯碼算法,主要包括了修正后的無逆BM迭代譯碼算法,錢搜索算法和Forney算法。采用了三級流水線結構實現,減小了譯碼器的時延,提高了譯碼的速率,使用了VHDL語言完成譯碼器...
上傳時間: 2013-10-17
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資源簡介:介紹了符合CCSDS標準的RS(255,223)碼譯碼器的硬件實現結構。譯碼器采用8位并行時域譯碼算法,主要包括了修正后的無逆BM迭代譯碼算法,錢搜索算法和Forney算法。采用了三級流水線結構實現,減小了譯碼器的時延,提高了譯碼的速率,使用了VHDL語言完成譯碼器...
上傳時間: 2013-12-13
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資源簡介:糾錯碼技術是一種通過增加一定冗余信息來提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯碼,在線性分組碼中,它具有最強的糾錯能力,既能糾正隨機錯誤,也能糾正突發錯誤,在深空通信、移動通信、磁盤陣列、光存儲及數字視頻廣播(DVB)等系統中具有廣泛...
上傳時間: 2013-07-20
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資源簡介:基于FPGA自適應高速RS編譯碼器的IP核設計
上傳時間: 2016-05-10
上傳用戶:asdkin
資源簡介:基于FPGA的RS編譯碼器實現 我是新手 剛學的寫的很簡單的代碼
上傳時間: 2014-12-03
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資源簡介:基于FPGA的Turbo碼交織器的設計與實現 比較實用
上傳時間: 2013-12-16
上傳用戶:1109003457
資源簡介:LDPC碼以其接近Shannon極限的優異性能在編碼界引起了轟動,成為研究的熱點。隨著研究的不斷深入和技術的發展,目前,LDPC碼已經被多個通信系統定為信道編碼方案,并被應用到第二代數字視頻廣播衛星(DVB—S2)通信系統中。由于LDPC碼譯碼過程中所涉及的數據量龐...
上傳時間: 2013-04-24
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資源簡介:該程序是RS編譯碼器的MATLAB仿真程序,里面有對程序的詳細說明和解釋。包括編碼算法和譯法算法的原理,流程以及代碼實現。對掌握RS碼有非常好的學習價值。
上傳時間: 2013-12-31
上傳用戶:爺的氣質
資源簡介:關于RS碼編碼器的相關程序,利用硬件語言實現
上傳時間: 2014-01-03
上傳用戶:gengxiaochao
資源簡介:RS編譯碼器的DSP實現,首先用MATLAB仿真,最后在DSP上實現
上傳時間: 2017-02-10
上傳用戶:D&L37
資源簡介:基于VHDL語言的循環碼編碼器的程序,以一個(15,6)循環碼為例
上傳時間: 2014-01-12
上傳用戶:xwd2010
資源簡介:基于vhdl的hdb3編譯碼器的設計與實現
上傳時間: 2014-01-13
上傳用戶:2525775
資源簡介:RS碼譯碼器C語言工程,為[255,191]碼率的譯碼結構,具有通用性
上傳時間: 2014-06-19
上傳用戶:hj_18
資源簡介:這是老師給的3—8譯碼器的源程序,自己剛才調試過了,真的成功了,哈哈……,有需要就看看吧
上傳時間: 2014-07-26
上傳用戶:星仔
資源簡介:Reed-Solomon碼(簡稱RS碼)是一種具有很強糾正突發和隨機錯誤能力的信道編碼方式,在深空通信、移動通信、磁盤陣列以及數字視頻廣播(DVB)等系統中具有廣泛的應用。 本文簡要介紹了有限域基本運算的算法和常用的RS編碼算法,分析了改進后的Euclid算法和改進后的...
上傳時間: 2013-06-11
上傳用戶:奇奇奔奔
資源簡介:針對固定碼長Turbo碼適應性差的缺點,以LTE為應用背景,提出了一種幀長可配置的Turbo編譯碼器的FPGA實現方案。該設計可以依據具體的信道環境和速率要求調節信息幀長,平衡譯碼性能和系統時延。方案采用“自頂向下”的設計思想和“自底而上”的實現方法,對 Tu...
上傳時間: 2013-10-28
上傳用戶:d815185728
資源簡介:本文提出了一種高速Viterbi譯碼器的FPGA實現方案。這種Viterbi譯碼器的設計方案既可以制成高性能的單片差錯控制器,也可以集成到大規模ASIC通信芯片中,作為全數字接收的一部分。 本文所設計的Viterbi譯碼器采用了基四算法,與基二算法相比,其譯碼速率在理論...
上傳時間: 2013-04-24
上傳用戶:181992417
資源簡介:針對固定碼長Turbo碼適應性差的缺點,以LTE為應用背景,提出了一種幀長可配置的Turbo編譯碼器的FPGA實現方案。該設計可以依據具體的信道環境和速率要求調節信息幀長,平衡譯碼性能和系統時延。方案采用“自頂向下”的設計思想和“自底而上”的實現方法,對 Tu...
上傳時間: 2013-10-08
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資源簡介:在通信系統中,人們一直致力于信息傳輸的有效性和可靠性的研究,信道糾錯編碼技術一直是人們研究的重點。1993年,Turbo碼的提出,以其接近Shannon極限的優異的譯碼性能在編碼界引起了轟動,并成為研究糾錯編碼的熱點課題。經過十幾年的研究和發展,目前,Turb...
上傳時間: 2013-07-09
上傳用戶:caixiaoxu26
資源簡介:研制發射微小衛星,是我國利用空間技術服務經濟建設、造福人類的重要途徑。現代微小衛星在短短20年里能取得長足的發展,主要取決于微小衛星自身的一系列特點:重量輕,體積小,成本低,性能高,安全可靠,發射方便、快捷靈活等。在衛星通信系統中,由于傳輸信...
上傳時間: 2013-08-01
上傳用戶:lili123
資源簡介:基于PLD的RS碼編譯碼器設計,用VHDL語言編寫,編譯通過,測試結果正確。
上傳時間: 2016-01-17
上傳用戶:13188549192
資源簡介: 本課題首先研究了常規的RS譯碼器的算法,確定在關鍵方程的計算中采用一種新改進的BM算法,然后提出了基于復數基的有限域快速并行乘法器和利用冪指數相減進行除法計算的有限域除法器,通過這些優化方法提高了RS譯碼器的速度,減少了譯碼延時和硬件資源使用...
上傳時間: 2013-06-29
上傳用戶:gokk
資源簡介:可靠通信要求消息從信源到信宿盡量無誤傳輸,這就要求通信系統具有很好的糾錯能力,如使用差錯控制編碼。自仙農定理提出以來,先后有許多糾錯編碼被相繼提出,例如漢明碼,BCH碼和RS碼等,而C。Berrou等人于1993年提出的Turbo碼以其優異的糾錯性能成為通信界...
上傳時間: 2013-04-24
上傳用戶:ziyu_job1234
資源簡介:在數字通信中,采用差錯控制技術(糾錯碼)是提高信號傳輸可靠性的有效手段,并發揮著越來越重要的作用。糾錯碼主要有分組碼和卷積碼兩種。在碼率和編碼器復雜程度相同的情況下,卷積碼的性能優于分組碼。 卷積碼的譯碼方法主要有代數譯碼和概率譯碼。代數譯碼...
上傳時間: 2013-04-24
上傳用戶:tedo811
資源簡介: 本文對于全并行Viterbi譯碼器的設計及其FPGA實現方案進行了研究,并最終將用FPGA實現的譯碼器嵌入到某數字通信系統之中。 首先介紹了卷積碼及Viterbi譯碼算法的基本原理,并對卷積碼的糾錯性能進行了理論分析。接著介紹了Viterbi譯碼器各個模塊實現的...
上傳時間: 2013-07-30
上傳用戶:13913148949
資源簡介:數字信息在有噪聲的信道中傳輸時,受到噪聲的影響,誤碼總是不可避免的。根據香農信息理論,只要使Es/N0足夠大,就可以達到任意小的誤碼率。采用差錯控制編碼,即信道編碼技術,可以在一定的Es/N0條件下有效地降低誤碼率。按照對信息元處理方式不同,信道編碼...
上傳時間: 2013-06-24
上傳用戶:lingduhanya
資源簡介:本文以某型號接收機的應用為背景,主要論述了如何實現基于FPGA的參數化的Viterbi譯碼器的知識產權(IP)核。文中詳細論述了譯碼器的內部結構、VerilogHDL(硬件描述語言)實現、仿真測試等。這些可變的參數包括:碼型、ACS(加比選)單元的數目、軟判決比特數、回溯...
上傳時間: 2013-04-24
上傳用戶:waizhang
資源簡介:在數字通信中,采用差錯控制技術(糾錯碼)是提高信號傳輸可靠性的有效手段,并發揮著越來越重要的作用。糾錯碼主要有分組碼和卷積碼兩種。在碼率和編碼器復雜程度相同的情況下,卷積碼的性能優于分組碼。 卷積碼的譯碼方法主要有代數譯碼和概率譯碼。代數譯碼...
上傳時間: 2013-04-24
上傳用戶:zhenyushaw
資源簡介:三篇關于Viterbi FPGA編譯碼器的優化設計文檔: 1、Viterbi譯碼器的FPGA設計實現與優化.pdf 2、Viterbi譯碼器的低功耗設計.pdf 3、基于FPGA的高速并行Viterbi譯碼器的設計與實現.pdf
上傳時間: 2013-11-27
上傳用戶:邶刖
資源簡介:基于VHDL語言的HDB3碼編譯碼器的設計 HDB3 碼的全稱是三階高密度雙極性碼,它是數字基帶傳輸中的一種重要碼型,具有頻譜中無直流分量、能量集中、提取位同步信息方便等優點。HDB3 碼是在AMI碼(極性交替轉換碼)的基礎上發展起來的,解決了AMI碼在連0碼過多時...
上傳時間: 2015-12-21
上傳用戶:jeffery