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Verilog HDL是一種硬件描述語言

  • 資源大小:30 K
  • 上傳時間: 2015-09-02
  • 上傳用戶:C69222090
  • 資源積分:2 下載積分
  • 標      簽: Verilog HDL 硬件描述語言

資 源 簡 介

Verilog HDL是一種硬件描述語言,用于從算法級、門級到開關級的多種抽象設計層次的數字系統建模,想學習的這個資料對你有用。

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