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verilog設計經驗點滴 因為Verilog是一種硬件描述語言

  • 資源大?。?/b>10 K
  • 上傳時間: 2013-12-14
  • 上傳用戶:alsczhang
  • 資源積分:2 下載積分
  • 標      簽: verilog Verilog 設計經驗 點滴

資 源 簡 介

verilog設計經驗點滴 因為Verilog是一種硬件描述語言,所以在寫Verilog語言時,首先要有所要寫的module在硬件上如何實現的概念,而不是去想編譯器如何去解釋這個module

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