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FPU加法器的設計與實現

  • 資源大小:580 K
  • 上傳時間: 2014-01-19
  • 上傳用戶:wodn76
  • 資源積分:2 下載積分
  • 標      簽: FPU 加法器

資 源 簡 介

浮點運算器的核心運算部件是浮點加法器,它是實現浮點指令各種運算的基礎,其設計優化對于提高浮點運算的速度和精度相當關鍵。文章從浮點加法器算法和電路實現的角度給出設計方法,通過VHDL語言在QuartusII中進行設計和驗證,此加法器通過狀態機控制運算,有效地降低了功耗,提高了速度,改善了性能。

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