用verilog HDL實(shí)現(xiàn)狀態(tài)機(jī)的設(shè)計(jì)
資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)狀態(tài)機(jī)的設(shè)計(jì)
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)曼徹斯特編碼的源碼
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資源簡(jiǎn)介:利用verilog編程實(shí)現(xiàn)狀態(tài)機(jī)的例子。很不錯(cuò)的。
上傳時(shí)間: 2015-05-10
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)I2C Master Controller 的設(shè)計(jì),包括主程序設(shè)計(jì)和測(cè)試程序設(shè)計(jì)
上傳時(shí)間: 2014-01-04
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資源簡(jiǎn)介:詳細(xì)說明狀態(tài)機(jī)的設(shè)計(jì),用VHDL實(shí)現(xiàn),是不錯(cuò)的教程
上傳時(shí)間: 2014-08-04
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)的曼徹斯特編碼器和解碼器。
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)的1553B航空電子總線接口。
上傳時(shí)間: 2016-05-19
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資源簡(jiǎn)介:用VHDL 和有限狀態(tài)機(jī)的方法設(shè)計(jì)了主干道與支干道的交叉路口交通信號(hào)燈無人自動(dòng)管理的控 制系統(tǒng)。將路口紅綠燈的各種亮燈情況定義不同的狀態(tài),路口狀況定義為觸發(fā)條件,組成有限狀態(tài)機(jī)
上傳時(shí)間: 2014-01-17
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)的VGA顯示彩條信號(hào),其中包括VGA時(shí)序、豎彩條、橫彩條、棋盤格
上傳時(shí)間: 2016-06-29
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)的任意 頻率分頻器源代碼,是一個(gè)通用的程序
上傳時(shí)間: 2014-01-07
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資源簡(jiǎn)介:有限狀態(tài)機(jī)的設(shè)計(jì)——LCD顯示控制實(shí)驗(yàn),用VHDL編寫程序,整片報(bào)告
上傳時(shí)間: 2013-12-17
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資源簡(jiǎn)介:有限狀態(tài)機(jī)的設(shè)計(jì)\\r\\n包括仿真文件以及sof文件
上傳時(shí)間: 2013-08-20
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)I2C總線功能,對(duì)I2C總線有很大幫助
上傳時(shí)間: 2013-12-28
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)I2C總線功能,對(duì)I2C總線有很大幫助
上傳時(shí)間: 2013-12-31
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資源簡(jiǎn)介:文章詳細(xì)介紹了VHDL中狀態(tài)機(jī)的設(shè)計(jì),結(jié)合圖形解釋,對(duì)于初學(xué)者很有幫助
上傳時(shí)間: 2015-08-05
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資源簡(jiǎn)介:使用8位控制器picoblaze實(shí)現(xiàn)狀態(tài)機(jī)的源代碼
上傳時(shí)間: 2014-01-03
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資源簡(jiǎn)介:com+與vb6分布式應(yīng)用程序設(shè)計(jì) 很好的用vb6.0實(shí)現(xiàn)com+的設(shè)計(jì)
上傳時(shí)間: 2013-12-20
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資源簡(jiǎn)介:用vHDL語言實(shí)現(xiàn)序列檢測(cè)器的設(shè)計(jì) 這是學(xué)習(xí)VHDL語言的經(jīng)典例子
上傳時(shí)間: 2014-11-29
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資源簡(jiǎn)介:數(shù)字時(shí)鐘顯示模塊,用verilog HDL 實(shí)現(xiàn)
上傳時(shí)間: 2016-03-03
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資源簡(jiǎn)介:1.設(shè)計(jì)目的 (1)設(shè)計(jì)交通燈控制器; (2)學(xué)習(xí)狀態(tài)機(jī)的設(shè)計(jì)方法; (3)學(xué)習(xí)原理圖、狀態(tài)機(jī)等多種的設(shè)計(jì)方法進(jìn)行混合設(shè)計(jì); (4)熟練掌握器件設(shè)計(jì)輸入、編譯、仿真和編程的過程。 2.設(shè)計(jì)內(nèi)容 位于十字路口的交通燈,在A方向和B方向各有紅、黃...
上傳時(shí)間: 2016-03-13
上傳用戶:mikesering
資源簡(jiǎn)介:狀態(tài)機(jī)的設(shè)計(jì)。在嵌入式開發(fā)中,狀態(tài)機(jī)的使用越來越多,對(duì)于狀態(tài)機(jī)的開發(fā),本文給出了很多講解。
上傳時(shí)間: 2016-04-01
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資源簡(jiǎn)介:有限狀態(tài)機(jī)的設(shè)計(jì) 包括仿真文件以及sof文件
上傳時(shí)間: 2016-07-14
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資源簡(jiǎn)介:用verilog HDL實(shí)現(xiàn)了83編碼器.
上傳時(shí)間: 2016-07-15
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資源簡(jiǎn)介:VHDL 狀態(tài)機(jī)的設(shè)計(jì)實(shí)例 ,不錯(cuò)的,對(duì)于搞清楚狀態(tài)機(jī)是很有用的.
上傳時(shí)間: 2013-11-27
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資源簡(jiǎn)介:三進(jìn)程有限狀態(tài)機(jī)的設(shè)計(jì)程序,內(nèi)附有AD574邏輯控制真值表以及采樣狀態(tài)機(jī)的原理圖
上傳時(shí)間: 2013-12-19
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資源簡(jiǎn)介:本例程是用MATLAB來實(shí)現(xiàn)數(shù)字濾波器的設(shè)計(jì)。
上傳時(shí)間: 2014-01-06
上傳用戶:標(biāo)點(diǎn)符號(hào)
資源簡(jiǎn)介:各種有限狀態(tài)機(jī)的設(shè)計(jì)。 VHDL源代碼。
上傳時(shí)間: 2013-12-18
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資源簡(jiǎn)介:用verilog HDL 實(shí)現(xiàn)時(shí)鐘(時(shí)和分)
上傳時(shí)間: 2013-12-26
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資源簡(jiǎn)介:用VHDL語言實(shí)現(xiàn)交通燈的設(shè)計(jì),并與硬件相連接.
上傳時(shí)間: 2013-12-27
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資源簡(jiǎn)介:該文檔為用matlab來實(shí)現(xiàn)fpga功能的設(shè)計(jì)總結(jié)文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
上傳時(shí)間: 2022-02-08
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