用verilog hdl實現的VGA顯示彩條信號,其中包括VGA時序、豎彩條、橫彩條、棋盤格
資源簡介:用verilog hdl實現的VGA顯示彩條信號,其中包括VGA時序、豎彩條、橫彩條、棋盤格
上傳時間: 2016-06-29
上傳用戶:yangbo69
資源簡介:用verilog hdl編寫的VGA顯示驅動程序
上傳時間: 2013-12-09
上傳用戶:banyou
資源簡介:用verilog hdl實現的曼徹斯特編碼器和解碼器。
上傳時間: 2013-12-23
上傳用戶:lifangyuan12
資源簡介:用verilog hdl實現的1553B航空電子總線接口。
上傳時間: 2016-05-19
上傳用戶:許小華
資源簡介:用verilog hdl實現的任意 頻率分頻器源代碼,是一個通用的程序
上傳時間: 2014-01-07
上傳用戶:alan-ee
資源簡介:用verilog hdl寫的VGA驅動,在FPGA上實測可用(實際上是別人的勞動成果,呵呵)。
上傳時間: 2014-01-15
上傳用戶:1966640071
資源簡介:基于FPGA的VGA時序彩條信號實現方法及其應用
上傳時間: 2013-12-05
上傳用戶:semi1981
資源簡介:用verilog hdl實現曼徹斯特編碼的源碼
上傳時間: 2013-12-29
上傳用戶:lhc9102
資源簡介:用verilog hdl寫的數字時鐘,已經在開發板上驗證過的,絕對原創,使用數碼管進行顯示!
上傳時間: 2013-12-03
上傳用戶:lnnn30
資源簡介:一個用verilog語言實現的包含:鍵盤掃描,led驅動、VGA視頻輸出的例子。功能為用鍵盤控制一個方塊的顯示位置。需要有fpga板子支持。
上傳時間: 2014-01-10
上傳用戶:pompey
資源簡介:數字時鐘顯示模塊,用verilog hdl 實現
上傳時間: 2016-03-03
上傳用戶:yiwen213
資源簡介:用verilog hdl實現I2C Master Controller 的設計,包括主程序設計和測試程序設計
上傳時間: 2014-01-04
上傳用戶:tonyshao
資源簡介:用verilog hdl編寫的基于fpga的動態數碼管顯示程序。
上傳時間: 2017-07-09
上傳用戶:13681659100
資源簡介:用verilog hdl實現狀態機的設計
上傳時間: 2014-01-22
上傳用戶:netwolf
資源簡介:用verilog hdl 寫的數字示波器的源代碼,其中還包括VGA控制源代碼
上傳時間: 2014-03-07
上傳用戶:731140412
資源簡介:用verilog hdl編寫的0832源程序,實現對0832實現D/A轉換。也可方便地轉換為vhdl源程序。
上傳時間: 2013-11-25
上傳用戶:qiao8960
資源簡介:用verilog hdl編寫的秒表設計,可以實現百分之一秒,十分之一秒,秒,十秒等功能。
上傳時間: 2017-07-09
上傳用戶:離殤
資源簡介:用verilog hdl 寫的時鐘程序,在DE2上實現了。
上傳時間: 2017-07-11
上傳用戶:tyler
資源簡介:用verilog hdl寫的操作SRAM的源碼
上傳時間: 2015-02-07
上傳用戶:sy_jiadeyi
資源簡介:用verilog hdl實現I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-28
上傳用戶:ouyangtongze
資源簡介:用verilog hdl實現I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-31
上傳用戶:zhouchang199
資源簡介:用verilog語言實現的ARM7處理器的標準內核的源代碼程序,nnARM, 具有很好的參考價值
上傳時間: 2015-05-10
上傳用戶:wanghui2438
資源簡介:verilog hdl實現的I2C Slave模擬
上傳時間: 2014-11-17
上傳用戶:ztj182002
資源簡介:用verilog語言實現的數據加密標準代碼,在QUARTUS5.1上仿真過
上傳時間: 2014-09-08
上傳用戶:mpquest
資源簡介:用verilog hdl編寫的一些例程,包括加法器/減法器等等,例子較多就不一一列舉了
上傳時間: 2013-12-20
上傳用戶:fhzm5658
資源簡介:用verilog hdl實現了83編碼器.
上傳時間: 2016-07-15
上傳用戶:731140412
資源簡介:用verilog編程實現的基于FPGA的AD數據采集程序
上傳時間: 2014-01-07
上傳用戶:yoleeson
資源簡介:這是用verilog hdl寫的可調占空比分頻控制器,可以掛在Avalon總線上使用
上傳時間: 2016-11-01
上傳用戶:ddddddos
資源簡介:這是用verilog語言實現的1024點ff程序t
上傳時間: 2016-11-09
上傳用戶:鳳臨西北
資源簡介:用verilog hdl 實現時鐘(時和分)
上傳時間: 2013-12-26
上傳用戶:Amygdala