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  資源簡介：Verilog實(shí)現(xiàn)的SMS4，已仿真和驗(yàn)證過

  標(biāo)簽： Verilog SMS4

  上傳時(shí)間： 2017-04-24

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  資源簡介：用Verilog實(shí)現(xiàn)的以太網(wǎng)接口!!!!!!!!!!!!!!!!!!

  標(biāo)簽： Verilog 以太網(wǎng)接口

  上傳時(shí)間： 2013-07-13

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  標(biāo)簽： Verilog 串口 收發(fā) 數(shù)據(jù)

  上傳時(shí)間： 2013-08-21

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• Verilog實(shí)現(xiàn)的DDS正弦信號(hào)發(fā)生器和測(cè)頻測(cè)相模塊免費(fèi)下載

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  標(biāo)簽： Verilog DDS 正弦信號(hào)發(fā)生器 模塊

  上傳時(shí)間： 2013-08-28

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• Verilog 實(shí)現(xiàn)的jtag ip模塊 包括了測(cè)試程序免費(fèi)下載

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  上傳時(shí)間： 2014-12-08

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• 用Verilog實(shí)現(xiàn)的四乘四鍵盤程序,在Quartus II上編譯通過并成功免費(fèi)下載

  資源簡介：用Verilog實(shí)現(xiàn)的四乘四鍵盤程序,在Quartus II上編譯通過并成功

  標(biāo)簽： Verilog Quartus 鍵盤程序 編譯

  上傳時(shí)間： 2015-05-13

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• 此代碼是用Verilog實(shí)現(xiàn)的以太網(wǎng)接口,在此基礎(chǔ)上做修改,可以作為一般的以太網(wǎng)接口程序開發(fā).免費(fèi)下載

  資源簡介：此代碼是用Verilog實(shí)現(xiàn)的以太網(wǎng)接口,在此基礎(chǔ)上做修改,可以作為一般的以太網(wǎng)接口程序開發(fā).

  標(biāo)簽： Verilog 以太網(wǎng)接口 代碼 修改

  上傳時(shí)間： 2014-01-20

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  標(biāo)簽： Verilog 除法 代碼

  上傳時(shí)間： 2015-10-01

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  上傳時(shí)間： 2014-12-02

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  上傳時(shí)間： 2013-12-28

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  資源簡介：用VHDL和Verilog實(shí)現(xiàn)的四人搶答器

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  上傳時(shí)間： 2015-11-15

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  標(biāo)簽： Verilog DDS 正弦信號(hào)發(fā)生器 模塊

  上傳時(shí)間： 2013-12-09

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  標(biāo)簽： Verilog 程序

  上傳時(shí)間： 2016-01-07

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  標(biāo)簽： Verilog crc

  上傳時(shí)間： 2016-01-21

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  上傳時(shí)間： 2016-01-21

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  上傳時(shí)間： 2014-01-08

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• 用Verilog實(shí)現(xiàn)的記時(shí)器程序,在Quartus II上編譯通過并成功運(yùn)行免費(fèi)下載

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  標(biāo)簽： Verilog Quartus 時(shí)器 程序

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• 用Verilog實(shí)現(xiàn)的搶答器程序,在Quartus II上編譯通過并成功運(yùn)行免費(fèi)下載

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  標(biāo)簽： Verilog jtag TAP

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• Verilog 實(shí)現(xiàn)的 jtag TAP免費(fèi)下載

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  標(biāo)簽： Verilog jtag TAP

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• Verilog 實(shí)現(xiàn)的 jtag TAP免費(fèi)下載

  資源簡介：Verilog 實(shí)現(xiàn)的 jtag TAP ， 轉(zhuǎn)自 opencore.com， 已通過驗(yàn)證

  標(biāo)簽： Verilog jtag TAP

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• lpc源代碼Verilog實(shí)現(xiàn)的。操作low pin count設(shè)備免費(fèi)下載

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  標(biāo)簽： Verilog count lpc low

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  標(biāo)簽： Verilog fpga uart 接口模塊

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  標(biāo)簽： Verilog UART 代碼

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• Verilog實(shí)現(xiàn)的以太網(wǎng)接口源程序代碼免費(fèi)下載

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