基于FPGA的2048點FFT的verilog實現的源代碼。
資源簡介:基于FPGA的2048點FFT的verilog實現的源代碼。
上傳時間: 2014-12-02
上傳用戶:GavinNeko
資源簡介:基于FPGA的16點FFT快速傅立葉變換的verilog源代碼。
上傳時間: 2015-04-02
上傳用戶:aysyzxzm
資源簡介:基于FPGA的16點FFT實現VEILOG
上傳時間: 2013-11-25
上傳用戶:lixinxiang
資源簡介:一個非常高效的基于TS101的8點FFT代碼,該代碼實現8點復數FFT,入口數據按實部,虛部交替存放 FFT結果也按實部,虛部交替存放. 程序沒有任何循環,也無須循轉因子. 非常高效啊
上傳時間: 2014-01-01
上傳用戶:zhangjinzj
資源簡介:2048點FFT在TMS320C240x定點DSP上的實現2048點FFT在TMS320C240x定點DSP上的實現
上傳時間: 2014-01-11
上傳用戶:yzy6007
資源簡介:這是我編的2048點的FFT程序,匯編的,執行效率較高,在TI的ccs上運行調試成功,整個工程文件都在里面,打開就可以用了,用的54系列的dsp.
上傳時間: 2014-12-06
上傳用戶:sxdtlqqjl
資源簡介:基于時間抽取(DIT)的128點FFT程序,運行于MATLAB6.5中。
上傳時間: 2017-08-20
上傳用戶:qb1993225
資源簡介:基于FPGA單精度浮點除法器的實現,有一些源代碼,僅供參考。
上傳時間: 2017-09-12
上傳用戶:希醬大魔王
資源簡介:該文檔為用verilog實現的貪吃蛇游戲(基于FPGA開發板)講解文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………
上傳時間: 2022-01-19
上傳用戶:1208020161
資源簡介:該文檔為用verilog實現的貪吃蛇游戲(基于FPGA開發板)總結文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………
上傳時間: 2022-05-08
上傳用戶:slq1234567890
資源簡介: 采用自動增益控制(AGC)技術實現的寬頻帶放大器在雷達系統及其他相關電子領域有著廣泛的應用。 本文詳細討論了基于FPGA和可編程增益放大器(PGA)實現的自動增益控制寬帶視頻放大器的設計及實現方法。首先給出了自動增益控制寬帶放大器取樣反饋、數字控制...
上傳時間: 2013-06-05
上傳用戶:acon
資源簡介:DSP2812下,C調匯編的128點FFT程序,算法為TI提供,定點,測量信號頻率和幅度較好,速度比C快三倍左右.
上傳時間: 2015-12-20
上傳用戶:330402686
資源簡介:MICROCHIP的DSPIC系列的30F6014單片機的32點FFT計算
上傳時間: 2016-01-09
上傳用戶:古谷仁美
資源簡介:這是本人在TI DSP C6713DSK開發板上開發的256點FFT實現程序,已調試通過。
上傳時間: 2016-01-16
上傳用戶:皇族傳媒
資源簡介:效率很高的256點FFT濾波源碼,可在此代碼基礎上改進,得到效果更好的代碼.
上傳時間: 2016-04-24
上傳用戶:pompey
資源簡介:一個用verilog實現的FPGA上的uart接口模塊,包括測試模塊和實體,并實現了輸出接口和狀態接口。
上傳時間: 2014-07-19
上傳用戶:gengxiaochao
資源簡介:基于FPGA自適應高速RS編譯碼器的IP核設計
上傳時間: 2016-05-10
上傳用戶:asdkin
資源簡介:ofdm調制中用到的1024點FFT源碼,ADI的TS系列DSP平臺。
上傳時間: 2013-12-26
上傳用戶:爺的氣質
資源簡介:Tiger sharec系列DSP的短點FFT代碼(4,6,8,16點FFT),全匯編實現,將DSP的性能發揮到極致,在超高實時要求應用下有意義.
上傳時間: 2013-12-20
上傳用戶:BOBOniu
資源簡介:蝶形運算,用于TI VC33 DSP上的256點FFT程序
上傳時間: 2017-06-10
上傳用戶:lizhizheng88
資源簡介:在window下開發的4096點FFT源碼,使用C開發,對學習數字信號處理有一定幫助
上傳時間: 2014-01-18
上傳用戶:lht618
資源簡介:優化過的128點FFT和iFFT,最大程度的精簡代碼和提高預算率
上傳時間: 2013-12-19
上傳用戶:yuzsu
資源簡介:51上寫的浮點FFT程序,經過Matlab驗證
上傳時間: 2013-12-25
上傳用戶:huannan88
資源簡介:MICROCHIP的DSPIC系列的30F6014單片機的32點FFT計算
上傳時間: 2017-09-13
上傳用戶:sjyy1001
資源簡介:verilog實現的FPGA三態以太網鏈路層通信代碼.
上傳時間: 2022-04-24
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資源簡介:verilog實現的AES-128加解密程序,FPGA驗證通過
上傳時間: 2022-06-26
上傳用戶:zhaiyawei
資源簡介:用verilog實現的串口收發數據程序,已經調試通過
上傳時間: 2013-08-21
上傳用戶:lixinxiang
資源簡介:verilog實現的DDS正弦信號發生器和測頻測相模塊,DDS模塊可產生兩路頻率和相位差均可預置調整的值正弦波,頻率范圍為20Hz-5MHz,相位范圍為0°-359°,測量的數據通過引腳傳輸給單片機,單片機進行計算和顯示。
上傳時間: 2013-08-28
上傳用戶:asdfasdfd
資源簡介:一個verilog實現的crc校驗,用于FPGA實現,快速,準確有效
上傳時間: 2016-01-21
上傳用戶:songrui
資源簡介:verilog 實現的hamming碼生成,用于FPGA
上傳時間: 2016-01-21
上傳用戶:xhz1993