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  資源簡(jiǎn)介：這是一個(gè)關(guān)于晶震的一個(gè)verilog 源代碼,希望對(duì)新手有用

  標(biāo)簽： verilog 源代碼

  上傳時(shí)間： 2013-08-23

  上傳用戶：大灰狼123456

• 這是一個(gè)關(guān)于晶震的一個(gè)verilog 源代碼,希望對(duì)新手有用免費(fèi)下載

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  標(biāo)簽： verilog 源代碼

  上傳時(shí)間： 2013-12-26

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• 關(guān)于通信原理課程設(shè)計(jì)中HDB3編解碼的一個(gè)verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：關(guān)于通信原理課程設(shè)計(jì)中HDB3編解碼的一個(gè)verilog源代碼

  標(biāo)簽： verilog HDB3 通信原理 編解碼

  上傳時(shí)間： 2013-12-22

  上傳用戶：jing911003

• 一個(gè)verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)verilog源代碼，作用是計(jì)數(shù)器的建模。

  標(biāo)簽： verilog 源代碼

  上傳時(shí)間： 2014-08-09

  上傳用戶：bjgaofei

• 一個(gè)verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)verilog源代碼，用于譯碼器的編程。

  標(biāo)簽： verilog 源代碼

  上傳時(shí)間： 2014-11-26

  上傳用戶：希醬大魔王

• 一個(gè)verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)verilog源代碼，可用ISE等實(shí)現(xiàn)，功能為I2C接口標(biāo)準(zhǔn)建模。

  標(biāo)簽： verilog 源代碼

  上傳時(shí)間： 2013-12-20

  上傳用戶：banyou

• 發(fā)一個(gè)基于ModelSim仿真的verilog源代碼包免費(fèi)下載

  資源簡(jiǎn)介：發(fā)一個(gè)基于ModelSim仿真的verilog源代碼包

  標(biāo)簽： ModelSim verilog 仿真 源代碼

  上傳時(shí)間： 2013-12-10

  上傳用戶：水中浮云

• 一個(gè)可綜合的串并轉(zhuǎn)換接口verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)可綜合的串并轉(zhuǎn)換接口verilog源代碼

  標(biāo)簽： verilog 串并轉(zhuǎn)換 接口 源代碼

  上傳時(shí)間： 2014-01-07

  上傳用戶：txfyddz

• 一個(gè)小單片機(jī)的verilog源代碼, 包含說(shuō)明文檔免費(fèi)下載

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  標(biāo)簽： verilog 單片機(jī) 源代碼 文檔

  上傳時(shí)間： 2013-12-05

  上傳用戶：gaojiao1999

• 一個(gè)視頻信號(hào)輸入的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)視頻信號(hào)輸入的verilog源代碼，里面含有相關(guān)的使用文檔。

  標(biāo)簽： verilog 視頻信號(hào) 源代碼 輸入

  上傳時(shí)間： 2013-12-25

  上傳用戶：zmy123

• 一個(gè)可綜合的同步FIFO的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)可綜合的同步FIFO的verilog源代碼

  標(biāo)簽： verilog FIFO 源代碼

  上傳時(shí)間： 2015-12-13

  上傳用戶：天誠(chéng)24

• 一個(gè)3階的32位抽取的cic濾波器的verilog源代碼免費(fèi)下載

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  標(biāo)簽： verilog cic 濾波器 源代碼

  上傳時(shí)間： 2016-02-21

  上傳用戶：wmwai1314

• 符合8051協(xié)議規(guī)范的UART的verilog源代碼.該壓縮包是一個(gè)modelsim的工程.免費(fèi)下載

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  標(biāo)簽： modelsim verilog 8051 UART

  上傳時(shí)間： 2014-07-09

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• 一個(gè)LCD控制器的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)LCD控制器的verilog源代碼，可以方便的控制TFT LCD！

  標(biāo)簽： verilog LCD 控制器 源代碼

  上傳時(shí)間： 2014-01-05

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• 一個(gè)java源代碼包免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)java源代碼包，其中包括快速排序，隊(duì)列和后綴表達(dá)式的計(jì)算，XML生成程序，為一個(gè)解析XML文件程序做了書價(jià)格的計(jì)算，是后綴表達(dá)式計(jì)算，中綴轉(zhuǎn)后綴

  標(biāo)簽： java 源代碼

  上傳時(shí)間： 2013-12-09

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• Dialogic D41/E語(yǔ)音卡 的一個(gè)應(yīng)用源代碼免費(fèi)下載

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  標(biāo)簽： Dialogic 41 語(yǔ)音卡 源代碼

  上傳時(shí)間： 2015-01-05

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• 一個(gè)龜兔賽跑源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)龜兔賽跑源代碼

  標(biāo)簽： 源代碼

  上傳時(shí)間： 2014-01-23

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• PCI接口的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：PCI接口的verilog源代碼

  標(biāo)簽： verilog PCI 接口 源代碼

  上傳時(shí)間： 2013-12-28

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• 一個(gè)操作系統(tǒng)源代碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)操作系統(tǒng)源代碼

  標(biāo)簽： 操作系統(tǒng) 源代碼

  上傳時(shí)間： 2015-01-17

  上傳用戶：plsee

• CSharpDevelop：這是一個(gè)包含源代碼的C#、VB.NET的編輯器。免費(fèi)下載

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  標(biāo)簽： CSharpDevelop NET VB 源代碼

  上傳時(shí)間： 2015-01-18

  上傳用戶：二驅(qū)蚊器

• 很好的一個(gè)游戲源代碼免費(fèi)下載

  資源簡(jiǎn)介：很好的一個(gè)游戲源代碼

  標(biāo)簽： 源代碼

  上傳時(shí)間： 2014-01-24

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• 很好的一個(gè)游戲源代碼免費(fèi)下載

  資源簡(jiǎn)介：很好的一個(gè)游戲源代碼

  標(biāo)簽： 源代碼

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  上傳用戶：阿四AIR

• 打包中有一個(gè)濾波器源代碼 .rar免費(fèi)下載

  資源簡(jiǎn)介：打包中有一個(gè)\濾波器源代碼 .rar

  標(biāo)簽： 濾波器 源代碼

  上傳時(shí)間： 2014-07-02

  上傳用戶：shizhanincc

• 本人自己寫的一個(gè)游戲源代碼：神奇讀心術(shù)！免費(fèi)下載

  資源簡(jiǎn)介：本人自己寫的一個(gè)游戲源代碼：神奇讀心術(shù)！

  標(biāo)簽： 源代碼

  上傳時(shí)間： 2013-12-18

  上傳用戶：妄想演繹師

• 主要完成數(shù)字電視前端信號(hào)處理和緩沖作用的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：主要完成數(shù)字電視前端信號(hào)處理和緩沖作用的verilog源代碼，可以直接使用

  標(biāo)簽： verilog 數(shù)字電視 信號(hào)處理 源代碼

  上傳時(shí)間： 2013-12-18

  上傳用戶：woshiayin

• powerbuilder開(kāi)發(fā)的一個(gè)仿優(yōu)化大師的界面的一個(gè)程序源代碼。不知道有人喜歡嗎？免費(fèi)下載

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  標(biāo)簽： powerbuilder 大師 程序 源代碼

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  上傳用戶：米卡

• 這是一個(gè)嵌入ARM里的一個(gè)游戲源代碼。是用ARM_SDT2.51軟件開(kāi)發(fā)的感興趣的人可以下載看看。免費(fèi)下載

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  標(biāo)簽： ARM_SDT 2.51 ARM 源代碼

  上傳時(shí)間： 2013-12-21

  上傳用戶：cjf0304

• 一個(gè)開(kāi)放源代碼的 AT&T 的 Korn Shell 的復(fù)制品, 支持大多數(shù) ksh89 的特性。免費(fèi)下載

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  標(biāo)簽： Shell Korn ksh AT

  上傳時(shí)間： 2014-01-21

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• 這是8位微處理器的verilog源代碼免費(fèi)下載

  資源簡(jiǎn)介：這是8位微處理器的verilog源代碼，可以欠在Flex10k10里面

  標(biāo)簽： verilog 8位微處理器 源代碼

  上傳時(shí)間： 2014-01-24

  上傳用戶：皇族傳媒

• flash接口控制器的VHDL以及verilog源代碼和Testbench程序免費(fèi)下載

  資源簡(jiǎn)介：flash接口控制器的VHDL以及verilog源代碼和Testbench程序

  標(biāo)簽： Testbench verilog flash VHDL

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