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  標(biāo)簽： DDS 數(shù)字移相 正弦信號(hào)發(fā)生器

  上傳時(shí)間： 2014-12-02

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  標(biāo)簽： EDA 數(shù)字移相 大學(xué)生 中的應(yīng)用

  上傳時(shí)間： 2013-12-02

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  標(biāo)簽： DDS 移相 正弦信號(hào)發(fā)生器 設(shè)計(jì)方案

  上傳時(shí)間： 2015-08-14

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  標(biāo)簽： VHDL DDS 代碼 數(shù)字移相

  上傳時(shí)間： 2014-01-08

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  標(biāo)簽： GSM 521 手機(jī)維修

  上傳時(shí)間： 2013-07-28

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• 基于FPGA和DDS技術(shù)的正弦信號(hào)發(fā)生器設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： FPGA DDS 正弦信號(hào)發(fā)生器

  上傳時(shí)間： 2014-01-18

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  上傳時(shí)間： 2013-10-23

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  標(biāo)簽： Nios Cyclone altera ALTERA

  上傳時(shí)間： 2015-09-02

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• 一個(gè)經(jīng)過(guò)DE2板驗(yàn)證的數(shù)字移相信號(hào)發(fā)生器的HDL原代碼!曾經(jīng)能夠獲獎(jiǎng)的,工程設(shè)計(jì)的好東西!免費(fèi)下載

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  標(biāo)簽： DE2 HDL 數(shù)字移相 信號(hào)發(fā)生器

  上傳時(shí)間： 2015-11-27

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• 基于C語(yǔ)言和單片機(jī)的數(shù)字移相設(shè)計(jì) C語(yǔ)言程序設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： C語(yǔ)言 單片機(jī) 數(shù)字移相 程序設(shè)計(jì)

  上傳時(shí)間： 2014-01-07

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• 基于FPGA的三相正弦信號(hào)發(fā)生器設(shè)計(jì).rar免費(fèi)下載

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  標(biāo)簽： FPGA 三相 正弦信號(hào)發(fā)生器

  上傳時(shí)間： 2013-06-15

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• DDS的多功能正弦信號(hào)發(fā)生器設(shè)計(jì)下載 免費(fèi)下載免費(fèi)下載

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  標(biāo)簽： DDS 多功能 免費(fèi)下載

  上傳時(shí)間： 2013-10-31

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• 基于單片機(jī)的移相式函數(shù)發(fā)生器設(shè)計(jì),用匯編語(yǔ)言編寫!免費(fèi)下載

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  標(biāo)簽： 單片機(jī) 函數(shù)發(fā)生器 移相式 匯編語(yǔ)言

  上傳時(shí)間： 2013-12-28

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• 介紹數(shù)字鎖相環(huán)的基本結(jié)構(gòu),詳細(xì)分析基于FPGA的數(shù)字鎖相環(huán)的鑒相器、環(huán)路濾波器、壓控振蕩器各部分的實(shí)現(xiàn)方法,并給出整個(gè)數(shù)字鎖相環(huán)的實(shí)現(xiàn)原理圖。仿真結(jié)果表明,分析合理,設(shè)計(jì)正確。免費(fèi)下載

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  標(biāo)簽： FPGA 數(shù)字鎖相環(huán) 分 基本結(jié)構(gòu)

  上傳時(shí)間： 2016-08-12

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  標(biāo)簽： Nios altera 2006 SOPC

  上傳時(shí)間： 2013-12-19

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• 基于FPGA的數(shù)字鎖相環(huán)的研究與實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：該文檔為基于FPGA的數(shù)字鎖相環(huán)的研究與實(shí)現(xiàn)總結(jié)文檔，是一份很不錯(cuò)的參考資料，具有較高參考價(jià)值，感興趣的可以下載看看………………

  標(biāo)簽： fpga

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• 51實(shí)現(xiàn)ad9850 51單片機(jī)的c語(yǔ)言編程 正弦信號(hào)發(fā)生器ad9850實(shí)際鍵盤免費(fèi)下載

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  標(biāo)簽： 9850 ad 51單片機(jī) c語(yǔ)言

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• 基于ATmega8的多路任意波形信號(hào)發(fā)生器的研制.pdf免費(fèi)下載

  資源簡(jiǎn)介：基于ATmega8的多路任意波形信號(hào)發(fā)生器的研制.pdf

  標(biāo)簽： ATmega8 多路 任意波形

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• 目 錄 第一章 VHDL文本輸入設(shè)計(jì)方法 1.1 編輯輸入并存盤VHDL原文件 1.2 將當(dāng)前設(shè)計(jì)設(shè)定為工程 1.3 選擇VHDL文本編譯版本號(hào)和排錯(cuò) 1.4 時(shí)序仿真 1.5 硬件測(cè)試 1.免費(fèi)下載

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  標(biāo)簽： VHDL 1.1 1.2 1.3

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• 基于FPGA的移相式DDS正弦信號(hào)發(fā)生器的VHDL源代碼免費(fèi)下載

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  標(biāo)簽： FPGA VHDL DDS 移相式

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• 基于fpga和sopc的用VHDL語(yǔ)言編寫的EDA數(shù)字移相信號(hào)發(fā)生器免費(fèi)下載

  資源簡(jiǎn)介：基于fpga和sopc的用VHDL語(yǔ)言編寫的EDA數(shù)字移相信號(hào)發(fā)生器

  標(biāo)簽： fpga VHDL sopc EDA

  上傳時(shí)間： 2016-02-04

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  標(biāo)簽： Verilog DDS 正弦信號(hào)發(fā)生器 模塊

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  標(biāo)簽： Verilog DDS 正弦信號(hào)發(fā)生器 模塊

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• 基于DDS的任意頻譜信號(hào)重構(gòu)與數(shù)字正交調(diào)制方法免費(fèi)下載

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  標(biāo)簽： DDS 頻譜 信號(hào)重構(gòu) 數(shù)字

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  標(biāo)簽： vc VC 源程序 數(shù)字信號(hào)處理

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  標(biāo)簽： VERILOG DDS 正弦信號(hào)發(fā)生器 語(yǔ)言

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