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101條Verilog和SystemVerilog設計陷阱

  • 資源大小:11340 K
  • 上傳時間: 2022-07-01
  • 上傳用戶:lijumiao
  • 資源積分:2 下載積分
  • 標      簽: verilog systemverilog

資 源 簡 介

有些人喜歡收集棒球卡片,老的車輛雜志,或是橡皮小鴨,但我喜歡收集Verilog書籍。

從1989年那個三孔活頁夾中保存的Gateway VERILOG-XL Reference Manual Versionl.5a復印本開始,那時的Verilog很簡單,其中只包含了一種過程獄值(那時的語言并沒有包含非阻塞賦值),它很難讓我們相信有一天能夠使用它來設計芯片,我們可以在VAX或是昂貴的Apollo工作站上進行仿真.

從那開始我購買了相當多的Verilog書籍,其中包含了少量的綜合書籍,還有一份介紹硬件描述語言歷史的文本,其中的一小部分介紹了VHDL,這些書籍中大部分都是關于Verilog.

但有趣的是,我并沒有花很多時間來閱讀它們,它們只是被擱置在書架上,我承認書架上擺滿了關于Verilog的書籍時,是一件令人驕傲的事情,但目光如矩的參觀者能發現它們都是全新的從未被閱讀過,擁有未使用過和未閱讀過的書籍都是無意義的,另一方面讓我沮喪,從這些書籍中只能找到很少一部分,對于工程師有價值的內容,我能否找到一本需天天使用的書籍,有利于我入門以及在工作中及時參閱。

Stu和Don編寫的就是這祥一本書,了解這些技巧我花費了很多年的時間,其中內容甚至讓我懷疑,自己是否了解Verilog,在這本能提供幫助和有價值的書籍中,給出的一些知識點都是經過提煉的,相信你不會感到沮喪。

如果你是一個老手,驗證這些技巧也需通過相當困難的方式,但你可笑著對自己說:“好的,我找到它了”

如果你是新手,快點跟隨兩位專家開始學習吧,不要猶豫快點來參加兩位紳士提供的一次培訓課程,我保證你不會遺憾.

我最喜歡的陷辨是第65條:循環是無限的,為什么?可以構建一個調試它的環境,相信我,如果建模錯誤會引發芯片損壞時,你就不會忘記錯誤為什么會出現?可惜這本書我沒有早點遇到,無疑你是幸運的,把這本書放在手邊,經常參閱,它可幫助你解決所有的模型編譯和項目設計的困難。


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