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基于FPGA的PROFIBUS-DP從站芯片設(shè)計(jì)

  • 資源大小:6080 K
  • 上傳時(shí)間: 2023-06-09
  • 上傳用戶:1208020161
  • 資源積分:2 下載積分
  • 標(biāo)      簽: PROFIBUS-DP FPGA

資 源 簡 介

作為PROFIBUS的一個(gè)版本,PROFIBUS-DP繼承了前者的主要技術(shù)特點(diǎn),在我國自動(dòng)化領(lǐng)域得到廣泛應(yīng)用,具備較大的市場(chǎng)發(fā)展?jié)摿Α5牵瑖鴥?nèi)對(duì)于DP總線的研究還局限于應(yīng)用領(lǐng)域,大部分國內(nèi)制造商使用的是國外廠商提供的通信芯片,而國產(chǎn)通信芯片的設(shè)計(jì)還處于起步階段。因此,PROFIBUS-DP相關(guān)芯片的開發(fā)具有重要的現(xiàn)實(shí)意義。    同時(shí),隨著可編程邏輯器件和EDA技術(shù)的發(fā)展,使用FPGA進(jìn)行通信芯片的開發(fā),已經(jīng)能夠滿足對(duì)高速數(shù)據(jù)通信的要求。    本文對(duì)基于FPGA的PROFIBUS-DP從站芯片設(shè)計(jì)進(jìn)行了研究。所做的主要工作包括:    1.按照FPGA系統(tǒng)開發(fā)流程,本文采用自頂而下的方法,完成了芯片的總體設(shè)計(jì)方案。設(shè)計(jì)共規(guī)劃了3個(gè)模塊,即物理層模塊、現(xiàn)場(chǎng)數(shù)據(jù)鏈路層模塊和用戶層模塊。然后,根據(jù)每個(gè)模塊所要實(shí)現(xiàn)的功能,進(jìn)行了功能子模塊的劃分。    2.在物理層模塊設(shè)計(jì)中,自適應(yīng)波特率模塊負(fù)責(zé)串行輸入數(shù)據(jù)的波特率檢測(cè),UART收發(fā)模塊實(shí)現(xiàn)數(shù)據(jù)的串并轉(zhuǎn)換。    3.現(xiàn)場(chǎng)數(shù)據(jù)鏈路層模塊包括4個(gè)子模塊。其中,F(xiàn)DL接收邏輯模塊模塊負(fù)責(zé)接收?qǐng)?bào)文幀的解析;FDL發(fā)送邏輯模塊將FDL數(shù)據(jù)處理模塊傳送的字段組成為發(fā)送報(bào)文幀。FDL數(shù)據(jù)處理模塊根據(jù)接收?qǐng)?bào)文的各個(gè)字段進(jìn)行分析,與緩沖區(qū)模塊以及用戶層模塊進(jìn)行數(shù)據(jù)交互。

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