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DSUWB同步技術(shù)研究及FPGA設(shè)計(jì).rar

  • 資源大?。?/b>1842 K
  • 上傳時(shí)間: 2023-10-02
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  • 標(biāo)      簽: DSUWB FPGA

資 源 簡 介

UWB脈沖超寬帶是近幾年來興起的短距離無線通信技術(shù)。它采用非常窄的脈沖傳輸數(shù)據(jù),具有諸多優(yōu)點(diǎn),如系統(tǒng)簡單、傳輸速率高、功耗低、安全性高、多徑分辨能力強(qiáng)、定位精確等。DS-UWB是脈沖超寬帶的一種,信息碼經(jīng)過偽隨機(jī)序列擴(kuò)頻后再對發(fā)射脈沖進(jìn)行調(diào)制。同步問題是通信接收技術(shù)的一個(gè)關(guān)鍵問題,適用于DS-UWB的同步技術(shù)是目前國內(nèi)外研究的一個(gè)熱點(diǎn)。 基于UWB同步問題的重要性,針對DS-UWB直擴(kuò)超寬帶系統(tǒng),本文研究了目前DS-UWB系統(tǒng)的同步方法。針對傳統(tǒng)捕獲算法速度慢以及UWB信號(hào)存在的多徑效應(yīng)問題,仿真分析了改進(jìn)的兩級(jí)結(jié)構(gòu)同步捕獲算法,能夠快速地進(jìn)行高精度的同步;針對傳統(tǒng)的基于最大似然(ML)準(zhǔn)則的同步算法普遍具有較低的檢測概率問題,仿真分析了改進(jìn)的基于T&L檢測器的同步捕獲算法,能夠在不增加太多復(fù)雜度的情況下很好地提高捕獲性能。另一方面,由于UWB信號(hào)帶寬“超寬”以及由此造成的同步捕獲搜索空間過大、存在多個(gè)虛同步點(diǎn)等問題,導(dǎo)致目前的同步算法普遍計(jì)算量較大,使用目前的數(shù)字邏輯器件完全實(shí)現(xiàn)算法難度很大。針對這個(gè)問題,探討了如何利用目前現(xiàn)有器件進(jìn)行系統(tǒng)實(shí)現(xiàn),提出基于FPGA的全數(shù)字設(shè)計(jì)模型,并設(shè)計(jì)了簡化的兩級(jí)結(jié)構(gòu)同步捕獲算法的系統(tǒng)實(shí)現(xiàn)方案,用Verilog HDL編寫了關(guān)鍵邏輯電路模塊。

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