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低頻接收機(jī)

  • 低振動的滾筒洗衣機(jī)驅(qū)動系統(tǒng)控制研究.rar

    滾筒式洗衣機(jī)在其工作運(yùn)轉(zhuǎn),尤其是其脫水甩干時的振動,一直是個突出的問題。滾筒洗衣機(jī)在運(yùn)行過程中由于衣物的不平衡分布,會使?jié)L筒受到變載荷與變方向偏心力激勵的作用并引起激烈的振動,使得整機(jī)的振動不僅產(chǎn)生很大的噪音,而且對洗衣機(jī)機(jī)械與電器部件的壽命產(chǎn)生影響。因為傳統(tǒng)機(jī)械減振方法存在通用性方面的限制,近年來隨著技術(shù)的發(fā)展,從機(jī)電一體化系統(tǒng)的角度出發(fā),綜合運(yùn)用機(jī)械、電子、電機(jī)等方面的技術(shù),提高洗衣機(jī)的振動控制效果已成為趨勢。 本文從課題要求和實際應(yīng)用出發(fā),在與日本松下公司合作的基礎(chǔ)上,針對National NA—V82型號滾筒洗衣機(jī),以電力電子用數(shù)字控制開發(fā)系統(tǒng)MyWay PE—Expert作為控制系統(tǒng),構(gòu)建了滾筒洗衣機(jī)驅(qū)動系統(tǒng)平臺,并開發(fā)了一種新型的低振動的滾筒洗衣機(jī)驅(qū)動控制方法。本文的結(jié)構(gòu)和主要研究內(nèi)容如下: 第一章簡單介紹了滾筒洗衣機(jī)的發(fā)展現(xiàn)狀,通過對課題的背景介紹,闡述了課題的實際意義。其后詳細(xì)介紹了傳統(tǒng)的機(jī)械減振手段以及新型的通過電機(jī)控制技術(shù)實現(xiàn)的減振方法。通過對兩者的分析比較,提出了本文的主要工作及方案。 第二章介紹了驅(qū)動系統(tǒng)主要硬件組成及各部分之間的連接,給出了驅(qū)動系統(tǒng)的詳細(xì)連接圖。同時給出了基于矢量控制的驅(qū)動系統(tǒng)基本控制方法的原理和說明。最后還介紹了振動測量設(shè)備并確定其使用方案。 第三章研究了振動產(chǎn)生的機(jī)理,對振動規(guī)律進(jìn)行分析。提出了基于加速度傳感器的偏心負(fù)載位置以及質(zhì)量的實時測定方法。并通過仿真和實驗分析,研究了脈動轉(zhuǎn)矩對電機(jī)振動的影響。最后在此基礎(chǔ)之上,提出了基于脈動轉(zhuǎn)矩的低振動的滾筒洗衣機(jī)驅(qū)動系統(tǒng)控制方法:分段線性化振動抑制法以及自振動抑制法。 第四章通過實驗研究,確定低振動驅(qū)動控制方法所需要的相關(guān)參數(shù)。并驗證了偏心負(fù)載位置以及質(zhì)量實時測定方法的精度和基于脈動轉(zhuǎn)矩的低振動的滾筒洗衣機(jī)驅(qū)動系統(tǒng)控制方法的效果。 第五章總結(jié)了研究的主要工作,并對未來的工作方向進(jìn)行了研究和討論。

    標(biāo)簽: 振動 滾筒洗衣機(jī) 控制研究

    上傳時間: 2013-04-24

    上傳用戶:q123321

  • 電子式互感器的關(guān)鍵技術(shù)及其相關(guān)理論研究.rar

    電子式互感器與傳統(tǒng)電磁式互感器相比,在帶寬、絕緣和成本等方面具有優(yōu)勢,因而代表了高電壓等級電力系統(tǒng)中電流和電壓測量的一種極具吸引力的發(fā)展方向。隨著信息技術(shù)的發(fā)展和電力市場中競爭機(jī)制的形成,電子式互感器成為人們研究的熱點(diǎn);越來越多的新技術(shù)被引入到電子式互感器設(shè)計中,以提高其工作可靠性,降低運(yùn)行總成本,減小對生態(tài)環(huán)境的壓力。本文圍繞電子式互感器實用化中的關(guān)鍵技術(shù)而展開理論與實驗研究,具體包括新型傳感器、雙傳感器的數(shù)據(jù)融合算法、數(shù)字接口、組合式電源、低功耗技術(shù)和自監(jiān)測功能的實現(xiàn)等。 目前電子式電流互感器(ECT)大多數(shù)采用單傳感器開環(huán)結(jié)構(gòu),對每個環(huán)節(jié)的精度和可靠性的要求都很高,嚴(yán)重制約了ECT整體性能的提高,影響其實用化。本文介紹了新型傳感器~鐵心線圈式低功率電流傳感器(LPET)和印刷電路板(PCB)空心線圈及其數(shù)字積分器,在此基礎(chǔ)上設(shè)計了一種基于LPCT和PCB空心線圈的組合結(jié)構(gòu)的新型電流傳感器。該結(jié)構(gòu)具有并聯(lián)的特點(diǎn),結(jié)合了這兩種互感器的優(yōu)點(diǎn),采用數(shù)據(jù)融合算法來處理兩路信號,實現(xiàn)高精度測量和提高系統(tǒng)可靠性,并探索出辨別LPET飽和的新方法。試驗和仿真結(jié)果表明,這種新型電流傳感器可以覆蓋較大的電流測量范圍,達(dá)到IEC 60044-8標(biāo)準(zhǔn)中關(guān)于測量(幅值誤差)、保護(hù)(復(fù)合誤差)和暫態(tài)響應(yīng)(峰值)的準(zhǔn)確度要求,能夠作為多用途電流傳感器使用。 在電子式電壓互感器方面,基于精密電阻分壓器的新型傳感器在原理、結(jié)構(gòu)和輸出信號等方面與傳統(tǒng)的電壓互感器有很大不同,本文設(shè)計了一種可替代10kV電磁式電壓互感器的精密電阻分壓器。通過試驗研究與計算分析,得出其性能主要受電阻特性和雜散電容的影響,并給出了減小其誤差的方法。測試結(jié)果表明,設(shè)計的10kV精密電阻分壓器的準(zhǔn)確度滿足IEC 60044-7標(biāo)準(zhǔn)要求,可達(dá)0.2級。 電子式互感器的關(guān)鍵技術(shù)之一是內(nèi)部的數(shù)字化以及其標(biāo)準(zhǔn)化接口,本文以10kV組合型電子式互感器為對象設(shè)計了一種實用化的數(shù)字系統(tǒng)。以精密電阻分壓器作為電壓傳感器,電流傳感器則采用基于數(shù)據(jù)融合算法的LPCT和PCB空心線圈的組合結(jié)構(gòu)。本文首先解決了互感器間的同步與傳感器間的內(nèi)部同步問題,進(jìn)而依照IEC61850-9-1標(biāo)準(zhǔn),實現(xiàn)了組合型電子式互感器的100M以太網(wǎng)接口。 電子式電流互感器在高電壓等級的應(yīng)用研究中,ECT高壓側(cè)的電源問題是關(guān)鍵技術(shù)之一。論文首先分析了兩種電源方案:取電CT電源和激光電源。取電CT電源通過一個特制的電流互感器(取電CT),直接從高壓側(cè)母線電流中獲取電能。在取電CT和整流橋之間設(shè)計一個串聯(lián)電感,大大降低了施加在整流橋上的的感應(yīng)電壓并限制了取電CT的輸出電流,起到了穩(wěn)定電壓和保護(hù)后續(xù)電路的作用。激光電源方案以先進(jìn)的光電轉(zhuǎn)換器、半導(dǎo)體激光二極管和光纖為基礎(chǔ),單獨(dú)一根上行光纖同時完成供能和控制信號的傳輸,在不影響光供能穩(wěn)定性的情況下,數(shù)據(jù)通信完成在短暫的供能間隔中。在高電位端控制信號通過在能量變換電路中增加一個比較器電路被提取出來。本文還提出了一種將兩種供能方式結(jié)合使用的組合電源,并設(shè)計了這兩種電源之間的切換方法,解決了取電CT電源的死區(qū)問題,延長了激光器的使用壽命。作為綜合應(yīng)用實例,設(shè)計并完成了以LPCT為傳感器、由組合電源供能、采用低功耗技術(shù)的高壓電子式電流互感器。互感器高壓側(cè)的一次轉(zhuǎn)換器能夠提供兩路傳感器數(shù)據(jù)通道,并且具有溫度補(bǔ)償和采集通道的自校正功能,在更寬溫度、更大電流范圍內(nèi)保證了極高的測量精度:互感器低電位端的二次轉(zhuǎn)換器具有數(shù)字和模擬接口,可以接收數(shù)據(jù)并發(fā)送命令來控制一次轉(zhuǎn)換器,包括同步和校正命令在內(nèi)的數(shù)據(jù)信號可以通過同一根供能光纖傳送到一次轉(zhuǎn)換器。該互感器具有在線監(jiān)測功能,這種預(yù)防性維護(hù)和自檢測功能夠提示維護(hù)或提出警告,提高了可靠性。系統(tǒng)測試表明:具有低功耗光纖發(fā)射驅(qū)動電路的一次轉(zhuǎn)換器平均功耗在40mw以下:上行光纖中通信波特率可以達(dá)到200kb/s,下行光纖中更是高達(dá)2Mb/s;系統(tǒng)準(zhǔn)確度同時滿足IEC6044-8標(biāo)準(zhǔn)對0.2S級測量和5TPE級保護(hù)電子式互感器的要求。

    標(biāo)簽: 電子式互感器 關(guān)鍵技術(shù)

    上傳時間: 2013-06-09

    上傳用戶:handless

  • 高速低壓低功耗CMOSBiCMOS運(yùn)算放大器設(shè)計.rar

    近年來,以電池作為電源的微電子產(chǎn)品得到廣泛使用,因而迫切要求采用低電源電壓的模擬電路來降低功耗。目前低電壓、低功耗的模擬電路設(shè)計技術(shù)正成為微電子行業(yè)研究的熱點(diǎn)之一。 在模擬集成電路中,運(yùn)算放大器是最基本的電路,所以設(shè)計低電壓、低功耗的運(yùn)算放大器非常必要。在實現(xiàn)低電壓、低功耗設(shè)計的過程中,必須考慮電路的主要性能指標(biāo)。由于電源電壓的降低會影響電路的性能,所以只實現(xiàn)低壓、低功耗的目標(biāo)而不實現(xiàn)優(yōu)良的性能(如高速)是不大妥當(dāng)?shù)摹?論文對國內(nèi)外的低電壓、低功耗模擬電路的設(shè)計方法做了廣泛的調(diào)查研究,分析了這些方法的工作原理和各自的優(yōu)缺點(diǎn),在吸收這些成果的基礎(chǔ)上設(shè)計了一個3.3 V低功耗、高速、軌對軌的CMOS/BiCMOS運(yùn)算放大器。在設(shè)計輸入級時,選擇了兩級直接共源一共柵輸入級結(jié)構(gòu);為穩(wěn)定運(yùn)放輸出共模電壓,設(shè)計了共模負(fù)反饋電路,并進(jìn)行了共?;芈费a(bǔ)償;在偏置電路設(shè)計中,電流鏡負(fù)載并不采用傳統(tǒng)的標(biāo)準(zhǔn)共源-共柵結(jié)構(gòu),而是采用適合在低壓工況下的低壓、寬擺幅共源-共柵結(jié)構(gòu);為了提高效率,在設(shè)計時采用了推挽共源極放大器作為輸出級,輸出電壓擺幅基本上達(dá)到了軌對軌;并采用帶有調(diào)零電阻的密勒補(bǔ)償技術(shù)對運(yùn)放進(jìn)行頻率補(bǔ)償。 采用標(biāo)準(zhǔn)的上華科技CSMC 0.6μpm CMOS工藝參數(shù),對整個運(yùn)放電路進(jìn)行了設(shè)計,并通過了HSPICE軟件進(jìn)行了仿真。結(jié)果表明,當(dāng)接有5 pF負(fù)載電容和20 kΩ負(fù)載電阻時,所設(shè)計的CMOS運(yùn)放的靜態(tài)功耗只有9.6 mW,時延為16.8ns,開環(huán)增益、單位增益帶寬和相位裕度分別達(dá)到82.78 dB,52.8 MHz和76°,而所設(shè)計的BiCMOS運(yùn)放的靜態(tài)功耗達(dá)到10.2 mW,時延為12.7 ns,開環(huán)增益、單位增益帶寬和相位裕度分別為83.3 dB、75 MHz以及63°,各項技術(shù)指標(biāo)都達(dá)到了設(shè)計要求。

    標(biāo)簽: CMOSBiCMOS 低壓 低功耗

    上傳時間: 2013-06-29

    上傳用戶:saharawalker

  • 基于嵌入式的遠(yuǎn)程圖像采集傳輸系統(tǒng)的研究.rar

    圖像的采集和傳輸是實時監(jiān)控、遠(yuǎn)程控制、智能小區(qū)等諸多領(lǐng)域的關(guān)鍵技術(shù)?;趥鹘y(tǒng):PC的圖像采集已成為現(xiàn)實。隨著信息技術(shù)的迅速發(fā)展,嵌入式系統(tǒng)的研究開發(fā)成為了后PC時代的一個熱點(diǎn),它被廣泛應(yīng)用于工業(yè)現(xiàn)場、信息家電等各行各業(yè)。同時,圖像的遠(yuǎn)程采集傳輸也朝著專業(yè)化、多樣化和低成本的方向發(fā)展。利用嵌入式技術(shù)來實現(xiàn)圖像的遠(yuǎn)程采集傳輸正順應(yīng)了時代發(fā)展,有較大的實用價值。 本文主要研究了基于嵌入式的遠(yuǎn)程圖像采集傳輸系統(tǒng)。嵌入式終端采用$3C2410為核心的目標(biāo)板為硬件平臺,采用嵌入式Linux為系統(tǒng)平臺。系統(tǒng)通過連接在嵌入式終端的USB攝像頭完成靜態(tài)圖像數(shù)據(jù)采集,并進(jìn)行圖像壓縮處理。在圖像傳輸方面,論文設(shè)計了兩種模式:一種是通過Intemet傳輸?shù)摹⒒贐/S模式的傳輸方式。在該模式下,遠(yuǎn)端客戶機(jī)通過瀏覽器訪問架設(shè)在終端里的嵌入式服務(wù)器而獲得圖像信息。另一種是基于GPRS網(wǎng)絡(luò)實現(xiàn)遠(yuǎn)程無線圖像傳輸。終端將采集到的圖像數(shù)據(jù)通過GPRS網(wǎng)絡(luò)發(fā)送到擁有固定Ip的監(jiān)控服務(wù)器上來完成圖像遠(yuǎn)程傳輸。 本文首先介紹了圖像采集傳輸和嵌入式方面的相關(guān)內(nèi)容,并介紹了本論文所采用的開發(fā)平臺。為了順利開發(fā)接著構(gòu)建了開發(fā)環(huán)境,這里包括U-boot的移植、Linux系統(tǒng)的內(nèi)核編譯和移植、設(shè)備驅(qū)動模塊的加載以及交叉編譯環(huán)境的建立。在此基礎(chǔ)上,利用Vide04Linux的接口函數(shù),用C語言實現(xiàn)了圖像原始數(shù)據(jù)的采集程序,并利用JPEG算法了實現(xiàn)圖像壓縮。在基于B/S模式的傳輸方式中,首先利用Boa架設(shè)了嵌入式服務(wù)器,然后用C語言完成CGI腳本,該腳本將圖像嵌入網(wǎng)頁并實時更新以實現(xiàn)網(wǎng)頁的動態(tài)輸出。在基于GPRS實現(xiàn)遠(yuǎn)程無線圖像傳輸方式中,論文詳細(xì)分析了系統(tǒng)通訊數(shù)據(jù)流的特征,提出了采用辨識特征字符、數(shù)據(jù)打包等策略以實現(xiàn)GPRS的網(wǎng)絡(luò)連接和數(shù)據(jù)通訊,并且在此基礎(chǔ)上用C語言編程實現(xiàn)。同時,在PC(Linux)上用Socket編程實現(xiàn)了監(jiān)控服務(wù)器軟件,該軟件用以接收圖像數(shù)據(jù)和控制嵌入式終端的系統(tǒng)狀態(tài)。最后,論文分析比較了兩種傳輸方式的區(qū)別和優(yōu)缺點(diǎn)。試驗證明,采用兩種方式都能成功實現(xiàn)圖像的遠(yuǎn)程采集傳輸,并且試驗效果較好。

    標(biāo)簽: 嵌入式 遠(yuǎn)程圖像

    上傳時間: 2013-05-17

    上傳用戶:squershop

  • 嵌入式視頻監(jiān)控系統(tǒng)的FPGA圖像處理子系統(tǒng)設(shè)計.rar

    隨著圖像處理技術(shù)的不斷發(fā)展,圖像處理技術(shù)在國民經(jīng)濟(jì)和社會生活的各個方面都得到了廣泛的運(yùn)用。與此同時,人們對圖像處理的要求也越來越高。傳統(tǒng)的數(shù)字圖像處理器件主要有專用集成芯片(Application Specific Integrated Circuit)和數(shù)字信號處理器(Digital Signal Process)。進(jìn)入20世紀(jì)以來,伴隨著半導(dǎo)體技術(shù)的發(fā)展,現(xiàn)場可編程門陣列FPGA以其應(yīng)用靈活、集成度高、功能強(qiáng)大、設(shè)計周期短、開發(fā)成本低的特點(diǎn),越來越多地被應(yīng)用在圖像處理領(lǐng)域。大量實踐證明,F(xiàn)PGA的并行處理能力與流水線作業(yè)能顯著地提高圖像處理的速度,因此基于FPGA的圖像處理系統(tǒng)有著廣闊的發(fā)展前景。 本文研究的是一個在嵌入式視頻監(jiān)控系統(tǒng)下的圖像預(yù)處理子系統(tǒng)。首先實現(xiàn)了一個通用可重復(fù)配置的圖像處理算法研究硬件平臺,完成圖像的采集、接收、處理、存儲、輸出等功能。由于FPGA本身具有完全的可重復(fù)配置性,所以該架構(gòu)的硬件平臺可以很方便的升級和重復(fù)配置。其次在該平臺上,本文使用Verilog HDL硬件語言在FPGA芯片上實現(xiàn)了多種圖像預(yù)處理算法。在實現(xiàn)過程中,為了充分發(fā)揮FPGA在并行處理方面的強(qiáng)大功能,本文對算法做了一定的改進(jìn),使其盡量能使用并行處理的方式來完成。實驗結(jié)果表明,本圖像預(yù)處理系統(tǒng)能在毫秒級高速地完成多種圖像算法,完全能夠滿足視頻監(jiān)控系統(tǒng)50幀/秒的輸出要求。 最后根據(jù)視頻監(jiān)控系統(tǒng)在實際運(yùn)用中出現(xiàn)的噪聲類型多樣化的情況,我們設(shè)計了一種基于反饋理論的圖像處理效果控制模塊。該模塊能通過對處理后圖像峰值信噪比(PSNR)的分析,控制FPGA對下一幅圖像的噪聲采用更有針對性的圖像處理方法。

    標(biāo)簽: FPGA 嵌入式視頻 圖像處理

    上傳時間: 2013-05-20

    上傳用戶:gundamwzc

  • FIR數(shù)字濾波器的FPGA最佳實現(xiàn)方法研究.rar

    在圖像處理、數(shù)據(jù)傳輸、雷達(dá)接收等現(xiàn)代信號處理領(lǐng)域,對信號處理的穩(wěn)定性、實時性和靈活性都有很高的要求。FIR數(shù)字濾波器因其線性相位特性滿足了現(xiàn)代信號處理領(lǐng)域?qū)V波器的高性能要求,成為應(yīng)用最廣泛的數(shù)字濾波器之一。高密度的FPGA兼顧實時性和靈活性,為FIR數(shù)字濾波器的實現(xiàn)提供了強(qiáng)大的硬件支持。 現(xiàn)今FIR數(shù)字濾波器的FPGA實現(xiàn)方法中最常用的是基于DA的實現(xiàn)方法和基于CSD編碼的實現(xiàn)方法,本文對這兩種實現(xiàn)方法進(jìn)行了深入的探討,并進(jìn)行了一定的改進(jìn)。本論文所做的主要工作和創(chuàng)新如下: 1、對FIR數(shù)字濾波器的硬件實現(xiàn)方法進(jìn)行了理論研究,其中著重對并行FIR數(shù)字濾波器的實現(xiàn)方法進(jìn)行了深入探討并提出了一個改進(jìn)的實現(xiàn)方法:基于CSD-DA的改進(jìn)實現(xiàn)方法。這個實現(xiàn)方法在一定情況下比單純的基于CSD編碼的實現(xiàn)方法和基于DA的實現(xiàn)方法都要節(jié)約芯片面積。 2、經(jīng)過電路建模和數(shù)學(xué)推導(dǎo)提出了“CSD-DA擇優(yōu)比較法”。該比較法可以從基于CSD編碼的實現(xiàn)方法、基于DA的實現(xiàn)方法以及基于CSD-DA的改進(jìn)實現(xiàn)方法中較精確的選擇出最佳實現(xiàn)方法。 3、用Cyclone EPEC6Q240C8芯片和音頻編解碼芯片TLV320AIC23B實現(xiàn)了一個可以濾除音頻信號中高頻噪聲的音頻FIR數(shù)字低通濾波器。

    標(biāo)簽: FPGA FIR 數(shù)字濾波器

    上傳時間: 2013-06-07

    上傳用戶:zhangyi99104144

  • 基于FPGA的分布式采集系統(tǒng)時鐘同步控制技術(shù)研究與實現(xiàn).rar

    隨著電子技術(shù)的快速發(fā)展,各種電子設(shè)備對時間精度的要求日益提升。在衛(wèi)星發(fā)射、導(dǎo)航、導(dǎo)彈控制、潛艇定位、各種觀測、通信等方面,時鐘同步技術(shù)都發(fā)揮著極其重要的作用,得到了廣泛的推廣。對于分布式采集系統(tǒng)來說,中心主站需要對來自于不同采集設(shè)備的采集數(shù)據(jù)進(jìn)行匯總和分析,得到各個采集點(diǎn)對同一事件的采集時間差異,通過對該時間差異的分析,最終做出對事件的準(zhǔn)確判斷。如果分布式采集系統(tǒng)中的各個采集設(shè)備不具有統(tǒng)一的時鐘基準(zhǔn),那么得到的各個采集時間差異就不能反映出實際情況,中心主站也無法準(zhǔn)確地對事件進(jìn)行分析和判斷,甚至得出錯誤的結(jié)論。因此,時鐘同步是分布式采集系統(tǒng)正常運(yùn)作的必要前提。 目前國內(nèi)外時鐘同步領(lǐng)域常用的技術(shù)有GPS授時技術(shù),鎖相環(huán)技術(shù)和IRIG-B 碼等。GPS授時技術(shù)雖然精度高,抗干擾性強(qiáng),但是由于需要專用的GPS接收機(jī),若單純使用GPS 授時技術(shù)做時鐘同步,就需要在每個采集點(diǎn)安裝接收機(jī),成本較高。鎖相環(huán)是一種讓輸出信號在頻率和相位上與輸入?yún)⒖夹盘柾降募夹g(shù),輸出信號的時鐘準(zhǔn)確度和穩(wěn)定性直接依賴于輸入?yún)⒖夹盘枴RIG-B 碼是一種信息量大,適合傳輸?shù)臅r間碼,但是由于其時間精度低,不適合應(yīng)用于高精度時鐘同步的系統(tǒng)。基于上述分析,本文結(jié)合這三種常用技術(shù),提出了一種基于FPGA的分布式采集系統(tǒng)時鐘同步控制技術(shù)。該技術(shù)既保留了GPS 授時的高精確度和高穩(wěn)定性,又具備IRIG-B時間碼易傳輸和低成本的特性,為分布式采集系統(tǒng)中的時鐘同步提供了一種新的解決方案。 本文中的設(shè)計采用了Ublox公司的精確授時GPS芯片LEA-5T,通過對GPS芯片串行時間信息解碼,獲得準(zhǔn)確的UTC時間,并實現(xiàn)了分布式采集系統(tǒng)中各個采集設(shè)備的精確時間打碼。為了能夠使整個分布式采集系統(tǒng)具有統(tǒng)一的高精度數(shù)據(jù)采集時鐘,本論文采用了數(shù)?;旌系逆i相環(huán)技術(shù),將GPS 接收芯片輸出的高精度秒信號作為參考基準(zhǔn),生成了與秒信號高精度同步的100MHZ 高頻時鐘。本文在FPGA 中完成了IRIG-B 碼的編碼部分,將B 碼的準(zhǔn)時標(biāo)志與GPS 秒信號同步,提高了IRIG-B 碼的時間精度。在分布式采集系統(tǒng)中,IRIG-B時間碼能直接通過串口或光纖將各個采集點(diǎn)時間與UTC時間統(tǒng)一,節(jié)約了各點(diǎn)布設(shè)GPS 接收機(jī)的高昂成本。最后,通過PC104總線對時鐘同步控制卡進(jìn)行了數(shù)據(jù)讀取和測試,通過實驗結(jié)果的分析,提出了改進(jìn)方案。實驗表明,改進(jìn)后的時鐘同步控制方案具有很高的時鐘同步精度,對時鐘同步技術(shù)有著重大的推進(jìn)意義!

    標(biāo)簽: FPGA 分布式 采集

    上傳時間: 2013-08-05

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  • LTE系統(tǒng)中基帶DAGC的應(yīng)用研究及FPGA實現(xiàn).rar

    當(dāng)今,移動通信正處于向第四代通信系統(tǒng)發(fā)展的階段,OFDM技術(shù)作為第四代數(shù)字移動通信(4G)系統(tǒng)的關(guān)鍵技術(shù)之一,被包括LTE在內(nèi)的眾多準(zhǔn)4G協(xié)議所采用。IDFT/DFT作為OFDM系統(tǒng)中的關(guān)鍵功能模塊,其精度對基帶解調(diào)性能產(chǎn)生著重大的影響,尤其對LTE上行所采用的SC_FDMA更是如此。為了使定點(diǎn)化IDFT/DFT達(dá)到較好的性能,本文采用數(shù)字自動增益控制(DAGC)技術(shù),以解決過大輸入信號動態(tài)范圍所造成的IDFT/DFT輸出信噪比(SNR)惡化問題。 首先,本文簡單介紹了較為成熟的AAGC(模擬AGC)技術(shù),并重點(diǎn)關(guān)注近年來為了改善其性能而興起的數(shù)字化AGC技術(shù),它們主要用于壓縮ADC輸入動態(tài)范圍以防止其飽和。針對基帶處理中具有累加特性的定點(diǎn)化IDFT/DFT技術(shù),進(jìn)一步分析了AAGC技術(shù)和基帶DAGC在實施對象,實現(xiàn)方法等上的異同點(diǎn),指出了基帶DAGC的必要性。 其次,根據(jù)LTE協(xié)議,搭建了從調(diào)制到解調(diào)的基帶PUSCH處理鏈路,并針對基于DFT的信道估計方法的缺點(diǎn),使用簡單的兩點(diǎn)替換實現(xiàn)了優(yōu)化,通過高斯信道下的MATLAB仿真,證明其可以達(dá)到理想效果。仿真結(jié)果還表明,在不考慮同步問題的高斯信道下,本文所搭建的基帶處理鏈路,采用64QAM進(jìn)行調(diào)制,也能達(dá)到在SNR高于17dB時,硬判譯碼結(jié)果為極低誤碼率(BER)的效果。 再次,在所搭建鏈路的基礎(chǔ)上,通過理論分析和MATLAB仿真,證明了包括時域和頻域DAGC在內(nèi)的基帶DAGC具有穩(wěn)定接收鏈路解調(diào)性能的作用。同時,通過對幾種DAGC算法的比較后,得到的一套適用于實現(xiàn)的基帶DAGC算法,可以使IDFT/DFT的輸出SNR處于最佳范圍,從而滿足LTE系統(tǒng)基帶解調(diào)的要求。針對時域和頻域DAGC的差異,分別選定移位和加法,以及查表的方式進(jìn)行基帶DAGC算法的實現(xiàn)。 最后,本文對選定的基帶DAGC算法進(jìn)行了FPGA設(shè)計,仿真、綜合和上板結(jié)果說明,時域和頻域DAGC實現(xiàn)方法占用資源較少,容易進(jìn)行集成,能夠達(dá)到的最高工作頻率較高,完全滿足基帶處理的速率要求,可以流水處理每一個IQ數(shù)據(jù),使之滿足基帶解調(diào)性能。

    標(biāo)簽: DAGC FPGA LTE

    上傳時間: 2013-05-17

    上傳用戶:laozhanshi111

  • 基于FPGA的RS255,223編解碼器的高速并行實現(xiàn).rar

    隨著信息時代的到來,用戶對數(shù)據(jù)保護(hù)和傳輸可靠性的要求也在不斷提高。由于信道衰落,信號經(jīng)信道傳輸后,到達(dá)接收端不可避免地會受到干擾而出現(xiàn)信號失真。因此需要采用差錯控制技術(shù)來檢測和糾正由信道失真引起的信息傳輸錯誤。RS(Reed—Solomon)碼是差錯控制領(lǐng)域中一類重要的線性分組碼,由于它編解碼結(jié)構(gòu)相對固定,性能強(qiáng),不但可以糾正隨機(jī)差錯,而且對突發(fā)錯誤的糾錯能力也很強(qiáng),被廣泛應(yīng)用在數(shù)字通信、數(shù)據(jù)存儲系統(tǒng)中,以滿足對數(shù)據(jù)傳輸通道可靠性的要求。因此設(shè)計一款高性能的RS編解碼器不但具有很大的應(yīng)用意義,而且具有相當(dāng)大的經(jīng)濟(jì)價值。 本文首先介紹了線形分組碼及其子碼循環(huán)碼、BCH碼的基礎(chǔ)理論知識,重點(diǎn)介紹了BCH碼的重要分支RS碼的常用編解碼算法。由于其算法在有限域上進(jìn)行,接著介紹了有限域的有關(guān)理論。基于RS碼傳統(tǒng)的單倍結(jié)構(gòu),本文提出了一種八倍并行編碼及九倍并行解碼方案,并用Verilog HDL語言實現(xiàn)。其中編碼器基于傳統(tǒng)的線性反饋移位寄存器除法電路并進(jìn)行八倍并行擴(kuò)展,譯碼器關(guān)鍵方程求解模塊基于修正的歐幾里德算法設(shè)計了一種便于硬件實現(xiàn)的脈動關(guān)鍵方程求解結(jié)構(gòu),其他模塊均采用九倍并行實現(xiàn)。由于進(jìn)行了超前運(yùn)算、流水線及并行處理,使編解碼的數(shù)據(jù)吞吐量大為提高,同時延時更小。 本論文設(shè)計了C++仿真平臺,并與HDL代碼結(jié)果進(jìn)行了對比驗證。Verilog HDL代碼經(jīng)過modelsim仿真驗證,并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上進(jìn)行綜合驗證以及靜態(tài)時序分析,綜合軟件為QUATURSⅡ V8.0。驗證及測試表明,本設(shè)計在滿足編解碼基本功能的基礎(chǔ)上,能夠?qū)崿F(xiàn)數(shù)據(jù)的高吞吐量和低延時傳輸,達(dá)到性能指標(biāo)要求。本論文在基于FPGA的RS(255,223)編解碼器的高速并行實現(xiàn)方面的研究成果,具有通用性、可移植性,有一定的理論及經(jīng)濟(jì)價值。

    標(biāo)簽: FPGA 255 223

    上傳時間: 2013-04-24

    上傳用戶:思琦琦

  • 基于FPGA的高速串行接口模塊仿真設(shè)計.rar

    現(xiàn)代社會信息量爆炸式增長,由于網(wǎng)絡(luò)、多媒體等新技術(shù)的發(fā)展,用戶對帶寬和速度的需求快速增加。并行傳輸技術(shù)由于時鐘抖動和偏移,以及PCB布線的困難,使得傳輸速率的進(jìn)一步提升面臨設(shè)計的極限;而高速串行通信技術(shù)憑借其帶寬大、抗干擾性強(qiáng)和接口簡單等優(yōu)勢,正迅速取代傳統(tǒng)的并行技術(shù),成為業(yè)界的主流。 本論文針對目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進(jìn)行研究,并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進(jìn)行仿真設(shè)計。本論文的主要工作是以某低成本相控陣?yán)走_(dá)信號處理機(jī)為設(shè)計平臺,在其中的一塊信號處理板上,進(jìn)行了基于LVDS(Low VoltageDifferential Signal)技術(shù)的高速LinkPort(鏈路口)設(shè)計和基于CML(Current ModeLogic)技術(shù)的Rocket I/O高速串行接口設(shè)計。首先在FPGA的軟件中進(jìn)行程序設(shè)計和功能、時序的仿真,當(dāng)仿真驗證通過之后,重點(diǎn)是在硬件平臺上進(jìn)行調(diào)試。硬件調(diào)試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接,進(jìn)行數(shù)據(jù)的互相傳送,接收和發(fā)送的數(shù)據(jù)相同,證明了高速鏈路口設(shè)計的正確性。并且在硬件調(diào)試時對Rocket IO GTP收發(fā)器進(jìn)行回環(huán)設(shè)計,經(jīng)過回環(huán)之后接收到的數(shù)據(jù)與發(fā)送的數(shù)據(jù)相同,證明了Rocket I/O高速串行接口設(shè)計的正確性。

    標(biāo)簽: FPGA 高速串行 接口模塊

    上傳時間: 2013-04-24

    上傳用戶:戀天使569

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