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內(nèi)(nèi)核

  • 基于NiosII軟核處理器的步進電機接口設(shè)計

        NiosII軟核處理器是Altera公司開發(fā),基于FPGA操作平臺使用的一款高速處理器,為了適應(yīng)高速運動圖像采集,提出了一種基于NiosII軟核處理的步進電機接口設(shè)計,使用verilog HDL語言完成該接口設(shè)計,最后通過QuartusII軟件,給出了實驗仿真結(jié)果。

    標(biāo)簽: NiosII 軟核處理器 步進電機 接口設(shè)計

    上傳時間: 2014-12-28

    上傳用戶:jiwy

  • 基于FPGA的DDS IP核設(shè)計方案

    以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具,研究了基于FPGA的DDS IP核設(shè)計,并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計的DDS IP核封裝成為SOPC Builder自定義的組件,結(jié)合32位嵌入式CPU軟核Nios II,構(gòu)成可編程片上系統(tǒng)(SOPC),利用極少的硬件資源實現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成,利用 SOPC技術(shù),在一片 FPGA 芯片上實現(xiàn)了整個信號源的硬件開發(fā)平臺,達到既簡化電路設(shè)計、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標(biāo)簽: FPGA DDS IP核 設(shè)計方案

    上傳時間: 2013-11-06

    上傳用戶:songkun

  • 基于多核DSP的SDIF雷達信號分選算法實現(xiàn)

    針對實際應(yīng)用中電子戰(zhàn)設(shè)備對雷達信號分選的實時性要求,在分析了序列差直方圖算法和多核DSP任務(wù)并行模式的基礎(chǔ)上,設(shè)計了基于TMS320C6678的八核DSP雷達信號分選電路,對密集的雷達信號進行分選。實驗結(jié)果表明:該電路可對常規(guī)雷達信號實現(xiàn)快速分選,并且分選效果良好,系統(tǒng)可靠性高。

    標(biāo)簽: SDIF DSP 多核 雷達信號分選

    上傳時間: 2013-10-16

    上傳用戶:攏共湖塘

  • 基于多核處理器的彈載嵌入式系統(tǒng)設(shè)計研究

    基于實現(xiàn)目標(biāo)探測識別以及高精度目標(biāo)信息測量等復(fù)雜處理算法的目的,采用單片多核DSP TMS320C6678構(gòu)成彈載高速多任務(wù)實時嵌入式處理平臺,通過數(shù)據(jù)流處理模式的并行軟件設(shè)計方法,將系統(tǒng)處理任務(wù)均衡分配到各處理器內(nèi)核,以實現(xiàn)實時并行處理,提升彈載信息處理系統(tǒng)的功能和性能。開展基于多核處理器的并行軟件研制、充分發(fā)揮多核處理能力將成為彈載嵌入式系統(tǒng)軟件設(shè)計的新課題。

    標(biāo)簽: 多核處理器 嵌入式系統(tǒng)設(shè)計

    上傳時間: 2013-11-23

    上傳用戶:璇珠官人

  • 基于NiosII多核智能交通車載終端的設(shè)計

    利用NiosII多核處理器,提出了基于Internet的實時路況查詢系統(tǒng)和智能車載終端。通過配置雙NiosII軟核,改善了MCU處理速度不高、外設(shè)資源有限、接口配置繁瑣、硬件設(shè)計和軟件設(shè)計編程復(fù)雜等問題,將大量控制以及對多種外設(shè)訪問的工作進行了合理分配。既具有普通導(dǎo)航設(shè)備的方便實用性,又能通過無線通訊及Internet與后臺服務(wù)器連接,獲取道路擁堵情況、停車場車位情況等動態(tài)實時信息,同時可作為智能交通的車載前端。

    標(biāo)簽: NiosII 多核 智能交通 車載終端

    上傳時間: 2014-12-30

    上傳用戶:superman111

  • 基于FPGA的16位數(shù)據(jù)路徑的AESIP核

    基于FPGA的16位數(shù)據(jù)路徑的AESIP核

    標(biāo)簽: AESIP FPGA 數(shù)據(jù)路徑

    上傳時間: 2013-11-12

    上傳用戶:zhangjinzj

  • Multicore Expert 系列: Multicore 2.0,來自飛思卡爾的下一代多核軟件

    本次會議,我們將討論加入下一代多核軟件開發(fā)包(SDK)的多個創(chuàng)新技術(shù),包括簡潔、高可用API集的新基礎(chǔ)庫(FLIB);重構(gòu)的Netcomm軟件庫;支持SEC IP模塊以實現(xiàn)安全功能的新使能工具;具有參考應(yīng)用的用戶空間DPAA (USDPAA);新型虛擬化技術(shù),包括現(xiàn)有Topaz+基于Kernel的虛擬機(KVM) ,用以優(yōu)化用戶空間的嵌入式容器支持;及非對稱多處理框架等。 本會是Multicore Expert系列的一部分,機會不容錯過。

    標(biāo)簽: Multicore Expert 2.0 飛思卡爾

    上傳時間: 2013-11-02

    上傳用戶:wojiaohs

  • 多核專家系列:多核軟件遷移與開發(fā):挑戰(zhàn)與解決方案

    隨著多核平臺在嵌入式市場的激增,從傳統(tǒng)堆棧到多核堆棧的遷移已成標(biāo)準(zhǔn)任務(wù)。但它本身引發(fā)了如何有效挖掘多核功能的一些挑戰(zhàn)。部分需要解決的問題包括:調(diào)試、有效線程處理及避免出現(xiàn)死鎖情況、性能和時間造成的延遲問題、多個CPU之間共享系統(tǒng)資源的問題、緩存一致性問題、OS角色問題(不同CPU之間的線程及中斷遷移)等。本會議將具體討論這些挑戰(zhàn)并且針對如何應(yīng)對這些挑戰(zhàn)提供相應(yīng)的建議。此外,我們還將討論現(xiàn)有的調(diào)試技術(shù)、工具和方法論。

    標(biāo)簽: 多核 軟件 方案

    上傳時間: 2013-12-26

    上傳用戶:wxnumen

  • 基于SOPC的觸控屏控制器IP核設(shè)計

    介紹一款基于SOPC的TFT-LCD觸控屏控制器IP核的設(shè)計與實現(xiàn)。采用Verilog HDL作控制器的模塊設(shè)計,并用ModelSim仿真測試,驗證其正確性;利用嵌入式SOPC開發(fā)工具,在開發(fā)板上完成觸控屏顯示驅(qū)動及其控制模塊的系統(tǒng)設(shè)計,給出系統(tǒng)硬、軟件設(shè)計,實現(xiàn)TFT-LCD觸控屏彩條顯示。這款觸控屏控制器IP核具備較強的通用性和兼容性,具有一定的使用范圍和應(yīng)用價值。

    標(biāo)簽: SOPC IP核 觸控屏控制器

    上傳時間: 2013-12-24

    上傳用戶:sdq_123

  • 基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計

    目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計以及共享實現(xiàn)LED燈的時控.

    標(biāo)簽: MicroBlaze SoPC AXI 總線

    上傳時間: 2014-12-30

    上傳用戶:stewart·

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