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內核網(wǎng)絡

  • 英飛凌XMC4500開發(fā)板原理圖接口部分

    英飛凌的32位MCU產(chǎn)品XMC4500是基于ARM的Cortex-M4核開發(fā)的新的產(chǎn)品，主頻在全溫度范圍內（最高125度）高達120MHz，帶有浮點運算，專用的電機控制接口。 此為開發(fā)套件的接口（以太網(wǎng)，CAN等）原理圖和PCB圖，原始文檔。。 ------晶川電子

    標簽： 4500 XMC 英飛凌 開發(fā)板原理圖

    上傳時間： 2013-05-20

    上傳用戶：FreeSky

  • 基于DSP和FPGA實時視頻采集、處理和顯示平臺

    基于高速數(shù)字信號處理器(DSP) 和大規(guī)模現(xiàn)場可編程門陣列( FPGA) ,成功地研制了小型\\r\\n化、低功耗的實時視頻采集、處理和顯示平臺. 其中的DSP 負責圖像處理,其外圍的全部數(shù)字邏輯功能都集成在一片F(xiàn)PGA 內,包括高速視頻流FIFO、同步時序產(chǎn)生與控制、接口邏輯轉換和對視頻編/ 解碼器進行設置的I2 C 控制核等. 通過增大FIFO 位寬、提高傳輸帶寬,降低了占用EMIF 總線的時間 利用數(shù)字延遲鎖相環(huán)邏輯,提高了顯示接口時序控制精度. 系統(tǒng)軟件由驅動層、管理層和應用層組成,使得硬件管理與

    標簽： FPGA DSP 實時視頻 采集

    上傳時間： 2013-08-08

    上傳用戶：PresidentHuang

  • 利用FPGA實現(xiàn)DDS經(jīng)過編譯沒有錯誤。編譯環(huán)境為QuartusII7.2

    利用FPGA實現(xiàn)DDS經(jīng)過編譯沒有錯誤。編譯環(huán)境為QuartusII7.2，該環(huán)境集成了IP核，可以提高開發(fā)效率。

    標簽： QuartusII FPGA DDS 7.2

    上傳時間： 2013-08-10

    上傳用戶：zhuyibin

  • 基于SDR Sdram(同步動態(tài)RAM) 作為主存儲器的LED 顯示系統(tǒng)的研究

    針對主控制板上存儲器(SRAM) 存儲的數(shù)據(jù)量小和最高頻率低的情況,提出了基于SDR Sdram(同步動態(tài)RAM) 作為主存儲器的LED 顯示系統(tǒng)的研究。在實驗中,使用了現(xiàn)場可編程門陣列( FPGA) 來實現(xiàn)各模塊的邏輯功能。最終實現(xiàn)了對L ED 顯示屏的控制,并且一塊主控制板最大限度的控制了256 ×128 個像素點,基于相同條件,比靜態(tài)內存控制的面積大了一倍,驗證了動態(tài)內存核[7 ]的實用性。

    標簽： Sdram SDR RAM LED

    上傳時間： 2013-08-21

    上傳用戶：sjw920325

  • 基于MAXII CPLD的對1602字符型液晶進行讀寫操作

    基于MAXII CPLD的對1602字符型液晶進行讀寫操作，其中使用了一個CFI的IP核

    標簽： MAXII CPLD 1602 字符型液晶

    上傳時間： 2013-08-23

    上傳用戶：yeling1919

  • 高級fpga編程

    高級fpga編程，采用nios2軟核，適合指導高級用戶

    標簽： fpga 編程

    上傳時間： 2013-08-23

    上傳用戶：2728460838

  • 基于FPGA的DDS基本信號發(fā)生器的設計

    　　本設計基于DDS原理和FPGA技術按照順序存儲方式，將對正弦波、方波、三角波、鋸齒波四種波形的取樣數(shù)據(jù)依次全部存儲在ROM波形表里，通過外接設備撥扭開關和鍵盤控制所需波形信號的輸出，最終將波形信息顯示在LCD液晶顯示屏上。各硬件模塊之間的協(xié)調工作通過嵌入式軟核處理器NiosⅡ用編程實現(xiàn)控制。本設計所搭建的LCD12864控制器是通過編程實現(xiàn)的IP核。

    標簽： FPGA DDS 信號發(fā)生器

    上傳時間： 2013-11-09

    上傳用戶：xfbs821

  • 基于SOPC數(shù)據(jù)采集與控制系統(tǒng)的設計

        基于SOPC技術設計了一個綜合應用系統(tǒng)：實現(xiàn)了鍵值數(shù)據(jù)采集、顯示，并將采集到的數(shù)據(jù)通過串口送給上位機；也可以接收上位機送來的數(shù)據(jù)，控制點亮相應的二極管且將接收到的數(shù)據(jù)顯示在數(shù)碼管上。系統(tǒng)硬件由FPGA及外圍電路組成，采用了性能優(yōu)良的Nios II軟核處理器；軟件在Altera公司的軟件集成開發(fā)工具Nios II IDE下應用C語言編程。該系統(tǒng)工作可靠，在實際的應用設計中有一定的參考價值。

    標簽： SOPC 數(shù)據(jù)采集 控制系統(tǒng)

    上傳時間： 2013-10-10

    上傳用戶：jjj0202

  • 集成化圖像控制引擎的研究與實現(xiàn)

    隨著半導體技術以及計算機軟硬件技術的飛速發(fā)展，對于圖像的顯示和控制技術也呈現(xiàn)出越來越多的方式。文中介紹了一種基于NIOS II軟核處理器實現(xiàn)對SD卡驅動與TFT-LCD控制的方法。在設計中利用FPGA的Altera的SOPC Builder定制NIOS II軟核處理器及其與顯示功能相關的模塊來協(xié)同從SD卡讀取JPEG格式的圖片，經(jīng)過FPGA解碼處理顯示于TFL-LCD上，并使用觸摸控制實現(xiàn)圖片的前進、后退、，暫停、自動播放時間控制功能

    標簽： 集成化 圖像控制 引擎

    上傳時間： 2013-11-01

    上傳用戶：huangld

  • 單端10-bit SAR ADC IP核的設計

    本設計通過采用分割電容陣列對DAC進行優(yōu)化，在減小了D/A轉換開關消耗的能量、提高速度的基礎上，實現(xiàn)了一款采樣速度為1 MS/s的10-bit單端逐次逼近型模數(shù)轉換器。使用cadence spectre 工具進行仿真，仿真結果表明，設計的D/A轉換器和比較器等電路滿足10-bit A/D 轉換的要求，逐次逼近A/D轉換器可以正常工作。

    標簽： bit SAR ADC 10

    上傳時間： 2013-11-21

    上傳用戶：chukeey

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