870_880MHz頻段的CDMA結環行器方案
利用帶線結環行器的相關理論，設計了870～880MHz 結環行器，最后實現的環行器在0.5～1.5GHz內，插入損耗≤0.4dB，最小隔離度≥ 20dB，電壓駐波比≤ 1.20，符合基站用環行器的技術指標. ...
四軸飛行器技術資料
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設計一個四路數據選擇器,其功能是將四組不同的數據按要求選擇一個輸出.輸出的那組數據有兩個控制信號決定,其真值表如下: 數據選擇控制端 輸出的數據 Input0 Input1 output 0 0 output0 0 1 output1 1 0 output 2 1 1 output 3...
VHDL的四選一選擇器
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用一位全加器組成四位全加器. 所用語言是Verilog HDL. 主要用在加法器的設計中。
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基于地址總線接口的四倍頻編碼器信號接口的 FPGA實現 Verilog HDL的
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