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國考職位表甘肅

  • TLV5616 12 位 3微秒 DAC 串行輸入可編程設置時間 功耗

    TLV5616 12 位 3微秒 DAC 串行輸入可編程設置時間 功耗

    標簽: 5616 TLV DAC 12

    上傳時間: 2013-11-02

    上傳用戶:xinyuzhiqiwuwu

  • 用ADC0832設計的兩路電壓表

    用ADC0832設計的兩路電壓表1 源代碼

    標簽: 0832 ADC 電壓表

    上傳時間: 2014-01-05

    上傳用戶:momofiona

  • 24位AD轉換器CS5361原理及應用

    CS5361 是CRYSTAL 公司推出的192kHz 采樣率、多位( 24 位) 音頻

    標簽: 5361 CS 24位 AD轉換器

    上傳時間: 2013-11-07

    上傳用戶:xauthu

  • 自制數字電橋(LCR表)

    自制數字電橋(LCR表).(附電路圖)

    標簽: LCR 數字電橋

    上傳時間: 2014-12-23

    上傳用戶:lilei900512

  • 簡易數字電壓表的設計

    簡易數字電壓表的設計

    標簽: 數字電壓表

    上傳時間: 2013-12-19

    上傳用戶:515414293

  • 16位高速模數轉換模塊的設計及其動態性能測試

    本文結合研究所科研項目需要,基于16 位高速ADC 芯片LTC2204,設計了一種滿足課題要求的高速度高性能的16 位模數轉換板卡方案。該方案中的輸入電路和時鐘電路采用差分結構,輸出電路采用鎖存器隔離結構,電源電路采用了較好的去耦措施,并且注重了板卡接地設計,使其具有抗噪聲干擾能力強、動態性能好、易實現的特點。

    標簽: 模數轉換 模塊 動態 性能測試

    上傳時間: 2013-11-10

    上傳用戶:cc1

  • 數字式液位測量儀設計

    本文設計數字式液位測量儀,采用雙差壓法對液位進行測量,有效地克服了液體密度變化對液位測量結果的影響,提高液位測量的精度。本設計的液位測量儀還能直接顯示液位高度的厘米數。關鍵詞:雙差壓法 液位測量儀 普通差壓法測量液位, 精度無法保證。本文提出雙差壓法的改進方案,以克服液體密度變化對液位測量結果的影響,提高液位測量的精度。 雙差壓法液位測量原理普通差壓法測量液位的原理:只有在液體密度ρ恒定不變的條件下,差壓△ P 才與液位高度H 呈線性正比關系,才可通過測量差壓△P 間接地獲取液位H 值。但液體密度ρ是液體組份和溫度的多元函數。當液體組份和溫度變化導致密度ρ改變時,即使液位高度H 沒有變化,也將使差壓信號△ P 改變,此時若還按原先的液體密度ρ從差壓信號△ P 計算出液位H,顯然將導致測量誤差, 嚴重時會造成操作人員的錯誤判斷。為此,本文提出采用兩個差壓傳感器,如圖1。其中差壓傳感器1 用于測量未知液位高度H 產生的差壓,即密閉容器底部和液面上方的壓力差:

    標簽: 數字式 液位 測量儀

    上傳時間: 2013-11-21

    上傳用戶:源碼3

  • 放大器及數據轉換器選擇指南

    德州儀器(TI)通過多種不同的處理工藝提供了寬范圍的運算放大器產品,其類型包括了高精度、微功耗、低電壓、高電壓、高速以及軌至軌。TI還開發了業界最大的低功耗及低電壓運算放大器產品選集,其設計特性可滿足寬范圍的多種應用。為使您的選擇流程更為輕松,我們提供了一個交互式的在線運算放大器參數搜索引擎——amplifier.ti.com/search,可供您鏈接至各種不同規格的運算放大器。設計考慮因素為某項應用選擇最佳的運算放大器所要考慮的因素涉及到多個相關聯的需求。為此,設計人員必須經常權衡彼此矛盾的尺寸、成本、性能等指標因素。即使是資歷最老的工程師也可能會為此而苦惱,但您大可不必如此。緊記以下的幾點,您將會發現選擇范圍將很快的縮小至可掌控的少數幾個。電源電壓(VS)——選擇表中包括了低電壓(最小值低于2.7V)及寬電壓范圍(最小值高于5V)的部分。其余運放的選擇類型(例如精密),可通過快速查驗供電范圍欄來適當選擇。當采用單電源供電時,應用可能需要具有軌至軌(rail-to-rail)性能,并考慮精度相關的參數。精度——主要與輸入偏移電壓(VOS)相關,并分別考慮隨溫度漂移、電源抑制比(PSRR)以及共模抑制比(CMRR)的變化。精密(precision)一般用于描述具有低輸入偏置電壓及低輸入偏置電壓溫度漂移的運算放大器。微小信號需要高精度的運算放大器,例如熱電偶及其它低電平的傳感器。高增益或多級電路則有可能需求低偏置電壓。

    標簽: 放大器 數據轉換器 選擇指南

    上傳時間: 2013-11-25

    上傳用戶:1966649934

  • 基于選擇進位32位加法器的硬件電路實現

    為了縮短加法電路運行時間,提高FPGA運行效率,利用選擇進位算法和差額分組算法用硬件電路實現32位加法器,差額分組中的加法單元是利用一種改進的超前進位算法實現,選擇進位算法可使不同的分組單元并行運算,利用低位的運算結果選擇高位的進位為1或者進位為零的運算結果,節省了進位選擇等待的時間,最后利用XILINX進行時序仿真,在FPGA上進行驗證,可穩定運行在高達50兆的頻率,理論分析與計算機仿真表明該算法切實可行、有效并且易于實現。

    標簽: 進位 加法器 硬件 電路實現

    上傳時間: 2013-12-19

    上傳用戶:jshailingzzh

  • 8位加法器和減法器設計實習報告

    8位加法器和減法器設計實習報告

    標簽: 8位 加法器 減法器 實習報告

    上傳時間: 2013-10-22

    上傳用戶:sjyy1001

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