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圖像傳感器

  • 安達(dá)VCD-1000無(wú)感矢量變頻器使用說明書

    安達(dá)VCD-1000無(wú)感矢量變頻器使用說明書,需要的可以拿去

    標(biāo)簽: 變頻器

    上傳時(shí)間: 2015-06-21

    上傳用戶:利劍如風(fēng)

  • 變壓器漏感對(duì)整流電路的影響-6頁(yè).pdf

    電感器設(shè)計(jì)工具集-27冊(cè)-46.0M 變壓器漏感對(duì)整流電路的影響-6頁(yè).pdf

    標(biāo)簽: 變壓器 漏感 整流電路

    上傳時(shí)間: 2013-07-23

    上傳用戶:米卡

  • 隔離升壓全橋DCDC變換器拓?fù)淅碚摵涂刂萍夹g(shù)研究.rar

    隔離升壓DC-DC變換器在電動(dòng)汽車、儲(chǔ)能系統(tǒng)、可再生能源發(fā)電以及超導(dǎo)儲(chǔ)能系統(tǒng)等領(lǐng)域有廣闊的應(yīng)用前景。本文以隔離升壓全橋變換器(Isolated Boost Full Bridge Converter,簡(jiǎn)稱IBFBC)為研究對(duì)象,針對(duì)隔離升壓型變換器的拓?fù)浣Y(jié)構(gòu)、起動(dòng)問題、隔離變壓器漏感問題、軟開關(guān)問題和輸入電感磁復(fù)位問題等進(jìn)行了系統(tǒng)深入的研究,解決了這一類拓?fù)渌灿屑夹g(shù)問題。 提出了隔離升壓DC-DC變換器拓?fù)渥澹治霰容^了各種拓?fù)涞奶攸c(diǎn),確定了以IBFBC為研究對(duì)象。對(duì)IBFBC進(jìn)行了詳細(xì)的穩(wěn)態(tài)分析和小信號(hào)建模分析,為其分析、設(shè)計(jì)和搭建實(shí)驗(yàn)平臺(tái)提供了電路理論基礎(chǔ)。 理論上分析了IBFBC起動(dòng)時(shí)存在電流沖擊的原因。提出了二種數(shù)字化軟起動(dòng)方案,該方案對(duì)主電路進(jìn)行了改造,利用DSP能靈活產(chǎn)生PWM波的特點(diǎn)采用了新的控制策略,成功實(shí)現(xiàn)了該系統(tǒng)的軟起動(dòng)。 理論上分析了IBFBC隔離變壓器漏感引起功率開關(guān)管關(guān)斷電壓尖峰的原因,采用了有源箝位的方法,有效的解決電壓尖峰問題。提出了帶有源箝位IBFBC的九種PWM控制策略,提出了一種控制型軟PWM方法,在不增加主電路元器件的基礎(chǔ)上,通過控制PWM的發(fā)生方法,實(shí)現(xiàn)了有源箝位功率開關(guān)管和橋臂功率開關(guān)管的零電壓開通。 從理論上分析了IBFBC輸入電感磁復(fù)位問題。在正常停機(jī)時(shí)提出了一種數(shù)字化軟停止的方法,控制變換器由Boost工作狀態(tài)逐漸過渡到Buck工作狀態(tài),讓輸入電感存儲(chǔ)的能量逐漸釋放掉,最后停止工作。對(duì)于故障保護(hù)停機(jī),采用了繞組磁復(fù)位的方法,把輸入電感設(shè)計(jì)成反激式變換器形式,突然停機(jī)時(shí),電感中存儲(chǔ)的能量通過反激式繞組釋放到輸出端,這樣保護(hù)了變換器不會(huì)損壞。 給出了主電路關(guān)鍵器件參數(shù)的設(shè)計(jì)方法,設(shè)計(jì)了以DSP-TMS320F2407為核心的數(shù)字控制單元,編寫了DSP控制程序和CPLD邏輯處理程序。研制了一臺(tái)輸出功率5KW,輸入電壓直流24V,輸出電壓直流300V的IBFBC,通過全面的性能實(shí)驗(yàn)驗(yàn)證了理論分析和仿真結(jié)果。 本文立足于IBFBC的關(guān)鍵技術(shù)要求,并充分考慮工程應(yīng)用中的實(shí)際因素,進(jìn)行了理論分析和實(shí)驗(yàn)研究,為實(shí)際系統(tǒng)方案設(shè)計(jì)提供理論依據(jù),并已經(jīng)在實(shí)際應(yīng)用中得到驗(yàn)證。

    標(biāo)簽: DCDC 隔離 升壓

    上傳時(shí)間: 2013-04-24

    上傳用戶:lifevast

  • LLC諧振DCDC變換器的研究.rar

    隨著信息技術(shù)的發(fā)展,通信和計(jì)算機(jī)等領(lǐng)域的DC/DC電源變換技術(shù)在電源行業(yè)占有很重要的市場(chǎng)。為了能滿足電源系統(tǒng)良好的性能和可靠性,分布電源系統(tǒng)(DPS)被廣泛應(yīng)用于電信、計(jì)算機(jī)等領(lǐng)域。DPS具有模塊化,可靠性和維護(hù)性等優(yōu)點(diǎn)。 本文討論了軟開關(guān)技術(shù)的種類和發(fā)展趨勢(shì),介紹了三種傳統(tǒng)的軟開關(guān)諧振變換器,通過理論分析和仿真,總結(jié)了三種傳統(tǒng)諧振變換器的優(yōu)缺點(diǎn)。在此基礎(chǔ)上,設(shè)計(jì)了一種新型的LLC串聯(lián)諧振變換器。此變換器可實(shí)現(xiàn)原邊開關(guān)管在零電壓條件下開通、輸出端的整流管零電流條件下關(guān)斷,因而可實(shí)現(xiàn)極高的轉(zhuǎn)換效率。由于電路充分地利用了變壓器的勵(lì)磁電感和開關(guān)管的寄生參數(shù),可使變換器在寬輸入電壓范圍和全負(fù)載下實(shí)現(xiàn)軟開關(guān)。此外,利用變壓器漏感和功率MOS管的寄生電容進(jìn)行諧振,可有效地降低輸出整流管的電壓應(yīng)力,提高抗EMI的性能。因此,在相同的設(shè)計(jì)規(guī)格下,LLC諧振變換器可以選取電壓和電流等較低的功率開關(guān)管和整流二極管,進(jìn)而減小開發(fā)成本。 結(jié)合PSPICE仿真和實(shí)驗(yàn)調(diào)試,論文詳細(xì)介紹了LLC串聯(lián)諧振變換器工作原理,詳細(xì)討論了諧振參數(shù)、輸入電壓和負(fù)載對(duì)變換器性能的影響;根據(jù)參數(shù)設(shè)計(jì)步驟和特性分析,設(shè)計(jì)了LLC串聯(lián)諧振變換器各組成電路;最后設(shè)計(jì)了24V/8A-200KHz的DC/DC電源模塊,通過實(shí)驗(yàn),其結(jié)果驗(yàn)證了該拓?fù)湓谌?fù)載下均能實(shí)現(xiàn)軟開關(guān),效率高等良好特性。

    標(biāo)簽: DCDC LLC 諧振

    上傳時(shí)間: 2013-05-20

    上傳用戶:dialouch

  • LCC諧振變換器在大功率高輸出電壓場(chǎng)合的應(yīng)用研究.rar

    高壓直流電源廣泛應(yīng)用于醫(yī)用X射線機(jī),工業(yè)靜電除塵器等設(shè)備。傳統(tǒng)的工頻高壓直流電源體積大、重量重、變換效率低、動(dòng)態(tài)性能差,這些缺點(diǎn)限制了它的進(jìn)一步應(yīng)用。而高頻高壓直流電源克服了前者的缺點(diǎn),已成為高壓大功率電源的發(fā)展趨勢(shì)。本文對(duì)應(yīng)用在高輸出電壓大功率場(chǎng)合的開關(guān)電源進(jìn)行研究,對(duì)主電路拓?fù)洹⒖刂撇呗浴⒐に嚱Y(jié)構(gòu)等方面做出詳細(xì)討論,提出實(shí)現(xiàn)方案。 高壓變壓器由于匝比很大,呈現(xiàn)出較大的寄生參數(shù),如漏感和分布電容,若直接應(yīng)用在PWM變換器中,漏感的存在會(huì)產(chǎn)生較高的電壓尖峰,損壞功率器件,分布電容的存在會(huì)使變換器有較大的環(huán)流,降低了變換器的效率。本文選用具有電容型濾波器的LCC諧振變換器為主電路拓?fù)洌梢岳酶邏鹤儔浩髦新└泻头植茧娙葑鳛橹C振元件,減少了元件的數(shù)量,從而減小了變換器的體積。 LCC諧振變換器采用變頻控制策略,可以工作在電感電流連續(xù)模式(CCM)和電感電流斷續(xù)模式(DCM),本文對(duì)這兩種工作模式進(jìn)行詳細(xì)討論。針對(duì)CCM下的LCC諧振變換器,本文分析其工作原理,用基波近似法推導(dǎo)出變換器的穩(wěn)態(tài)模型,給出一種詳盡的設(shè)計(jì)方法,可以保證所有開關(guān)管在全負(fù)載范圍內(nèi)實(shí)現(xiàn)零電壓開關(guān),減小電流應(yīng)力和開關(guān)頻率的變化范圍,并進(jìn)行仿真驗(yàn)證。基于該變換器,研制出輸出電壓為41kV,功率為23kW的高頻高壓電源,實(shí)驗(yàn)結(jié)果驗(yàn)證了分析與設(shè)計(jì)的正確性。 針對(duì)DCM下的LCC諧振變換器,本文分析其工作原理,該變換器可以實(shí)現(xiàn)零電流開關(guān),有效地減小IGBT拖尾電流造成的關(guān)斷損耗。論文通過電路狀態(tài)方程推導(dǎo)出變換器的電壓傳輸比特性,在此基礎(chǔ)上對(duì)主電路參數(shù)進(jìn)行設(shè)計(jì),并進(jìn)行仿真驗(yàn)證。基于該變換器,研制出輸出電壓為66kV,功率為72kW的高頻高壓電源,實(shí)驗(yàn)結(jié)果表明了方案的可行性。

    標(biāo)簽: LCC 諧振變換器 大功率

    上傳時(shí)間: 2013-04-24

    上傳用戶:edrtbme

  • 基于FPGA的通用異步收發(fā)器的設(shè)計(jì).rar

    通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時(shí)支持短距離和長(zhǎng)距離數(shù)據(jù)傳輸?shù)拇型ㄐ沤涌冢粡V泛應(yīng)用于微機(jī)和外設(shè)之間的數(shù)據(jù)交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點(diǎn)是數(shù)據(jù)傳輸速率比較慢,難以滿足高速率數(shù)據(jù)傳輸?shù)膱?chǎng)合,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來實(shí)現(xiàn)PC機(jī)和FPGA芯片之間的通信,勢(shì)必會(huì)增加接口連線的復(fù)雜程度以及降低整個(gè)系統(tǒng)的穩(wěn)定性和有效性。 本課題就是針對(duì)UART的特點(diǎn)以及FPGA設(shè)計(jì)具有可移植性的優(yōu)勢(shì),提出了一種基于FPGA芯片的嵌入式UART設(shè)計(jì)方法,其中主要包括狀態(tài)機(jī)的描述形式以及自頂向下的設(shè)計(jì)方法,利用硬件描述語(yǔ)言來編制UART的各個(gè)子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內(nèi)部,這樣不僅能解決傳統(tǒng)UART芯片的缺點(diǎn)而且同時(shí)也使整個(gè)系統(tǒng)變得更加具有緊湊性以及可靠性。 本課題所設(shè)計(jì)的LIART支持標(biāo)準(zhǔn)的RS-232C傳輸協(xié)議,主要設(shè)計(jì)有發(fā)送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個(gè)獨(dú)立的數(shù)據(jù)緩沖區(qū)FIFO模塊。該模塊具有可變的波特率、數(shù)據(jù)幀長(zhǎng)度以及奇偶校驗(yàn)方式,還有多種中斷源、中斷優(yōu)先級(jí)、較強(qiáng)的抗干擾數(shù)據(jù)接收能力以及芯片內(nèi)部自診斷的能力,模塊內(nèi)分開的接收和發(fā)送數(shù)據(jù)緩沖寄存器能實(shí)現(xiàn)全雙工通信。除此之外最重要的是利用IP模塊復(fù)用技術(shù)設(shè)計(jì)數(shù)據(jù)緩沖區(qū)FIFO,采用兩種可選擇的數(shù)據(jù)緩沖模式。這樣既可以應(yīng)用于高速的數(shù)據(jù)傳輸環(huán)境,也能適合低速的數(shù)據(jù)傳輸場(chǎng)合,因此可以達(dá)到資源利用的最大化。 在具體的設(shè)計(jì)過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發(fā)環(huán)境中對(duì)各個(gè)功能模塊進(jìn)行綜合優(yōu)化、仿真驗(yàn)證以及下載實(shí)現(xiàn)。各項(xiàng)數(shù)據(jù)結(jié)果表明,本課題中所設(shè)計(jì)的UART滿足預(yù)期設(shè)計(jì)目標(biāo)。

    標(biāo)簽: FPGA 異步收發(fā)器

    上傳時(shí)間: 2013-08-02

    上傳用戶:rocketrevenge

  • MPEG2視頻解碼器的FPGA設(shè)計(jì).rar

    MPEG-2是MPEG組織在1994年為了高級(jí)工業(yè)標(biāo)準(zhǔn)的圖象質(zhì)量以及更高的傳輸率所提出的視頻編碼標(biāo)準(zhǔn),其優(yōu)秀性使之成為過去十年應(yīng)用最為廣泛的標(biāo)準(zhǔn),也是未來十年影響力最為廣泛的標(biāo)準(zhǔn)之一。 本文以MPEG-2視頻標(biāo)準(zhǔn)為研究?jī)?nèi)容,建立系統(tǒng)級(jí)設(shè)計(jì)方案,設(shè)計(jì)FPGA原型芯片,并在FPGA系統(tǒng)中驗(yàn)證視頻解碼芯片的功能。最后在0.18微米工藝下實(shí)現(xiàn)ASIC的前端設(shè)計(jì)。完成的主要工作包括以下幾個(gè)方面: 1.完成解碼系統(tǒng)的體系結(jié)構(gòu)的設(shè)計(jì),采用了自頂而下的設(shè)計(jì)方法,實(shí)現(xiàn)系統(tǒng)的功能單元的劃分;根據(jù)其視頻解碼的特點(diǎn),確定解碼器的控制方式;把視頻數(shù)據(jù)分文幀內(nèi)數(shù)據(jù)和幀間數(shù)據(jù),實(shí)現(xiàn)兩種數(shù)據(jù)的并行解碼。 2.實(shí)現(xiàn)了具體模塊的設(shè)計(jì):根據(jù)本文研究的要求,在比特流格式器模塊設(shè)計(jì)中提出了特有的解碼方式;在可變長(zhǎng)模塊中的變長(zhǎng)數(shù)據(jù)解碼采用組合邏輯外加查找表的方式實(shí)現(xiàn),大大減少了變長(zhǎng)數(shù)據(jù)解碼的時(shí)間;IQ、IDCT模塊采用流水的設(shè)計(jì)方法,減少數(shù)據(jù)計(jì)算的時(shí)間:運(yùn)動(dòng)補(bǔ)償模塊,針對(duì)模塊數(shù)據(jù)運(yùn)算量大和訪問幀存儲(chǔ)器頻繁的特點(diǎn),采用四個(gè)插值單元同時(shí)處理,增加像素緩沖器,充分利用并行性結(jié)構(gòu)等方法來加快運(yùn)動(dòng)補(bǔ)償速度。 3.根據(jù)視頻解碼的參考軟件,通過解碼系統(tǒng)的仿真結(jié)果和軟件結(jié)果的比較來驗(yàn)證模塊的功能正確性。最后用FPGA開發(fā)板實(shí)現(xiàn)了解碼系統(tǒng)的原型芯片驗(yàn)證,取得了良好的解碼效果。 整個(gè)設(shè)計(jì)采用Verilog HDL語(yǔ)言描述,通過了現(xiàn)場(chǎng)可編程門陣列(FPGA)的原型驗(yàn)證,并采用SIMC0.18μm工藝單元庫(kù)完成了該電路的邏輯綜合。經(jīng)過實(shí)際視頻碼流測(cè)試,本文設(shè)計(jì)可以達(dá)到MPEG-2視頻主類主級(jí)的實(shí)時(shí)解碼的技術(shù)要求。

    標(biāo)簽: MPEG2 FPGA 視頻解碼器

    上傳時(shí)間: 2013-07-27

    上傳用戶:ice_qi

  • 基于ARM-LINUX的嵌入式媒體播放器的研究與實(shí)現(xiàn)

    隨著科學(xué)技術(shù)的發(fā)展,人們對(duì)生活質(zhì)量的要求越來越高,在視聽享受方面,家庭影院越來越普遍,便攜式電子設(shè)備也日趨成熟。目前,人們對(duì)嵌入式媒體播放器的研究越來越廣泛了,國(guó)內(nèi)外已經(jīng)出現(xiàn)了像MP3、MP4和智能手機(jī)等眾多樣式的便攜式嵌入式媒體播放器。但由于種種環(huán)境及條件的限制,這些便攜式的媒體播放器都只能播放單一的或幾種固定的媒體格式,可擴(kuò)展性都比較差;而現(xiàn)在隨著應(yīng)用的不斷增多,越來越多的更先進(jìn)的壓縮算法被提出,導(dǎo)致了媒體格式的多樣化,在這種情況下,必然要求嵌入式媒體播放器要適應(yīng)多種格式。為此,通過對(duì)各種PC機(jī)上的播放器設(shè)計(jì)架構(gòu)的研究與借鑒,在本文中主要在軟件方面為嵌入式媒體播放器設(shè)計(jì)了一種可擴(kuò)展性架構(gòu),并設(shè)計(jì)了播放器界面,實(shí)現(xiàn)了一些播放器的功能。 另外,在本文還介紹了一種基于嵌入式技術(shù)的多媒體播放器的系統(tǒng)設(shè)計(jì)方案。該系統(tǒng)主要是通過在嵌入式芯片上加載操作系統(tǒng),同時(shí)擴(kuò)充必要的接口,在操作系統(tǒng)的支持下,開發(fā)多媒體播放器。 在本文的整個(gè)系統(tǒng)設(shè)計(jì)過程中,采用了Intel公司的PXA270處理器芯片,外擴(kuò)展了USB接口,定制并加載了Linux操作系統(tǒng),在操作系統(tǒng)的支持下,對(duì)各個(gè)外擴(kuò)的接口進(jìn)行了驅(qū)動(dòng)程序的編寫,同時(shí)應(yīng)用QT/Embedded開發(fā)了多媒體播放器的圖形界面并實(shí)現(xiàn)了相應(yīng)的功能,最后,圖像既可顯示在LCD顯示屏上也可通過VGA接口顯示在電腦顯示屏上,聲音信號(hào)則是通過PXA270處理器的IIS總線傳給CODEC芯片,然后將其轉(zhuǎn)換為模擬信號(hào),進(jìn)而通過音箱或者耳機(jī)等設(shè)備放出。

    標(biāo)簽: ARM-LINUX 嵌入式 媒體播放器

    上傳時(shí)間: 2013-06-19

    上傳用戶:stvnash

  • 基于H.264的無(wú)線傳輸差錯(cuò)控制及解碼器的ARM實(shí)現(xiàn)

    信息化社會(huì)的到來以及IP技術(shù)的興起,正深刻的改變著電信網(wǎng)絡(luò)的面貌以及未來技術(shù)發(fā)展的走向。無(wú)線通信技術(shù)的發(fā)展為實(shí)現(xiàn)數(shù)字化社區(qū)提供了有力的保證。而視頻通信則成為多媒體業(yè)務(wù)的核心。如何在環(huán)境惡劣的無(wú)線環(huán)境中,實(shí)時(shí)傳輸高質(zhì)量的視頻面臨著巨大的挑戰(zhàn),因此這也成為人們的研究熱點(diǎn)。 對(duì)于無(wú)線移動(dòng)信道來說,網(wǎng)絡(luò)的可用帶寬是有限的。由于多徑、衰落、時(shí)延擴(kuò)展、噪聲影響和信道干擾等原因,無(wú)線移動(dòng)通信不僅具有帶寬波動(dòng)的特點(diǎn),而且信道誤碼率高,經(jīng)常會(huì)出現(xiàn)連續(xù)的、突發(fā)性的傳輸錯(cuò)誤。無(wú)線信道可用帶寬與傳輸速率的時(shí)變特性,使得傳輸?shù)目煽啃源鬄榻档汀?視頻播放具有嚴(yán)格的實(shí)時(shí)性要求,這就要求網(wǎng)絡(luò)為視頻的傳輸提供足夠的帶寬.有保障的延時(shí)和誤碼率。為了獲得可接受的重建視頻質(zhì)量,視頻傳輸至少需要28Kbps左右的帶寬。而且視頻傳輸對(duì)時(shí)延非常敏感。然而無(wú)線移動(dòng)網(wǎng)絡(luò)卻無(wú)法提供可靠的服務(wù)質(zhì)量。 基于無(wú)線視頻通信面臨的挑戰(zhàn),本文在對(duì)新一代視頻編碼國(guó)際標(biāo)準(zhǔn)H.264/AVC研究的基礎(chǔ)上,主要在提高其編碼效率和H.264的無(wú)線傳輸抗誤碼性能,以及如何在嵌入式環(huán)境下實(shí)現(xiàn)H.264解碼器進(jìn)行了研究。 結(jié)合低碼率和幀內(nèi)刷新,提出一種針對(duì)感興趣區(qū)的可變幀內(nèi)刷新方法。實(shí)驗(yàn)表明該方法可以使用較少的碼率對(duì)感興趣區(qū)域進(jìn)行更好的錯(cuò)誤控制,以提高區(qū)域圖像質(zhì)量,同時(shí)能根據(jù)感興趣區(qū)及信道的狀況自動(dòng)調(diào)整宏塊刷新數(shù)量,充分利用有限的碼率。 為了有效的平衡編碼效率和抗誤碼能力的之間的矛盾,筆者提出了一種自適應(yīng)FMO(Flexible Macroblock Order)編碼方法,可根據(jù)圖像的復(fù)雜度自適應(yīng)地選擇編碼所需的FMO模式。仿真結(jié)果表明這種FMO編碼方式完全可行,且在運(yùn)動(dòng)復(fù)雜度頻繁變化時(shí)效果更加明顯,完全可應(yīng)用在環(huán)境惡劣的無(wú)線信道中。 在對(duì)嵌入式PXA270硬件結(jié)構(gòu)和X264研究的基礎(chǔ)上,基本實(shí)現(xiàn)了基于H.264的嵌入式解碼,在PXA270基礎(chǔ)上進(jìn)行環(huán)境的配置,定制WirtCE操作系統(tǒng),并編譯、產(chǎn)生開發(fā)所用的SDK和下載內(nèi)核到目標(biāo)機(jī)。利用開發(fā)工具EVC實(shí)現(xiàn)在PC機(jī)上的實(shí)時(shí)開發(fā)和在線仿真調(diào)試,最終實(shí)現(xiàn)了對(duì)無(wú)差錯(cuò)H.264碼流實(shí)時(shí)解碼。

    標(biāo)簽: 264 ARM 無(wú)線傳輸 差錯(cuò)控制

    上傳時(shí)間: 2013-06-18

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  • 基于DSPFPGA的H264AVC實(shí)時(shí)編碼器

    H.264/AVC是ITU-T和ISO聯(lián)合推出的新標(biāo)準(zhǔn),采用了近幾年視頻編碼方面的先進(jìn)技術(shù),以較高編碼效率和網(wǎng)絡(luò)友好性成為新一代國(guó)際視頻編碼標(biāo)準(zhǔn)。 本文以實(shí)現(xiàn)D1格式的H.264/AVC實(shí)時(shí)編碼器為目標(biāo),作者負(fù)責(zé)系統(tǒng)架構(gòu)設(shè)計(jì),軟硬件劃分以及部分模塊的硬件算法設(shè)計(jì)與實(shí)現(xiàn)。通過對(duì)H.264/AVC編碼器中主要模塊的算法復(fù)雜度的評(píng)估,算法特點(diǎn)的分析,同時(shí)考慮到編碼器系統(tǒng)的可伸縮性,可擴(kuò)展性,本文采用了DSP+FPGA的系統(tǒng)架構(gòu)。DSP充當(dāng)核心處理器,而FPGA作為協(xié)處理器,針對(duì)編碼器中最復(fù)雜耗時(shí)的模塊一運(yùn)動(dòng)估計(jì)模塊,設(shè)計(jì)相應(yīng)的硬件加速引擎,以提供編碼器所需要的實(shí)時(shí)性能。 H.264/AVC仍基于以前視頻編碼標(biāo)準(zhǔn)的運(yùn)動(dòng)補(bǔ)償混合編碼方案,其中一個(gè)主要的不同在于幀間預(yù)測(cè)采用了可變塊尺寸的運(yùn)動(dòng)估計(jì),同時(shí)運(yùn)動(dòng)向量精度提高到1/4像素。更小和更多形狀的塊分割模式的采用,以及更加精確的亞像素位置的預(yù)測(cè),可以改善運(yùn)動(dòng)補(bǔ)償精度,提高圖像質(zhì)量和編碼效率,但同時(shí)也大大增加了編碼器的復(fù)雜度,因此需要設(shè)計(jì)專門的硬件加速引擎。 本文給出了1/4像素精度的運(yùn)動(dòng)估計(jì)基于FPGA的硬件算法設(shè)計(jì)與實(shí)現(xiàn),包括整像素搜索,像素插值,亞像素(1/2,1/4)搜索以及多模式選擇(支持全部七種塊分割模式)。設(shè)計(jì)中,將多處理器技術(shù)和流水線技術(shù)相結(jié)合,提供高性能的并行計(jì)算能力,同時(shí),采用合理的存儲(chǔ)器組織結(jié)構(gòu)以提供高數(shù)據(jù)吞吐量,滿足運(yùn)算的帶寬要求,并使編碼器具有較好的可伸縮性。最后,在Modelsim環(huán)境下建立測(cè)試平臺(tái),完成了對(duì)整個(gè)設(shè)計(jì)的RTL級(jí)的仿真驗(yàn)證,并針對(duì)Altera公司的FPGA芯片stratixⅡ系列的EP2S60-4器件進(jìn)行優(yōu)化,從而使工作頻率最終達(dá)到134MHz,分析數(shù)據(jù)表明該模塊能夠滿足編碼器的實(shí)時(shí)性要求。

    標(biāo)簽: DSPFPGA H264 264 AVC

    上傳時(shí)間: 2013-07-24

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