以嵌入式計算機為技術核心的嵌入式系統(tǒng)是繼網(wǎng)絡之后，又一個IT領域新的技術發(fā)展方向。由于嵌入式系統(tǒng)具有體積小、性能強、功耗低、可靠性高等特點，目前已經(jīng)廣泛的應用在國防、消費電子、信息家電、網(wǎng)絡通信、工業(yè)控制等領域。其中具有代表意義的是32位的控制器和嵌入式操作系統(tǒng)的應用。 本文是以弧焊機器人的焊縫跟蹤系統(tǒng)為例，研究了基于嵌入式實時操作系統(tǒng)μC/OS-Ⅱ和32位ARM微處理器的嵌入式系統(tǒng)的實現(xiàn)。該焊縫跟蹤應用系統(tǒng)實例實現(xiàn)的功能是使弧焊機器人能及時檢測并自動糾正當前焊接點與焊縫之間出現(xiàn)的偏差，以提高弧焊機器人的智能化水平。 論文首先介紹了32位的ARM控制器工作原理，然后介紹了嵌入式操作系統(tǒng)的工作原理以及焊縫信號的處理原理，在此基礎上設計了弧焊機器人焊縫跟蹤系統(tǒng)的硬件電路，最后完成了嵌入式操作系統(tǒng)μC/OS-Ⅱ在S3C44BOX上的移植工作，并且編寫和調試了控制軟件。基本上達到了控制要求。
標簽： ARM COS 嵌入式 系統(tǒng)研究
上傳時間： 2013-04-24
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邊界掃描技術是一種應用于數(shù)字集成電路器件的標準化可測試性設計方法，它提供了對電路板上元件的功能、互連及相互間影響進行測試的一種新方案，極大地方便了系統(tǒng)電路的測試。本文基于IEEE 1149.1標準剖析了JTAG邊界掃描測試的精髓，分析了其組成，功能與時序控制等關鍵技術。 應用在FPGA芯片中的邊界掃描電路側重于電路板級測試，兼顧芯片功能測試，同時提供JTAG下載方式。針對在FPGA芯片中的應用特點，設計了一種邊界掃描電路，應用于自行設計的FPGA結構之中。除了基本的測試功能外，加入了對FPGA芯片進行配置、回讀以及用戶自定義測試等功能。 通過仿真驗證，所設計的邊界掃描電路可實現(xiàn)FPGA芯片的測試、配置和回讀等功能，并符合IEEE 11491.1邊界掃描標準的規(guī)定，達到設計要求。
上傳時間： 2013-04-24
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在機器人學的研究領域中，如何有效地提高機器人控制系統(tǒng)的控制性能始終是研究學者十分關注的一個重要內容。在分析了工業(yè)機器人的發(fā)展歷程和機器人控制系統(tǒng)的研究現(xiàn)狀后，本論文的主要目標是針對四關節(jié)實驗室機器人特有的機械結構和數(shù)學模型，建立一個新型全數(shù)字的基于DSP和FPGA的機器人位置伺服控制系統(tǒng)的軟、硬件平臺，實現(xiàn)對四關節(jié)實驗室機器人的精確控制。 本論文從實際情況出發(fā)，首先分析了所研究的四關節(jié)實驗室機器人的本體結構，并對其抽象簡化得到了它的運動學數(shù)學模型。在明確了實現(xiàn)機器人精確位置伺服控制的控制原理后，我們對機器人控制系統(tǒng)的諸多可行性方案進行了充分論證，并最終決定采用了三級CPU控制的控制體系結構：第一級CPU為上位計算機，它實現(xiàn)對機器人的系統(tǒng)管理、協(xié)調控制以及完成機器人實時軌跡規(guī)劃等控制算法的運算；第二級CPU為高性能的DSP處理器，它輔之以具有高速并行處理能力的FPGA芯片，實現(xiàn)了對機器人多個關節(jié)的高速并行驅動；第三級CPU為交流伺服驅動處理器，它實現(xiàn)了機器人關節(jié)伺服電機的精確三閉環(huán)誤差驅動控制，以及電機的故障診斷和自動保護等功能。此外，我們采用比普通UART速度快得多的USB來實現(xiàn)上位計算機．與下位控制器之間的數(shù)據(jù)通信，這樣既保證了兩者之間連接方便，又有效的提高了控制系統(tǒng)的通信速度和可靠性。 機器人系統(tǒng)的軟件設計包括兩個部分：一是采用VC++實現(xiàn)的上位監(jiān)控軟件系統(tǒng)，它主要負責機器人實時軌跡規(guī)劃等控制算法的運算，同時完成用戶與機器人系統(tǒng)之間的信息交互；二是采用C語言實現(xiàn)的下位DSP控制程序，它主要負責接收上位監(jiān)控系統(tǒng)或者下位控制箱發(fā)送的控制信號，實現(xiàn)對機器人的實時驅動，同時還能夠實時的向上位監(jiān)控系統(tǒng)或者下位控制箱反饋機器人的當前狀態(tài)信息。 研究開發(fā)出來的四關節(jié)實驗室機器人控制器具有控制實時性好、定位精度高、運行穩(wěn)定可靠的特點，它允許用戶通過上位控制計算機實現(xiàn)對機器人的各種設定作業(yè)的控制，也可以讓用戶通過機器人控制箱現(xiàn)場對機器人進行回零、示教等各項操作。
上傳時間： 2013-04-24
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常用的實時數(shù)字信號處理的器件有可編程的數(shù)字信號處理(DSP)芯片(如AD系列、TI系列)、專用集成電路(ASIC)、現(xiàn)場可編程門陣列(FPGA)等。在工程實踐中,往往要求對信號處理要有高速性、實時性和靈活性,而已有的一些軟件和硬件實現(xiàn)方式則難以同時達到這幾方面的要求。隨著可編程邏輯器件和EDA技術的發(fā)展,使用FPGA來實現(xiàn)數(shù)字信號處理,既具有實時性,又兼顧了一定的靈活性。FPGA具有的靈活的可編程邏輯可以方便的實現(xiàn)高速數(shù)字信號處理,突破了并行處理、流水級數(shù)的限制,有效地利用了片上資源,加上反復的可編程能力,越來越受到國內外從事數(shù)字信號處理的研究者所青睞。 FIR數(shù)字濾波器以其良好的線性特性被廣泛使用,屬于數(shù)字信號處理的基本模塊之一。本論文對基于FPGA的FIR數(shù)字濾波器實現(xiàn)進行了研究,所做的主要工作如下： 1.介紹了FIR數(shù)字濾波器的基本理論和FPGA的基本概況,以及FPGA設計流程、設計指導原則和常用的設計指導思想與技巧。 2.以FIR數(shù)字濾波器的基本理論為依據(jù),使用分布式算法為濾波器的硬件實現(xiàn)算法,并對其進行了詳細的討論。針對分布式算法中查找表規(guī)模過大的缺點,采用優(yōu)化分布式算法的多塊查找表方式使得硬件規(guī)模極大的減小。 3.設計出一個192階的FIR濾波器實例。其系統(tǒng)要求為：定點16位輸入、定點12位系數(shù)、定點16位輸出,采樣率為75MHz。設計用Quartus II軟件進行仿真,并將其仿真結果與Matlab仿真結果進行對比分析。 仿真結果表明,本論文設計的濾波器硬件規(guī)模較小,采樣率達到了75MHz。同時只要將查找表進行相應的改動,就能分別實現(xiàn)低通、高通、帶通FIR濾波器,體現(xiàn)了設計的靈活性。
標簽： FPGA FIR 數(shù)字濾波器
上傳時間： 2013-06-06
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對弓網(wǎng)故障的檢測在列車提速的今天顯得尤其重要，原始故障圖像數(shù)據(jù)量的巨大使實時存儲和傳輸故障圖像極其困難。JPEG作為一種低復雜度、高壓縮比的圖像壓縮標準在多媒體、網(wǎng)絡傳輸?shù)阮I域得到廣泛的應用。和相同圖像質量的其它常用文件格式(如GIF，TIFF，PCX)相比，JPEG是目前靜態(tài)圖像中壓縮比最高的。 FPGA以其設計靈活、高速的卓越特性，逐漸成為許多應用中首先器件，尤其是與Verilog和VHDL等語言的結合，大大變革了電子系統(tǒng)的設計方法，加速了系統(tǒng)的設計進程。 本文旨在研究并實現(xiàn)一種實時采集并對特定幀進行壓縮傳輸?shù)姆椒āＭㄟ^采用可編程邏輯器件FPGA來實現(xiàn)整個采集、顯示、壓縮和傳輸，使系統(tǒng)具有可定制、高速度等優(yōu)點。 本文首先介紹了開發(fā)硬件可編程邏輯門陣列FPGA及其開發(fā)語言Veridlog，并介紹了FPGA的設計方法及開發(fā)流程；接著介紹了PAL制視頻采集的相關知識及設計，其中主要包括基于I2C總線的模擬視頻解碼控制、視頻的數(shù)字化ITU-R BT.601標準介紹及視頻同步信號的獲取、基于SDRAM的視頻幀存儲、VGA顯示控制設計；隨后介紹了JPEG標準，并根據(jù)故障檢測的特點，設計了針對灰度圖像壓縮的JPEG編碼器，設計中先分別對組成JPEG編碼器的二維DCT變換模塊、量化模塊、Z字掃描模塊、變換直流系數(shù)的差分脈沖編碼模塊、交流系數(shù)的游程編碼模塊、哈夫曼編碼模塊及打包模塊進行了仿真測試，然后再對整個JPEG編碼器進行了測試；最后設計了單幀視頻的SRAM緩存，并將緩存的源圖像采用本文設計的JPEG編碼器進行壓縮，再設計一個僅包含發(fā)送功能的UART 將壓縮后的碼流傳輸?shù)絇C機，在PC機上通過將接收的碼流以ASCⅡ碼的形式還原為采集圖片。 本文實現(xiàn)了整個采集壓縮系統(tǒng)，同時也進一步驗證了本文設計的灰度圖像JPEG編碼器的正確性。相信本文無論是對弓網(wǎng)故障的圖像檢測，還是對于JPEG編碼器的芯片設計都有一定的參考價值。
標簽： FPGA JPEG 壓縮系統(tǒng)
上傳時間： 2013-04-24
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本文介紹了單片機在鍋爐溫度控制上的應用，主要是以87C51 單片機作為控制器核心，結合溫度傳感變送器、A/D 轉換器、LED 顯示器、D/A 轉換器，模擬多路開關等，組成一個八通道的鍋爐溫度控
標簽： 單片機 中的應用 鍋爐 溫度控制系統(tǒng)
上傳時間： 2013-04-24
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簡介 探討了在PC機中用Visual Basic下的Microsoft Comm control控件與使用C51編程的MCS\ 51單片機之間的串行通信的方法,以及在VB中怎樣處理二進制碼,并給出了演示程序和通信協(xié)議。
上傳時間： 2013-04-24
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基于DSP技術的虛擬式FFT頻譜分析儀：虛擬儀器已經(jīng)成為儀器發(fā)展的一個重要方向,目前已在眾多領域獲得了廣泛應用。FFT 頻譜分析是機械工程、故障診斷等諸多領域所廣泛采用的分析方法。但傳統(tǒng)FFT
上傳時間： 2013-04-24
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現(xiàn)場可編程門陣列(FPGA)是一種現(xiàn)場可編程專用集成電路，它將門陣列的通用結構與現(xiàn)場可編程的特性結合于一體，如今，F(xiàn)PGA系列器件已成為最受歡迎的器件之一。隨著FPGA器件的廣泛應用，它在數(shù)字系統(tǒng)中的作用日益變得重要，它所要求的準確性也變得更高。因此，對FPGA器件的故障測試和故障診斷方法進行更全面的研究具有重要意義。隨著FPGA器件的迅速發(fā)展，F(xiàn)PGA的密度和復雜程度也越來越高，使大量的故障難以使用傳統(tǒng)方法進行測試，所以人們把視線轉向了可測性設計(DFT)問題。可測性設計的提出為解決測試問題開辟了新的有效途徑，而邊界掃描測試方法是其中一個重要的技術。 本文對FPGA的故障模型及其測試技術和邊界掃描測試的相關理論與方法進行了詳細的探討，給出了利用布爾矩陣理論建立的邊界掃描測試過程的數(shù)學描述和數(shù)學模型。論文中首先討論邊界掃描測試中的測試優(yōu)化問題，總結解決兩類優(yōu)化問題的現(xiàn)有算法，分別對它們的優(yōu)缺點進行了對比，進而提出對兩種現(xiàn)有算法的改進思想，并且比較了改進前后優(yōu)化算法的性能。另外，本文還對FPGA連線資源中基于邊界掃描測試技術的自適應完備診斷算法進行了深入研究。在研究過程中，本文基于自適應完備診斷的思想對原有自適應診斷算法的性能進行了分析，并將獨立測試集和測試矩陣的概念引入原有自適應診斷算法中，使改進后的優(yōu)化算法能夠簡化原算法的實現(xiàn)過程，并實現(xiàn)完備診斷的目標。最后利用測試仿真模型證明了優(yōu)化算法能夠更有效地實現(xiàn)完備診斷的目標，在緊湊性指標與測試復雜性方面比現(xiàn)在算法均有所改進，實現(xiàn)了算法的優(yōu)化。
上傳時間： 2013-06-30
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隨著我國信息化發(fā)展進程加快，信息化覆蓋面擴大，信息安全問題也就隨之增多，其影響和后果也更加廣泛和嚴重。同時，信息安全及其對經(jīng)濟發(fā)展、國家安全和社會穩(wěn)定的重大影響，正日益突出地顯現(xiàn)出來，受到越來越多的關注。在和平年代，通過對信息載體進行大規(guī)模的物理破壞，從而達到危害信息安全的目的，在一定程度上是行不通的。然而，在信息安全的角力上，破壞者從來都沒有放棄過，他們把目標對準了信息載體中的數(shù)據(jù)，由于數(shù)據(jù)的易失性，計算機數(shù)據(jù)成為信息安全中的最大隱患，同時也是破壞信息安全的一個突破口。 本文提出研制硬盤加密卡的主要目的是為了防止對計算機數(shù)據(jù)的竊取，保護硬盤中的數(shù)據(jù)。破壞者在得到硬盤后，也不能夠得到硬盤中的數(shù)據(jù)，從而達到保護信息安全的目的。加密卡提供兩個符合ATA-6標準的接口，串接在主板IDE接口和硬盤之間。存儲在硬盤上的數(shù)據(jù)，是經(jīng)過加密以后的加密數(shù)據(jù)；從硬盤上讀出的數(shù)據(jù)，必須經(jīng)過該卡的解密才可被正常使用，否則只是一堆亂碼。加密卡采用FPGA技術實現(xiàn)IDE接口和加密算法，以減小加解密帶來的速度上的影響。 論文的工作重點主要有以下幾個方面的內容：FPGA及VHDL語言的研究，ATA協(xié)議標準研究及IDE接口的FPGA實現(xiàn)。論文對ATA協(xié)議做了細致的研究，分析了硬盤接口的工作機制以及主機與硬盤之間的通信協(xié)議，并在此基礎上，重點研究了用FPGA的編程功能來實現(xiàn)一個計算機硬件底層接口協(xié)議的方法，詳細介紹了芯片的內部框圖及FPGA的軟件流程圖，提出了在實現(xiàn)過程中應注意的要點，最終用FPGA構建了一個雙向IDE硬盤通道，實現(xiàn)了兩套符合ATA-6規(guī)范的IDE接口。
上傳時間： 2013-08-02
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