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基于FPGA的超聲波測距系統(tǒng)

  • 基于FPGA的智能小車系統(tǒng)講解

    該文檔為基于FPGA的智能小車系統(tǒng)講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

    標(biāo)簽： fpga

    上傳時間： 2022-04-27

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  • 基于fpga的音樂播放器的設(shè)計.

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    標(biāo)簽： fpga 音樂播放器

    上傳時間： 2022-04-28

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  • 基于FPGA的音樂播放器設(shè)計總結(jié)

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    標(biāo)簽： fpga

    上傳時間： 2022-05-01

    上傳用戶：d1997wayne

  • 基于FPGA的ADC采集系統(tǒng)的設(shè)計

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    標(biāo)簽： fpga adc

    上傳時間： 2022-05-04

    上傳用戶：aben

  • 基于FPGA的步進電機細分驅(qū)動器

    該文檔為基于FPGA的步進電機細分驅(qū)動器總結(jié)文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

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    上傳時間： 2022-05-08

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  • Verilog編寫基于FPGA的DDS實現(xiàn)

    Verilog編寫基于FPGA的DDS實現(xiàn)。適合感興趣的學(xué)習(xí)者學(xué)習(xí)，可以提高自己的能力，大家可以多交流哈

    標(biāo)簽： verilog fpga dds

    上傳時間： 2022-05-18

    上傳用戶：zhaiyawei

  • 基于FPGA的反應(yīng)時間測試機verilog HDL實驗

    基于FPGA的反應(yīng)時間測試機verilog HDL實驗，適合感興趣的學(xué)習(xí)者學(xué)習(xí)，可以提高自己的能力，大家可以多交流哈

    標(biāo)簽： fpga verilog hdl

    上傳時間： 2022-05-20

    上傳用戶：20125101110

  • 基于FPGA的DSP算法實現(xiàn)代碼

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    標(biāo)簽： fpga dsp

    上傳時間： 2022-05-21

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  • 基于FPGA的線型CCD高速驅(qū)動采集一體化控制板設(shè)計

    基于FPGA的線型CCD高速驅(qū)動采集一控制板設(shè)計摘要：線型CCD圖像傳感器在工業(yè)檢測、圖像測量和機器視覺等方面有著廣泛的應(yīng)用。本文針對CCD測量應(yīng)用系統(tǒng)中的前端處理、驅(qū)動控制和信號采集，設(shè)計制作了一款基于FPGA的高速驅(qū)動采集 體化控制板。該控制板選用了Altera公司的Cyclone系列FPGA和TI公司的專用圖像信號處理芯片VSP5010，由FPGA對VSP5010進行配置，生成雙路CCD驅(qū)動脈沖，控制接收A/D變換后的圖像數(shù)據(jù)，并以適當(dāng)?shù)慕涌诜绞綄⒉杉瘮?shù)據(jù)送入計算機以便進行后期處理。該控制板將CCD的驅(qū)動脈沖產(chǎn)生和圖像數(shù)據(jù)采集集于一體，有效簡化了CCD測量應(yīng)用系統(tǒng)前端的外部電路設(shè)計，提高了圖像數(shù)據(jù)采集速率和質(zhì)量，并具有靈活性強，易于擴展等特點。關(guān)鍵詞：線型CCD：FPGA：AFE：驅(qū)動：數(shù)據(jù)采集

    標(biāo)簽： fpga ccd 高速驅(qū)動采集

    上傳時間： 2022-06-22

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  • 基于FPGA的CCD探測系統(tǒng)

    隨著圖像采集系統(tǒng)的廣泛應(yīng)用，人們對CCD探測系統(tǒng)的要求日益提高。傳統(tǒng)的CCD探測系統(tǒng)由于結(jié)構(gòu)復(fù)雜，造價較高，已不能滿足日益廣泛的應(yīng)用需要。本文設(shè)計了一套基于單片F(xiàn)PGA的小型化與經(jīng)濟化的CCD探測系統(tǒng)，能夠滿足空間光強的測量并實現(xiàn)光信號的識別和處理。本文研究了CCD探測系統(tǒng)的基本結(jié)構(gòu)。設(shè)計了基于單片F(xiàn)PGA的CCD探測系統(tǒng)的硬件電路原理圖，完成了硬件電路板制作與調(diào)試。系統(tǒng)FPGA選用Altera公司的低成本FPGA芯片EP2C20Q240，電路板采用雙層板設(shè)計，實現(xiàn)了CCD探測系統(tǒng)的小型化與經(jīng)濟化的目標(biāo)。利用FPGA器件實現(xiàn)了CCD驅(qū)動時序脈沖的設(shè)計、實現(xiàn)了單采樣與相關(guān)雙采樣的控制程序設(shè)計，利用FPGA的數(shù)字信號處理功能實現(xiàn)了相關(guān)雙采樣的信號處理。基于FPGA的可編程特性，在不改變外部電路的基礎(chǔ)上，通過程序的改變，對CCD驅(qū)動頻率、模數(shù)轉(zhuǎn)換器采樣時刻的選擇進行方便調(diào)節(jié)。系統(tǒng)與上位機的數(shù)據(jù)傳輸接口采用了網(wǎng)絡(luò)傳輸方案，充分發(fā)揮了網(wǎng)絡(luò)傳輸?shù)倪h距離傳輸、遠程訪問、信息共享等優(yōu)勢，系統(tǒng)采用基于FPGA的Nios IⅡ嵌入式處理器系統(tǒng)，通過對其應(yīng)用軟件的開發(fā)，實現(xiàn)了系統(tǒng)與上位機之間數(shù)據(jù)的可靠性傳輸。

    標(biāo)簽： fpga ccd

    上傳時間： 2022-06-23

    上傳用戶：xsr1983

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