為了研制高性能的全數(shù)字永磁同步電機驅(qū)動系統(tǒng)，本文提出了一種基于FPGA的單芯片驅(qū)動控制方案。它采用硬件模塊化的現(xiàn)代EDA設(shè)計方法，使用VHDL硬件描述語言，實現(xiàn)了永磁同步電機矢量控制系統(tǒng)的設(shè)計。方案包括矢量變換、空間矢量脈寬調(diào)制(SVPWM)、電流環(huán)、速度環(huán)以及串行通訊等五部分。經(jīng)過仿真和實驗表明，系統(tǒng)具有良好的穩(wěn)定性和動態(tài)性能，調(diào)節(jié)轉(zhuǎn)速的范圍可以達到0.5r/min~4200r/min，對干擾誤差信號具有較強的容錯性，能夠滿足高性能的運動控制領(lǐng)域?qū)τ来磐诫姍C驅(qū)動系統(tǒng)的要求。
上傳時間： 2013-10-13
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設(shè)計了一個基于FPGA的單精度浮點數(shù)乘法器.設(shè)計中采用改進的帶偏移量的冗余Booth3算法和跳躍式Wallace樹型結(jié)構(gòu),并提出對Wallace樹產(chǎn)生的2個偽和采用部分相加的方式,提高了乘法器的運算速度;加入對特殊值的處理模塊,完善了乘法器的功能.本設(shè)計在Altera DE2開發(fā)板上進行了驗證.
標簽： FPGA 精度 浮點數(shù) 乘法器設(shè)計
上傳時間： 2013-10-09
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文中提出了一種基于FPGA的八通道超聲探傷系統(tǒng)設(shè)計方案。該系統(tǒng)利用低功耗可變增益運放和八通道ADC構(gòu)成高集成度的前端放大和數(shù)據(jù)采集模塊；采用FPGA和ARM作為數(shù)字信號處理的核心和人機交互的通道。為了滿足探傷系統(tǒng)實時、高速的要求，我們采用了硬件報警，缺陷回波峰值包絡(luò)存儲等關(guān)鍵技術(shù)。此外，該系統(tǒng)在小型化和數(shù)字化方面有顯著提高，為便攜式多通道超聲檢測系統(tǒng)設(shè)計奠定基礎(chǔ)
標簽： FPGA 八通道 超聲探傷 系統(tǒng)設(shè)計
上傳時間： 2013-10-13
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用vhdl語言編寫的基于fpga的波形發(fā)生器，使用了quartusII程序。可以在1602液晶顯示器上顯示目前的波形種類。產(chǎn)生的波形分別是正弦波，三角波，鋸齒波和方波。
上傳時間： 2015-12-17
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實現(xiàn)了基于FPGA的DDS信號源設(shè)計，能同時兩路輸出，輸出波形包括正弦波、三角波、方波和鋸齒波，且其頻率和相位均可調(diào)，還能計算兩路輸出信號的相位差。
上傳時間： 2022-04-21
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廣東工業(yè)大學(xué)碩士學(xué)位論文 (工學(xué)碩士) 基于FPGA的PCIE數(shù)據(jù)采集卡設(shè)計數(shù)據(jù)采集處理技術(shù)與傳感器技術(shù)、信號處理技術(shù)和PC機技術(shù)共同構(gòu)成檢測 技術(shù)的基礎(chǔ)，其中數(shù)據(jù)采集處理技術(shù)作為實現(xiàn)自動化檢測的前提，在整個數(shù)字化 系統(tǒng)中處于尤為重要的地位。對于核磁共振這樣復(fù)雜的系統(tǒng)設(shè)備，實現(xiàn)自動化測 試顯得尤為必要，又因為核磁共振成像系統(tǒng)的特殊性，對數(shù)據(jù)的采集有特殊要求， 需要根據(jù)各種脈沖序列的不同要求設(shè)置采樣點數(shù)和采樣間隔，根據(jù)待采信號的不 同帶寬來設(shè)置采樣率，將系統(tǒng)成像的數(shù)據(jù)采集下來進行處理，最后重建圖像和顯 示。因此本文基于現(xiàn)有的采集技術(shù)開發(fā)專門應(yīng)用于核磁共振成像的數(shù)據(jù)采集卡。 該采集卡從軟件與硬件兩個方面對基于FPGA的PCIE數(shù)據(jù)采集卡進行了研 究，并完成了實物設(shè)計。軟件方面以FPGA為核心芯片完成數(shù)據(jù)采集卡的接口控 制以及數(shù)據(jù)處理。通過Altera的GXB IP核對數(shù)據(jù)進行捕捉，同時根據(jù)實際需要 設(shè)計了傳輸協(xié)議，由數(shù)據(jù)處理模塊將捕捉到的數(shù)據(jù)通過CIC濾波器進行抽取濾 波，然后將信號存入DDR2 SDRAM存儲芯片中。在傳輸接口設(shè)計上采用PCIE 總線接口的數(shù)據(jù)傳輸模式，并利用FPGA的IP核資源完成接口的邏輯控制。 硬件部分分為FPGA外圍配置電路、DDR2接口電路、PCIE接口電路等模 塊。該采集卡硬件系統(tǒng)由Flash對FPGA進行初始化，通過FPGA配置PCIE總 線，根據(jù)FPGA中PCIE通道引腳的要求進行布局布線。DDR2接口電路模塊依 據(jù)DDR2芯片驅(qū)動和接收端的電平標準、端接方式確定DDR2與FPGA之間通 信的各信號走線。針對各個模塊接口電路的特點分別進行眼圖測試，分析了板卡 的通信質(zhì)量，對整個原理圖布局進行了設(shè)計優(yōu)化。 通過測試，該數(shù)據(jù)采集卡實現(xiàn)了通過CPLD對FPGA進行加載，并在FPGA 內(nèi)部實現(xiàn)了抽取濾波等高速數(shù)字信號處理，各種接IsI和控制邏輯以及通過大容量 的DDR2 SDRAM緩存各種數(shù)據(jù)處理結(jié)果正確。經(jīng)系統(tǒng)成像，該采集卡采集下來 的數(shù)字信息可通過圖像重建準確成像，為核磁共振成像系統(tǒng)的工程實現(xiàn)打下了良 好的成像基礎(chǔ)。
上傳時間： 2022-06-21
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隨著汽車工業(yè)的迅速發(fā)展，關(guān)于汽車的研究也就越來越受人關(guān)注。本設(shè)計就是在這樣的背景下提出的，指導(dǎo)教師已經(jīng)有充分的準備。本題目是結(jié)合科研項目而確定的設(shè)計類課題。設(shè)計的智能電動小車應(yīng)該能夠?qū)崟r顯示時間、速度、里程，具有自動尋跡、尋光、避障功能，可程控行駛速度、準確定位停車。根據(jù)題目的要求，確定如下方案：在現(xiàn)有玩具電動車的基礎(chǔ)上，加裝光電、紅外線、超聲波傳感器及金屬探測器，實現(xiàn)對電動車的速度、位置、運行狀況的實時測量，并將測量數(shù)據(jù)傳送至單片機進行處理，然后由單片機根據(jù)所檢測的各種數(shù)據(jù)實現(xiàn)對電動車的智能控制。這種方案能實現(xiàn)對電動車的運動狀態(tài)進行實時控制，控制靈活、可靠，精度高，可滿足對系統(tǒng)的各項要求。本設(shè)計采用MCS-51系列中的80C51單片機。以80C51為控制核心，利用超聲波傳感器檢測道路上的障礙，控制電動小汽車的自動避障，快慢速行駛，以及自動停車，并可以自動記錄時間、里程和速度，自動尋跡和尋光功能。80C51是一款八位單片機，它的易用性和多功能性受到了廣大使用者的好評。下面就簡要的介紹一下單片機及其典型應(yīng)用方式：
標簽： 單片機 電動智能超聲波避障小車
上傳時間： 2022-06-29
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基于FPGA的系統(tǒng)設(shè)計和應(yīng)用研究
標簽： FPGA 系統(tǒng)設(shè)計 應(yīng)用研究
上傳時間： 2013-04-15
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基于FPGA的8051SOC設(shè)計
上傳時間： 2013-04-15
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專輯類----可編程邏輯器件相關(guān)專輯 基于FPGA的系統(tǒng)設(shè)計和應(yīng)用研究-72頁-3.1M.rar
上傳時間： 2013-04-24
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