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增強(qiáng)(qiáng)現(xiàn)(xiàn)實(shí)(shí)

  • 華為軟件變成規(guī)范及實(shí)例,很不錯的教程. 有需要的請下載哦

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    標(biāo)簽: 教程

    上傳時間: 2013-12-19

    上傳用戶:稀世之寶039

  • 使用C#開發(fā)的酒店管理系統(tǒng) 對房間的增刪改操作

    使用C#開發(fā)的酒店管理系統(tǒng) 對房間的增刪改操作

    標(biāo)簽: 管理系統(tǒng) 房間 操作

    上傳時間: 2013-12-22

    上傳用戶:s363994250

  • 於嵌入式系統(tǒng)中實(shí)作無線網(wǎng)路之

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    標(biāo)簽: programming

    上傳時間: 2015-03-04

    上傳用戶:1547591994

  • springMVC增刪改查實(shí)例

    學(xué)院管理模塊增刪改查,基于springMVC設(shè)計(jì)模式。。。。。。。。

    標(biāo)簽: springMVC

    上傳時間: 2016-06-03

    上傳用戶:hhhh

  • 增塑劑鄰苯二甲酸二丁酯的綠色合成

    增塑劑鄰苯二甲酸二丁酯的綠色合成

    標(biāo)簽: 合成

    上傳時間: 2016-07-27

    上傳用戶:波瀾不驚吧

  • ESD Protection in CMOS ICs

    在互補(bǔ)式金氧半(CMOS)積體電路中,隨著量產(chǎn)製程的演進(jìn),元件的尺寸已縮減到深次微 米(deep-submicron)階段,以增進(jìn)積體電路(IC)的性能及運(yùn)算速度,以及降低每顆晶片的製造 成本。但隨著元件尺寸的縮減,卻出現(xiàn)一些可靠度的問題。 在次微米技術(shù)中,為了克服所謂熱載子(Hot-Carrier)問題而發(fā)展出 LDD(Lightly-Doped Drain) 製程與結(jié)構(gòu); 為了降低 CMOS 元件汲極(drain)與源極(source)的寄生電阻(sheet resistance) Rs 與 Rd,而發(fā)展出 Silicide 製程; 為了降低 CMOS 元件閘級的寄生電阻 Rg,而發(fā)展出 Polycide 製 程 ; 在更進(jìn)步的製程中把 Silicide 與 Polycide 一起製造,而發(fā)展出所謂 Salicide 製程

    標(biāo)簽: Protection CMOS ESD ICs in

    上傳時間: 2020-06-05

    上傳用戶:shancjb

  • ESD_Technology

    在互補(bǔ)式金氧半(CMOS)積體電路中,隨著量產(chǎn)製程 的演進(jìn),元件的尺寸已縮減到深次微米(deep-submicron)階 段,以增進(jìn)積體電路(IC)的性能及運(yùn)算速度,以及降低每 顆晶片的製造成本。但隨著元件尺寸的縮減,卻出現(xiàn)一些 可靠度的問題。

    標(biāo)簽: ESD_Technology

    上傳時間: 2020-06-05

    上傳用戶:shancjb

  • 增程式電動車 動力系統(tǒng)結(jié)構(gòu)調(diào)研

    增程式電動車 動力系統(tǒng)結(jié)構(gòu)調(diào)研

    標(biāo)簽: 增程式電動車

    上傳時間: 2022-02-17

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  • cadence-allegro16.6高級教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist,進(jìn)而認(rèn)識新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點(diǎn)的分析,透過本章學(xué)習(xí)可以對 Allegro 和 Capture 之間的互動關(guān)係,同時也能體驗(yàn)出 Allegro 和 Capture 同步變更屬性等強(qiáng)大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動作只是針對由 Capture(線路圖部分)產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(Layout部分)1. 在 OrCAD Capture 中設(shè)計(jì)好線路圖。2. 然後由 OrCAD Capture 產(chǎn)生 Netlist(annotate 是在進(jìn)行線路圖根據(jù)第五步產(chǎn)生的資料進(jìn)行編改)。 3. 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(layout 工作系統(tǒng))。 4. 在 Allegro 中進(jìn)行 PCB 的 layout。 5. 把在 Allegro 中產(chǎn)生的 back annotate(Logic)轉(zhuǎn)出(在實(shí)際 layout 時可能對原有的 Netlist 有改動過),並轉(zhuǎn)入 OrCAD Capture 裏進(jìn)行回編。

    標(biāo)簽: cadence allegro

    上傳時間: 2022-04-28

    上傳用戶:kingwide

  • 【網(wǎng)盤】100多個電子專業(yè)畢業(yè)設(shè)計(jì)及產(chǎn)品設(shè)計(jì)資料 增送protel 99se軟件

    【網(wǎng)盤】100多個電子專業(yè)畢業(yè)設(shè)計(jì)及產(chǎn)品設(shè)計(jì)資料 增送protel 99se軟件,百度網(wǎng)盤技術(shù)資料,打開連接后保存到自己的百度網(wǎng)盤,然后在網(wǎng)盤客戶端下下載。

    標(biāo)簽: 畢業(yè)設(shè)計(jì)

    上傳時間: 2022-05-06

    上傳用戶:d1997wayne

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