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多路搶答器

AVR單片機內部AD變換 AVR內部ADC轉換原理： AVR單片機內部的ADC轉換為10位逐次逼近型ADC。ADC與一個8通道的模擬多路復用器連接

AVR單片機內部AD變換 AVR內部ADC轉換原理： AVR單片機內部的ADC轉換為10位逐次逼近型ADC。ADC與一個8通道的模擬多路復用器連接，能對來自端口A 的8 路單端輸入模擬電壓進行采樣。單端電壓輸入以0V (GND) 為基準。器件還支持16 路差分電壓輸入組合。

標簽： ADC AVR 單片機變換

上傳時間： 2017-07-09

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多路只能搶答器的設計

多路只能搶答器的設計，可以供學習數字電路知識時參考。

標簽： 多路搶答器

上傳時間： 2014-08-16

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單片機課程設計(基于多路數字搶答器)

單片機課程設計(基于多路數字搶答器)這是一份非常不錯的資料，歡迎下載，希望對您有幫助！

標簽： 單片機

上傳時間： 2022-03-04

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多路多節功分器的設計與傳輸線問題的研究

文章的設計是采用內部互聯一分二功分器的方法來實現多路功分器, 因為實際制作中很難將一分二功分器直接相連, 所以在一分二功分器之間需要采用傳輸線進行連接, 本文主要研究了內部互聯多路多節功分器的性能以及傳輸線對內部互聯多路多節功分器的影響。

標簽： 多路功分器傳輸線

上傳時間： 2013-10-26

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多路模擬信號采集器

這是多路模擬信號采集器，歡迎大家下載觀看

標簽： 多路模擬信號采集器

上傳時間： 2013-12-09

上傳用戶：wfl_yy
基于LM2679多路輸出DC-DC變換器

發現并證明了在設計多路大電流DC-DC變換器時,如果對每個工作模塊進行有效隔離可避免自激情況發生。這個發現可更好地指導設計大電流多路DC-DC變換器。

標簽： DC-DC 2679 LM 多路輸出

上傳時間： 2013-10-23

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多路輸出反激變換器的假斷續行為分析

在對具有多路輸出的反激變換器進行理論分析的基礎上，進行了模型仿真及試驗。其結果揭示了由于各路輸出時間常數的不同，而導致變換器在連續工作模式下出現假斷續狀態，此分析結果為反激變換器的輸出參數設計提供了很好的依據。

標簽： 多路輸出反激變換器假斷續分

上傳時間： 2013-11-17

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基于FPGA的多路高速串并轉換器設計

高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

標簽： FPGA 多路串并轉換

上傳時間： 2013-11-03

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基于FPGA的多路高速串并轉換器設計

高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

標簽： FPGA 多路串并轉換

上傳時間： 2013-11-17

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內附多路選擇器

內附多路選擇器，74系列芯片VHDL源碼，加法器，FIR，比較器等大量例子，對初學VHDL語言很有好處?？捎胢axplus，quartus，synplicity等綜合軟件進行調試

標簽： 多路選擇器

上傳時間： 2013-12-26

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