·西門子變頻器6SE70、整流單元、6RA70、440等調(diào)試參數(shù)
上傳時(shí)間： 2013-06-06
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·詳細(xì)說明：VC++視頻開發(fā)實(shí)例集錦，包括“遠(yuǎn)程視頻監(jiān)控”語音識(shí)別系統(tǒng)等13個(gè)經(jīng)典例子。是VC++源碼.文件列表: vc++視頻開發(fā) ............\chap10 ............\......\BDA ............\......\...\bda.dsw ............\......\...
標(biāo)簽： quot VC 視頻開發(fā) 實(shí)例集錦
上傳時(shí)間： 2013-04-24
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微軟等數(shù)據(jù)結(jié)構(gòu)算法面試100題全部答案集錦 找工作的朋友們，可以下載來看看，全部都是經(jīng)典面試題。
標(biāo)簽： 100 微軟 數(shù)據(jù)結(jié)構(gòu) 算法
上傳時(shí)間： 2013-04-24
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采用等精度測(cè)頻原理的頻率計(jì)程序與仿真：4位顯示的等精度頻率計(jì)。
標(biāo)簽： 等精度測(cè)頻 程序 頻率計(jì)
上傳時(shí)間： 2013-04-24
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實(shí)現(xiàn)LCD1602的字符數(shù)字字母等顯示功能，結(jié)合VHDL語言在Q2下實(shí)現(xiàn)
上傳時(shí)間： 2013-08-06
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主要介紹了等精度頻率測(cè)量原理，該原理具有在整個(gè)測(cè)試頻段內(nèi)保持高精度頻率\r\n測(cè)量的優(yōu)點(diǎn) 同時(shí)在該原理基礎(chǔ)上，采用了Verilog HDL語言設(shè)計(jì)了高速的等精度測(cè)頻\r\n模塊，并且利用EDA開發(fā)平臺(tái)QUARTUS11 3 .0對(duì)CPLD芯片進(jìn)行寫人，實(shí)現(xiàn)了計(jì)數(shù)等\r\n主要邏輯功能 還使用C語言設(shè)計(jì)了該等精度頻率計(jì)的主控程序以提高測(cè)量精度。本設(shè)\r\n計(jì)實(shí)現(xiàn)了對(duì)頻率變化范圍較大的信號(hào)進(jìn)行頻率測(cè)量，能夠滿足高速度、高精度的測(cè)頻要\r\n求。
上傳時(shí)間： 2013-08-16
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介紹了Xilinx最新的EDK9．1i和ISE9．1i等工具的設(shè)計(jì)使用流程
上傳時(shí)間： 2013-08-16
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基于等精度測(cè)量原理的頻率計(jì)，AT89S52和CPLD,有詳細(xì)注釋。測(cè)量準(zhǔn)確。
標(biāo)簽： 等精度 測(cè)量原理 頻率計(jì)
上傳時(shí)間： 2013-08-18
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nois中基于c的ddr等存儲(chǔ)器的checksum的實(shí)現(xiàn).
標(biāo)簽： checksum nois ddr 存儲(chǔ)器
上傳時(shí)間： 2013-08-26
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智能機(jī)器小車主要完成尋跡功能，由機(jī)械結(jié)構(gòu)和控制單元兩個(gè)部分組成。機(jī)械結(jié)構(gòu)是一個(gè)由底盤、前后輔助輪、控制板支架、傳感器支架、左右驅(qū)動(dòng)輪、步進(jìn)電機(jī)等組成。控制單元部分主要由主要包含傳感器及其調(diào)理電路、步進(jìn)電機(jī)及驅(qū)動(dòng)電路、控制器三個(gè)部分。本設(shè)計(jì)的核心為控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作主控芯片。CPLD芯片的設(shè)計(jì)主要在MAX+plusⅡ10.0環(huán)境下利用VHDL語言編程實(shí)現(xiàn)。驅(qū)動(dòng)步進(jìn)電機(jī)電路主要利用ULN2803作為驅(qū)動(dòng)芯片。
標(biāo)簽： CPLD 設(shè)計(jì)實(shí)現(xiàn) 智能機(jī)
上傳時(shí)間： 2013-08-30
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