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振動信號

  • TC35I西門子短信模塊開發板M3電路圖

    TC35I西門子短信模塊開發板M3

    標簽: 35I TC 35 西門子

    上傳時間: 2013-10-10

    上傳用戶:eastgan

  • 為什么在晶振并上電阻

    STM32F晶振的使用

    標簽: 晶振 上電

    上傳時間: 2013-10-08

    上傳用戶:dvfeng

  • 基于嵌入式系統的切削顫振在線監測技術研究

    針對機床切削過程中的顫振現象難于實時、精確監測和控制的問題,設計了一種基于"FPGA+ARM"結構的切削顫振在線監測系統.切削振動數據采集主控制邏輯用FPGA來實現,ARM則用來實現采集數據的處理及快速發出顫振警報.

    標簽: 嵌入式系統 切削 在線監測 技術研究

    上傳時間: 2014-12-30

    上傳用戶:jdm439922924

  • GSM短信貓說明

    usb短信貓

    標簽: GSM 短信

    上傳時間: 2013-11-07

    上傳用戶:旭521

  • 低信噪比環境下WCDMA小區搜索的FPGA實現

    針對區域內多個小區普查的需求,對復雜環境下低信噪比WCDMA小區搜索進行了針對性改進,采用差分相干累積以及RS軟譯碼算法提高了低信噪比條件下WCDMA小區搜索性能并利用FPGA進行了工程實現,仿真計算和安捷倫E5515C的測試結果表明改進是有效的。

    標簽: WCDMA FPGA 低信噪比 環境

    上傳時間: 2013-11-18

    上傳用戶:wxqman

  • 一種彩信報警系統方案

    設計一種基于GPRS 和51 單片機的彩信報警系統。利用單片機技術、帶彩信協議GPRS 無線通信模塊、圖像捕獲和圖像壓縮編碼功能模塊,實現原理圖設計到電路板設計開發。

    標簽: 彩信報警 系統方案

    上傳時間: 2013-11-10

    上傳用戶:china97wan

  • 基于FPGA技術的偏振模色散自適應補償技術設計與仿真

    我國的骨干通信網上的傳輸速率已經向40 GB/s甚至是160 GB/s發展,傳輸線路以光纖作為主要的傳輸通道。與光纖相關的損耗和單模光纖的主要色散,即偏振模色散,不僅僅限制了光信號在通信過程中的傳輸距離,還很大程度上影響其通信容量。其中,偏振模色散對單模光纖高速和長距離通信的影響尤為突出。因此應現代光纖通信技術網的高速發展的需要,把當前流行的FPGA技術應用到單模光纖的偏振模色散的自適應補償技術中,用硬件描述語言來實現,可以大大提高光纖的偏振模色散自適應補償對實時性和穩定性的要求。

    標簽: FPGA 偏振模 仿真 補償技術

    上傳時間: 2014-01-22

    上傳用戶:wfeel

  • 基于FPGA的多功能多路舵機控制器的實現

    伺服舵機作為基本的輸出執行機構廣泛應用于 遙控航模以及人形機器人的控制中。舵機是一種位 置伺服的驅動器,其控制信號是PWM信號.,利 用占空比的變化改變舵機的位置,也可使用FPGA、 模擬電路、單片機來產生舵機的控制信號舊。應 用模擬電路產生PWM信號,應用的元器件較多, 會增加電路的復雜程度;若用單片機產生PWM信 號,當信號路數較少時單片機能滿足要求,但當 PWM信號多于4路時,由于單片機指令是順序執 行的,會產生較大的延遲,從而使PWM信號波形 不穩,導致舵機發生顫振。

    標簽: FPGA 多功能 多路 舵機

    上傳時間: 2013-11-20

    上傳用戶:cjh1129

  • 基于FPGA的恒溫晶振頻率校準系統的設計

    為滿足三維大地電磁勘探技術對多個采集站的同步需求,基于FPGA設計了一種晶振頻率校準系統。系統可以調節各采集站的恒溫壓控晶體振蕩器同步于GPS,從而使晶振能夠輸出高準確度和穩定度的同步信號。系統中使用FPGA設計了高分辨率的時間間隔測量單元,達到0.121 ns的測量分辨率,能對晶振分頻信號與GPS秒脈沖信號的時間間隔進行高精度測量,縮短了頻率校準時間。同時在FPGA內部使用PicoBlaze嵌入式軟核處理器監控系統狀態,并配合滑動平均濾波法對測量得到的時間間隔數據實時處理,有效地抑制了GPS秒脈沖波動對頻率校準的影響。

    標簽: FPGA 恒溫晶振 頻率校準

    上傳時間: 2013-11-17

    上傳用戶:www240697738

  • 在FPGA中基于信元的FIFO設計方法實戰方法

      設計工程師通常在FPGA上實現FIFO(先進先出寄存器)的時候,都會使用由芯片提供商所提供的FIFO。但是,由于其通用性使得其針對性變差,某些情況下會變得不方便或者將增加硬件成本。此時,需要進行自行FIFO設計。本文提供了一種基于信元的FIFO設計方法以供設計者在適當的時候選用。這種方法也適合于不定長包的處理。

    標簽: FPGA FIFO 信元 設計方法

    上傳時間: 2013-11-05

    上傳用戶:ch3ch2oh

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