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數(shù)(shù)字邏輯電路

  • 定壓輸入6000VDC隔離非穩(wěn)壓單路輸出

    定壓輸入、6000VDC隔離非穩(wěn)壓單路輸出電源模塊效率高、體積小、可靠性高、耐沖擊、隔離特性好,溫度范圍寬。國際標(biāo)準(zhǔn)引腳方式,阻燃封裝(UL94-V0),自然冷卻,無需外加散熱片,無需外加其他元器件可直接使用,并可直接焊接在PCB板上。

    標(biāo)簽: 6000 VDC 定壓輸入 隔離非穩(wěn)壓

    上傳時間: 2013-10-15

    上傳用戶:u789u789u789

  • 多路電壓采集系統(tǒng)

    多路電壓采集系統(tǒng)一、實驗?zāi)康模保煜た删幊绦酒珹DC0809,8253的工作過程,掌握它們的編程方法。2.加深對所學(xué)知識的理解并學(xué)會應(yīng)用所學(xué)的知識,達到在應(yīng)用中掌握知識的目的。 二、實驗內(nèi)容與要求1.基本要求通過一個A/D轉(zhuǎn)換器循環(huán)采樣4路模擬電壓,每隔一定時間去采樣一次,一次按順序采樣4路信號。A/D轉(zhuǎn)換器芯片AD0809將采樣到的模擬信號轉(zhuǎn)換為數(shù)字信號,轉(zhuǎn)換完成后,CPU讀取數(shù)據(jù)轉(zhuǎn)換結(jié)果,并將結(jié)果送入外設(shè)即CRT/LED顯示,顯示包括電壓路數(shù)和數(shù)據(jù)值。2. 提高要求 (1) 可以實現(xiàn)循環(huán)采集和選擇采集2種方式。(2)在CRT上繪制電壓變化曲線。 三、實驗報告要求 1.設(shè)計目的和內(nèi)容 2.總體設(shè)計 3.硬件設(shè)計:原理圖(接線圖)及簡要說明 4.軟件設(shè)計框圖及程序清單5.設(shè)計結(jié)果和體會(包括遇到的問題及解決的方法) 四、總體設(shè)計設(shè)計思路如下:1) 4路模擬電壓信號通過4個電位器提供0-5V的電壓信號。2) 選擇ADC0809芯片作為A/D轉(zhuǎn)換器,4路輸入信號分別接到ADC0809的IN0—IN4通道,每隔一定的時間采樣一次,采完一路采集下一路,4路電壓循環(huán)采集。3) 利用3個LED數(shù)碼管顯示數(shù)據(jù),1個數(shù)碼管用來顯示輸入電壓路數(shù),3個數(shù)碼管用來顯示電壓采樣值。4) 延時由8253定時/計數(shù)器來實現(xiàn)。 五、硬件電路設(shè)計根據(jù)設(shè)計思路,硬件主要利用了微機實驗平臺上的ADC0809模數(shù)轉(zhuǎn)換器、8253定時/計數(shù)器以及LED顯示輸出等模塊。電路原理圖如下:1.基本接口實驗板部分1) 電位計模塊,4個電位計輸出4路1-5V的電壓信號。2) ADC0809模數(shù)轉(zhuǎn)換器,將4路電壓信號接到IN0-IN3,ADD_A、ADD_B、ADD_C分別接A0、A1、A2,CS_AD接CS0時,4個采樣通道對應(yīng)的地址分別為280H—283H。3) 延時模塊,8253和8255組成延時電路。8255的PA0接到8253的OUT0,程序中查詢計數(shù)是否結(jié)束。硬件電路圖如圖1所示。 圖1 基本實驗板上的電路圖實驗板上的LED顯示部分實驗板上主要用到了LED數(shù)碼管顯示電路,插孔CS1用于數(shù)碼管段碼的輸出選通,插孔CS2用于數(shù)碼管位選信號的輸出選通。電路圖如圖2所示。

    標(biāo)簽: 多路 電壓采集

    上傳時間: 2013-11-06

    上傳用戶:sunchao524

  • FPGA與ARM EPI通信,控制16路步進電機和12路DC馬達 VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進電機和12路DC馬達 VHDL編寫的,,,,,

    標(biāo)簽: FPGA VHDL ARM EPI

    上傳時間: 2013-10-21

    上傳用戶:zhyfjj

  • 基于FPGA的無人機多路視頻監(jiān)控系統(tǒng)設(shè)計

    為了能實時監(jiān)控?zé)o人機的狀態(tài)和提高無人機的安全可靠性,本設(shè)計利用FPGA高速率、豐富的片上資源和靈活的設(shè)計接口,設(shè)計了一套無人機多路監(jiān)控系統(tǒng)。該監(jiān)控系統(tǒng)具備了將處于無人機不同位置的攝像機所采集的視頻信息,傳送給地面站控制設(shè)備,并在同一臺顯示器上實現(xiàn)同步顯示的功能。仿真結(jié)果表明,該系統(tǒng)可以很好的保證監(jiān)控視頻的實時性、和高清度,確保無人機完成偵查任務(wù)。

    標(biāo)簽: FPGA 無人機 多路 視頻監(jiān)控

    上傳時間: 2013-10-22

    上傳用戶:cxl274287265

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計

      系統(tǒng)結(jié)構(gòu)如 圖 1所示 , 從 系統(tǒng) 結(jié) 構(gòu)圖可 以看 出 , 系統(tǒng)主要包括視頻信 號輸入模塊 , 視頻信號處 理模 塊和視頻信號輸出模塊等 3個部分組成。各個模塊主要功能為: 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號 轉(zhuǎn) 換成 數(shù) 字 信 號 送 到F P GA; 視頻處理模塊主要有F P GA 完成 ,根據(jù) 需要 對輸入 的數(shù)字視頻信號進行處理 ; 視頻輸 出模塊將 F P GA處理后的信號轉(zhuǎn)換成模擬信號輸出到顯示器。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時間: 2013-11-11

    上傳用戶:shawvi

  • 基于FPGA的多路視頻合成系統(tǒng)的設(shè)計

      摘 要:研究一種基于FPGA的多路視頻合成系統(tǒng)。系統(tǒng)接收16路ITU656格式的視頻數(shù)據(jù),按照畫面分割的要求對視頻數(shù)據(jù)流進行有效抽取和幀合成處理,經(jīng)過視頻編碼芯片轉(zhuǎn)換成模擬信號輸出到顯示器,以全屏或多窗口模式顯示多路視頻畫面。系統(tǒng)利用FPGA的高速并行處理能力的優(yōu)勢,應(yīng)用靈活的的多路視頻信號的合成技術(shù)和數(shù)字圖像處理算法,實現(xiàn)實時處理多路視頻數(shù)據(jù)。

    標(biāo)簽: FPGA 多路 視頻合成

    上傳時間: 2014-12-05

    上傳用戶:jiangfire

  • 基于FPGA的多功能多路舵機控制器的實現(xiàn)

    伺服舵機作為基本的輸出執(zhí)行機構(gòu)廣泛應(yīng)用于 遙控航模以及人形機器人的控制中。舵機是一種位 置伺服的驅(qū)動器,其控制信號是PWM信號.,利 用占空比的變化改變舵機的位置,也可使用FPGA、 模擬電路、單片機來產(chǎn)生舵機的控制信號舊。應(yīng) 用模擬電路產(chǎn)生PWM信號,應(yīng)用的元器件較多, 會增加電路的復(fù)雜程度;若用單片機產(chǎn)生PWM信 號,當(dāng)信號路數(shù)較少時單片機能滿足要求,但當(dāng) PWM信號多于4路時,由于單片機指令是順序執(zhí) 行的,會產(chǎn)生較大的延遲,從而使PWM信號波形 不穩(wěn),導(dǎo)致舵機發(fā)生顫振。

    標(biāo)簽: FPGA 多功能 多路 舵機

    上傳時間: 2014-12-28

    上傳用戶:ainimao

  • 七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路

             七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路包括基礎(chǔ)篇、時序篇和驗證篇三個部分。

    標(biāo)簽: Altera FPGA

    上傳時間: 2013-10-11

    上傳用戶:woshinimiaoye

  • 采用FPGA的多路高壓IGBT驅(qū)動觸發(fā)器研制

    為有效控制固態(tài)功率調(diào)制設(shè)備,提高系統(tǒng)的可調(diào)性和穩(wěn)定性,介紹了一種基于現(xiàn)場可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅(qū)動觸發(fā)器的設(shè)計方法和實現(xiàn)電路。該觸發(fā)器可選擇內(nèi)或外觸發(fā)信號,可遙控或本控,能產(chǎn)生多路頻率、寬度和延時獨立可調(diào)的脈沖信號,信號的輸入輸出和傳輸都使用光纖。將該觸發(fā)器用于高壓IGBT(3300 V/ 800 A) 感應(yīng)疊加脈沖發(fā)生器中進行實驗測試,給出了實驗波形。結(jié)果表明,該多路高壓IGBT驅(qū)動觸發(fā)器輸出脈沖信號達到了較高的調(diào)整精度,頻寬’脈寬及延時可分別以步進1 Hz、0. 1μs、0. 1μs 進行調(diào)整,滿足了脈沖發(fā)生器的要求,提高了脈沖功率調(diào)制系統(tǒng)的性能。

    標(biāo)簽: FPGA IGBT 多路 驅(qū)動

    上傳時間: 2013-10-22

    上傳用戶:zhulei420

  • 基于FPGA的多路高速串并轉(zhuǎn)換器設(shè)計

    高速串并轉(zhuǎn)換器的設(shè)計是FPGA 設(shè)計的一個重要方面,傳統(tǒng)設(shè)計方法由于采用FPGA 的內(nèi)部邏輯資源來實現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗證平臺中多路高速串并轉(zhuǎn)換器的設(shè)計為例,詳細闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計方法和16 路1 :8 串并轉(zhuǎn)換器的實現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計的多路串并轉(zhuǎn)換器可以實現(xiàn)800 Mbit/ s 輸入信號的串并轉(zhuǎn)換,并且減少了設(shè)計復(fù)雜度,縮短了開發(fā)周期,能滿足設(shè)計要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場可編程邏輯陣列;Xilinx ; ISERDES

    標(biāo)簽: FPGA 多路 串并轉(zhuǎn)換

    上傳時間: 2013-11-03

    上傳用戶:王小奇

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