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時(shí)(shí)延算法

一種基于SIFT描述子的特征匹配新算法

為了克服傳統(tǒng)的局部特征匹配算法對(duì)噪聲和圖像灰度非線性變換敏感的不足，提出了基于SIFT（Scale Invariant Feature Transform）描述算子的特征匹配算法。該算法首先

標(biāo)簽： SIFT 特征匹配新算法

上傳時(shí)間： 2013-04-24

上傳用戶：hphh
高噪聲率下極值型中值濾波算法的改進(jìn)

極值型中值濾波算法在高噪聲率下的濾波效果不是很好，主要原因有以下兩個(gè)：首先，濾波窗口中過(guò)多的噪聲點(diǎn)會(huì)使窗口中的點(diǎn)在排序時(shí)產(chǎn)生中值偏移；其次是高噪聲率環(huán)境下，可能序列中值本身就是是噪聲點(diǎn)。對(duì)此，本文提出

標(biāo)簽： 高噪聲率中值濾波法的改進(jìn)

上傳時(shí)間： 2013-06-26

上傳用戶：小小小熊
超寬帶脈沖與MB-OFDM物理層的FPGA實(shí)現(xiàn)

現(xiàn)代通信系統(tǒng)對(duì)帶寬和數(shù)據(jù)速率的要求越來(lái)越高，超寬帶(ultra-wideband，UWB)通信以其傳輸速率高、空間容量大、成本低、功耗低的優(yōu)點(diǎn)，成為解決企業(yè)、家庭、公共場(chǎng)所等高速因特網(wǎng)接入的需求與越來(lái)越擁擠的頻率資源分配之間的矛盾的技術(shù)手段。論文主要圍繞兩方面展開(kāi)分析：一是介紹用于UWB無(wú)載波脈沖調(diào)制及直接序列碼分多址調(diào)制(DS-CDMA)的新型脈沖，即Hermite正交脈沖，并且分析了這種構(gòu)建UWB多元通信和多用戶通信的系統(tǒng)性能。二是分析了UWB的多帶頻分復(fù)用物理層提案(MBOA)的調(diào)制技術(shù)，并在FPGA上實(shí)現(xiàn)了調(diào)制模塊。正交Hermite脈沖集被提出用于UWB的M元雙正交調(diào)制系統(tǒng)，獲得高數(shù)據(jù)速率。調(diào)整脈沖的脈寬因子和中心頻率能使脈沖滿足FCC的頻譜要求。M元雙正交調(diào)制的接收機(jī)需要M/2個(gè)相關(guān)器，遠(yuǎn)比M元正交調(diào)制所需的相關(guān)器數(shù)量少。誤碼率一定時(shí)，維數(shù)M的增加可獲得高的比特率和低的信噪比。雖然高階的Hermite脈沖易受抖動(dòng)時(shí)延的影響，但當(dāng)抖動(dòng)時(shí)延范圍小于0.02ns時(shí)，其影響較為不明顯。本文認(rèn)為1～8階的Hermite脈沖皆可用，可構(gòu)成16元雙正交系統(tǒng)。正交Hermite脈沖集也可以構(gòu)造UWB多用戶系統(tǒng)。各用戶的信息用不同的Hermite脈沖同時(shí)傳輸，其多用戶的誤比特率上限低于高斯單脈沖構(gòu)成的PPM多用戶系統(tǒng)的誤比特率，所以其系統(tǒng)性能更優(yōu)。正交Hermite脈沖還可以用于UWB的DS-CDMA調(diào)制，在8個(gè)脈沖可用的情況下，最多可容64個(gè)用戶同時(shí)通信。基于MBOA提出的UWB物理層協(xié)議，本文用Verilog硬件語(yǔ)言實(shí)現(xiàn)了調(diào)制與解調(diào)結(jié)構(gòu)，并用Modelsim做了時(shí)序驗(yàn)證。用Verilog編程實(shí)現(xiàn)的輸出數(shù)據(jù)與Matlab生成的UWB建模的輸出結(jié)果一致。為了達(dá)到UWBMB-OFDM系統(tǒng)的FFT處理器的要求，一個(gè)混和基多通道流水線的FFT算法結(jié)構(gòu)被提出。其有效的實(shí)現(xiàn)方法也被提出。這種結(jié)構(gòu)采用多通道以獲得高的數(shù)據(jù)吞吐量。此外，它用于存儲(chǔ)和復(fù)數(shù)乘法器的硬件損耗相比其他的FFT處理器是最少的。高基的FFT蝶算減少了復(fù)數(shù)乘法器的數(shù)量。在132MHz的工作頻率下，整個(gè)128點(diǎn)FFT變換在此結(jié)構(gòu)模式下只需要242.4ns,滿足了MBOA的要求。

標(biāo)簽： MB-OFDM FPGA 超寬帶脈沖

上傳時(shí)間： 2013-07-29

上傳用戶：TI初學(xué)者
RS編譯碼器的設(shè)計(jì)與FPGA實(shí)現(xiàn)

Reed-Solomon碼(簡(jiǎn)稱RS碼)是一種具有很強(qiáng)糾正突發(fā)和隨機(jī)錯(cuò)誤能力的信道編碼方式，在深空通信、移動(dòng)通信、磁盤(pán)陣列以及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛的應(yīng)用。本文簡(jiǎn)要介紹了有限域基本運(yùn)算的算法和常用的RS編碼算法，分析了改進(jìn)后的Euclid算法和改進(jìn)后的BM算法，針對(duì)改進(jìn)后的BM算法提出了一種流水線結(jié)構(gòu)的譯碼器實(shí)現(xiàn)方案并改進(jìn)了該算法的實(shí)現(xiàn)結(jié)構(gòu)，在譯碼器復(fù)雜度和譯碼延時(shí)上作了折衷，降低了譯碼器的復(fù)雜度并提高了譯碼器的最高工作頻率。在Xilinx公司的Virtex-Ⅱ系列FPGA上設(shè)計(jì)實(shí)現(xiàn)了RS(255,239)編譯碼器，證明了該方案的可行性。

標(biāo)簽： FPGA RS編譯碼

上傳時(shí)間： 2013-06-11

上傳用戶：奇奇奔奔
基于FPGA/CPLD實(shí)現(xiàn)的FFT算法與仿真分析

可編程邏輯器件FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)和CPLD(復(fù)雜可編程邏輯器件)越來(lái)越多的應(yīng)用于數(shù)字信號(hào)處理領(lǐng)域，與傳統(tǒng)的ASIC(專用集成電路)和DSP(數(shù)字信號(hào)處理器)相比，基于FPGA和CPLD實(shí)現(xiàn)的數(shù)字信號(hào)處理系統(tǒng)具有更高的實(shí)時(shí)性和可嵌入性，能夠方便地實(shí)現(xiàn)系統(tǒng)的集成與功能擴(kuò)展。 FFT的硬件結(jié)構(gòu)主要包括蝶形處理器、存儲(chǔ)單元、地址生成單元與控制單元。本文提出的算法在蝶形處理器內(nèi)引入流水線結(jié)構(gòu)，提高了FFT的運(yùn)算速度。同時(shí)，流水線寄存器能夠寄存蝶形運(yùn)算中的公共項(xiàng)，這樣在設(shè)計(jì)蝶形處理器時(shí)只用到了一個(gè)乘法器和兩個(gè)加法器，降低了硬件電路的復(fù)雜度。為了進(jìn)一步提高FFT的運(yùn)算速度，本文在深入研究各種乘法器算法的基礎(chǔ)上，為蝶形處理器設(shè)計(jì)了一個(gè)并行乘法器。在實(shí)現(xiàn)該乘法器時(shí)，本文采用改進(jìn)的布斯算法，用以減少部分積的個(gè)數(shù)。同時(shí)，使用華萊士樹(shù)結(jié)構(gòu)和4-2壓縮器對(duì)部分積并行相加。本文以32點(diǎn)復(fù)數(shù)FFT為例進(jìn)行設(shè)計(jì)與邏輯綜合。通過(guò)設(shè)計(jì)相應(yīng)的存儲(chǔ)單元，地址生成單元和控制單元完成FFT電路。電路的仿真結(jié)果與軟件計(jì)算結(jié)果相符，證明了本文所提出的算法的正確性。另外，本文還對(duì)設(shè)計(jì)結(jié)果提出了進(jìn)一步的改進(jìn)方案，在乘法器內(nèi)加入一級(jí)流水線寄存器，使FFT的速度能夠提高到當(dāng)前速度的兩倍，這在實(shí)時(shí)性要求較高的場(chǎng)合具有極高的實(shí)用價(jià)值。

標(biāo)簽： FPGA CPLD FFT 算法

上傳時(shí)間： 2013-07-18

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ECC密碼算法的FPGA實(shí)現(xiàn)及優(yōu)化設(shè)計(jì)

　　本文主要對(duì)基于FPGA芯片的橢圓曲線密碼算法的實(shí)現(xiàn)及優(yōu)化設(shè)計(jì)進(jìn)行了研究。由于點(diǎn)乘運(yùn)算極大影響了橢圓曲線密碼系統(tǒng)的加/解密速度，本文對(duì)點(diǎn)乘運(yùn)算的FPGA設(shè)計(jì)進(jìn)行了重點(diǎn)優(yōu)化。首先比較分析了三種點(diǎn)乘算法，從運(yùn)算復(fù)雜度的角度確定了蒙哥馬里算法是最利于FPGA芯片實(shí)現(xiàn)的。然后根據(jù)蒙哥馬里算法，用VerilogHDL語(yǔ)言實(shí)現(xiàn)了基于FPGA芯片的橢圓域中的基本運(yùn)算(模加、模乘、模平方和模逆)。通過(guò)三種模乘算法在FPGA上的實(shí)現(xiàn)，設(shè)計(jì)出一種串并混合的乘法器，達(dá)到了面積與速度的最佳匹配。本文利用Modelsim對(duì)本課題設(shè)計(jì)的硬件系統(tǒng)進(jìn)行了仿真實(shí)驗(yàn)，驗(yàn)證了所設(shè)計(jì)的硬件系統(tǒng)完成了橢圓曲線密碼算法在FPGA上的實(shí)現(xiàn)。最后使用SynplifyPro進(jìn)行綜合及布局布線，綜合報(bào)告文件證明了本課題所設(shè)計(jì)的ECC加密系統(tǒng)達(dá)到了優(yōu)化芯片速度和面積的目的。

標(biāo)簽： FPGA ECC 密碼算法優(yōu)化設(shè)計(jì)

上傳時(shí)間： 2013-04-24

上傳用戶：thuyenvinh
RS（255，223）譯碼器的FPGA實(shí)現(xiàn)及其性能測(cè)試

　　本課題首先研究了常規(guī)的RS譯碼器的算法，確定在關(guān)鍵方程的計(jì)算中采用一種新改進(jìn)的BM算法，然后提出了基于復(fù)數(shù)基的有限域快速并行乘法器和利用冪指數(shù)相減進(jìn)行除法計(jì)算的有限域除法器，通過(guò)這些優(yōu)化方法提高了RS譯碼器的速度，減少了譯碼延時(shí)和硬件資源使用，最后利用VHDL硬件描述語(yǔ)言在FPGA上實(shí)現(xiàn)了流水線處理的RS(255,223)譯碼器?！?　本課題實(shí)現(xiàn)的RS(255,223)硬件譯碼器的性能在國(guó)內(nèi)具有領(lǐng)先水平，對(duì)我國(guó)以后航天項(xiàng)目高速數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)有著很大的意義?！?/p>
標(biāo)簽： FPGA 255 223 譯碼器

上傳時(shí)間： 2013-06-29

上傳用戶：gokk
基于FPGA的細(xì)胞圖像識(shí)別預(yù)處理的硬件研究

本文提出了一種基于FPGA的細(xì)胞圖像識(shí)別系統(tǒng)方案，該系統(tǒng)中FPGA處于核心地位，F(xiàn)PGA采用Altera公司的EP1K100QC208-1芯片，構(gòu)造專用處理功能，實(shí)現(xiàn)彩色圖像灰度化、灰度變換、中值濾波、低通濾波、灰度圖像二值化等算法。這部分處理的數(shù)據(jù)量非常大，由于采用FPGA處理，產(chǎn)生的時(shí)延變得很小；最后系統(tǒng)機(jī)進(jìn)行識(shí)別處理的是二值圖像，數(shù)據(jù)量也很小。所進(jìn)行的仿真實(shí)驗(yàn)取得了良好的效果，給出了部分源代碼和實(shí)驗(yàn)結(jié)果。設(shè)計(jì)采用VHDL語(yǔ)言描述，并使用電子設(shè)計(jì)自動(dòng)化(EDA)工具進(jìn)行了模擬和驗(yàn)證。

標(biāo)簽： FPGA 圖像識(shí)別預(yù)處理硬件

上傳時(shí)間： 2013-04-24

上傳用戶：xwd2010
圖像縮放算法的研究及其在FPGA上的實(shí)現(xiàn)

作者研究了當(dāng)前流行的縮放算法，對(duì)圖像紋理相關(guān)性大小和邊緣方向的判斷上提出了一種新的方法，并在此基礎(chǔ)上發(fā)展了一套適用于數(shù)字視頻芯片的圖像縮放算法。仿真結(jié)果表明此算法由優(yōu)于目前流行的圖像縮放算法。介紹了FPGA的開(kāi)發(fā)工作大致可以分為設(shè)計(jì)和驗(yàn)證兩大部分，在具體開(kāi)發(fā)流程上可以根據(jù)要求靈活控制?？s放芯片的開(kāi)發(fā)可以分為：芯片結(jié)構(gòu)設(shè)計(jì)、時(shí)鐘系統(tǒng)設(shè)計(jì)、存儲(chǔ)器讀寫(xiě)控制、IP核復(fù)用設(shè)計(jì)、計(jì)算精度控制等方面的電路設(shè)計(jì)。在設(shè)計(jì)完成各級(jí)子模塊以后拼接各子?？焱瓿烧麄€(gè)縮放模塊的設(shè)計(jì)。通過(guò)測(cè)試發(fā)現(xiàn)設(shè)計(jì)中存在的缺陷，修改再測(cè)試，最終完成整個(gè)模塊的設(shè)計(jì)?！　?/p>
標(biāo)簽： FPGA 圖像法的研究

上傳時(shí)間： 2013-05-31

上傳用戶：tdyoung
G.729語(yǔ)音編碼算法及其關(guān)鍵部分FPGA設(shè)計(jì)的研究

本文對(duì)G.729語(yǔ)音編碼算法的基本原理和實(shí)現(xiàn)系統(tǒng)開(kāi)發(fā)方面進(jìn)行了深入研究。針對(duì)G.729語(yǔ)音編碼算法在實(shí)際應(yīng)用中存在的一些問(wèn)題，在大量分析和實(shí)驗(yàn)的基礎(chǔ)上，提出了新的改進(jìn)算法。G.729語(yǔ)音編碼算法硬件實(shí)現(xiàn)方面，國(guó)內(nèi)外現(xiàn)在主要以DSP為實(shí)現(xiàn)平臺(tái)，這是由于DSP以其卓越的運(yùn)算能力為數(shù)字語(yǔ)音信號(hào)處理領(lǐng)域的研究及開(kāi)發(fā)提供了有力的工具。但G.729語(yǔ)音編碼算法具有計(jì)算復(fù)雜和數(shù)據(jù)存儲(chǔ)量大的固有缺陷，隨著通信量的不斷增加和服務(wù)的擴(kuò)展，對(duì)G.729語(yǔ)音編碼實(shí)時(shí)性的要求也越來(lái)越高。隨著微電子制造工藝的發(fā)展，越來(lái)越多的語(yǔ)音編碼平臺(tái)采用DSP與FPGA或MCU相互結(jié)合的系統(tǒng)，通過(guò)進(jìn)行軟硬件協(xié)同設(shè)計(jì)提高編碼效率。

標(biāo)簽： FPGA 729 語(yǔ)音編碼算法

上傳時(shí)間： 2013-06-30

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