高效的乘法函數,不用調用系統乘法器,對沒有乘法器的系統來說非常有用.
標簽： 乘法器 乘法 函數
上傳時間： 2016-09-21
上傳用戶：wanqunsheng
GF_2_m_域乘法器的快速設計及FPGA實現，ＲＳ編碼及其譯碼都是在GF_2_m_域中進行的
標簽： FPGA GF 乘法器
上傳時間： 2016-09-22
上傳用戶：xsnjzljj
GF_2_m_域乘法器的快速設計及FPGA實現，對于rs編翼碼的理解和設計有幫助
上傳時間： 2013-12-12
上傳用戶：日光微瀾
基于BOOTH的32位快速乘法器的設計源碼
標簽： BOOTH 乘法器 源碼
上傳用戶：pinksun9
altera fpga verilog 設計的基于查找表的DCT程序及zigzag掃描程序，已經過matlab 和modelsim 驗證，文件中包含TESTBENCH ，直接可用
標簽： verilog altera zigzag fpga
上傳時間： 2016-10-08
上傳用戶：362279997
xilinx里的乘法器ip核程序，booth乘法 wallace tree算法 4-2壓縮編碼 超前進位加法
標簽： xilinx 乘法器 程序
上傳時間： 2016-10-17
上傳用戶：ve3344
64位乘法器源碼verilog,經過驗證測試
標簽： verilog 乘法器 源碼 驗證測試
上傳時間： 2016-10-18
上傳用戶：hwl453472107
32位元2進位SIGNED乘法器32位元SIGNED乘法器
標簽： SIGNED 乘法器
上傳時間： 2013-12-17
上傳用戶：皇族傳媒
這是我用verilog hdl語言寫的浮點乘法器,用的是基4的booth算法,對于部分積使用了5-2壓縮和3-2壓縮,歡迎大家指點,也歡迎大家把它改成流水線以提高速度.
標簽： verilog booth hdl 家
上傳時間： 2013-11-29
上傳用戶：jjj0202
用VHDL寫的4*4乘法器，學習VHDL語言的可以
標簽： VHDL 乘法器
上傳時間： 2014-11-24
上傳用戶：JasonC
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