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校準(zhǔn)差

  • 基于FPGA的串行通信實現(xiàn)與CRC校驗

    本文應用EDA技術,基于FPGA器件設計與實現(xiàn)UART,并采用CRC校驗。主要工作如下: 1、在異步串行通信電路部分完全用FPGA來實現(xiàn)。選用Xilinx公司的SpartanⅢ系列的XC3S1000來實現(xiàn)異步串行通信的接收、發(fā)送和接口控制功能,利用FPGA集成度比較高,具有在線可編程能力,在其完成各種功能的同時,完全可以將串行通信接口構建其中,可根據(jù)實際需求分配資源。 2、利用VerilogHDL語言非常容易掌握,功能比VHDL更強大的特點,可以在設計時不斷修改程序,來適用不同規(guī)模的應用,而且采用Verilog輸入法與工藝性無關,利用系統(tǒng)設計時對芯片的要求,施加不同的約束條件,即可設計出實際電路。 3、利用ModelSim仿真工具對程序進行功能仿真和時序仿真,以驗證設計是否能獲得所期望的功能,確定設計程序配置到邏輯芯片之后是否可以運行,以及程序在目標器件中的時序關系。 4、為保證數(shù)據(jù)傳輸?shù)恼_性,采用循環(huán)冗余校驗CRC(CyclicRedundancyCheck),該編碼簡單,誤判概率低,為了減少硬件成本,降低硬件設計的復雜度,本設計通過CRC算法軟件實現(xiàn)。 實驗結(jié)果表明,基于EDA技術的現(xiàn)場可編程門陣列FPGA集成度高,結(jié)構靈活,設計方法多樣,開發(fā)周期短,調(diào)試方便,修改容易,采用FPGA較好地實現(xiàn)了串行數(shù)據(jù)的通信功能,并對數(shù)據(jù)作了一定的處理,本設計中為CRC校驗。另外,可以利用FPGA的在線可編程特性,對本設計電路進行功能擴展,以滿足更高的要求。

    標簽: FPGA CRC 串行 通信實現(xiàn)

    上傳時間: 2013-04-24

    上傳用戶:Altman

  • 共模干擾和差模干擾及其抑制技術

    共模干擾和差模干擾及其抑制技術,是擴干擾技術的基礎。

    標簽: 共模干擾 差模 干擾 抑制技術

    上傳時間: 2013-04-24

    上傳用戶:003030

  • 差分時鐘EMC設計標準電路

    差分時鐘EMC設計標準電路,內(nèi)有電路圖,詳實!

    標簽: EMC 差分 時鐘 設計標準

    上傳時間: 2013-04-24

    上傳用戶:muyehuli

  • 共模干擾和差模干擾

    濾波器雖然是一種十分普通的器件,有關濾波的技術也 已經(jīng)十分成熟。但是,現(xiàn)實情況是許多電磁兼容方面的問題 都是由于對干擾的濾波措施不當造成的。這是由于我們沒有 掌握電磁干擾濾波的一些特點。為了在電磁兼容設計中應用 好濾波技術,正確掌握一些概念是十分必要的。共模干擾和 差模干擾的概念就是這樣一種重要概念。正確區(qū)別共模和差 模干擾對于正確設計和使用濾波器十分重要。

    標簽: 共模干擾 差模 干擾

    上傳時間: 2013-06-04

    上傳用戶:skhlm

  • 校驗碼生成器

    CRC16校驗碼生成器,用于計算16位CRC校驗碼

    標簽: 校驗碼 生成器

    上傳時間: 2013-06-22

    上傳用戶:huangping588

  • 三菱PLC MODBUS RTU通信CRC校驗子程序

    三菱PLC MODBUS RTU通信CRC校驗子程序

    標簽: MODBUS PLC CRC RTU

    上傳時間: 2013-05-16

    上傳用戶:qulele

  • 用于FPGA的N+0.5分頻代碼

    用于FPGA的N+0.5分頻代碼,可以用來進行非整數(shù)分頻!

    標簽: FPGA 0.5 分頻 代碼

    上傳時間: 2013-08-06

    上傳用戶:weixiao99

  • 非常經(jīng)典的循環(huán)冗余校驗碼IEEE文章

    非常經(jīng)典的循環(huán)冗余校驗碼IEEE文章。。

    標簽: IEEE 循環(huán)冗余 校驗碼

    上傳時間: 2013-08-09

    上傳用戶:黃蛋的蛋黃

  • 對硅微諧振式加速度計的數(shù)據(jù)采集電路開展研究工作

    項目的研究內(nèi)容是對硅微諧振式加速度計的數(shù)據(jù)采集電路開展研究工作。硅微諧振式加速度計敏感結(jié)構輸出的是兩路差分的頻率信號,因此硅微諧振式加速度計數(shù)據(jù)采集電路完成的主要任務是測出兩路頻率信號的差值。測量要求是:實現(xiàn)10ms內(nèi)對中心諧振頻率為20kHz、標度因數(shù)為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計輸出的頻率信號的測量,等效測量誤差為±1mg。電路的控制核心為單片機,具有串行接口以便將測量結(jié)果傳送給PC機從而分析、保存測量結(jié)果。\\r\\n按研究內(nèi)容設計了軟硬件。軟件采用多周期同步法

    標簽: 硅微 加速度計 數(shù)據(jù)采集電路 諧振式

    上傳時間: 2013-08-11

    上傳用戶:csgcd001

  • CRC校驗碼并行計算的FPGA實現(xiàn),PDF打開

    CRC校驗碼并行計算的FPGA實現(xiàn),PDF打開

    標簽: FPGA CRC 校驗碼

    上傳時間: 2013-08-18

    上傳用戶:vmznxbc

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