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核密度估計

  • ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項

    ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項

    標簽： ISE_IP DDR ip 教程

    上傳時間： 2013-11-11

    上傳用戶：lmeeworm

  • 在Altera 28nm FPGA上解決100-GbE線路卡設計挑戰(zhàn)

    支持40 GbE、100 GbE和Interlaken的高密度硬核MLD/PCS模塊，從而提高系統(tǒng)集成度。 寬帶數(shù)據(jù)緩沖，提供1,600-Mbps外部存儲器接口。 數(shù)據(jù)包處理和流量管理功能的高效實現(xiàn)。 更高的系統(tǒng)性能，同時保持功耗和成本預算不變。

    標簽： Altera FPGA 100 GbE

    上傳時間： 2013-11-23

    上傳用戶：asdgfsdfht

  • 基于NiosII軟核處理器的步進電機接口設計

        NiosII軟核處理器是Altera公司開發(fā)，基于FPGA操作平臺使用的一款高速處理器，為了適應高速運動圖像采集，提出了一種基于NiosII軟核處理的步進電機接口設計，使用verilog HDL語言完成該接口設計，最后通過QuartusII軟件，給出了實驗仿真結果。

    標簽： NiosII 軟核處理器 步進電機 接口設計

    上傳時間： 2014-12-28

    上傳用戶：jiwy

  • 基于FPGA的DDS IP核設計方案

    以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具，研究了基于FPGA的DDS IP核設計，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件，結合32位嵌入式CPU軟核Nios II，構成可編程片上系統(tǒng)（SOPC），利用極少的硬件資源實現(xiàn)了可重構信號源。該系統(tǒng)基本功能都在FPGA芯片內完成，利用 SOPC技術，在一片 FPGA 芯片上實現(xiàn)了整個信號源的硬件開發(fā)平臺，達到既簡化電路設計、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標簽： FPGA DDS IP核 設計方案

    上傳時間： 2013-11-06

    上傳用戶：songkun

  • 基于多核DSP的SDIF雷達信號分選算法實現(xiàn)

    針對實際應用中電子戰(zhàn)設備對雷達信號分選的實時性要求，在分析了序列差直方圖算法和多核DSP任務并行模式的基礎上，設計了基于TMS320C6678的八核DSP雷達信號分選電路，對密集的雷達信號進行分選。實驗結果表明：該電路可對常規(guī)雷達信號實現(xiàn)快速分選，并且分選效果良好，系統(tǒng)可靠性高。

    標簽： SDIF DSP 多核 雷達信號分選

    上傳時間： 2013-10-16

    上傳用戶：攏共湖塘

  • 一種基于實時車流密度信息的VANET路由協(xié)議

    在車載自組網中，路由協(xié)議很大程度上決定了整個網絡的性能。如何有效的利用車流信息提高傳輸質量是改善路由性能的一個關鍵問題。本文基于速度-密度線性模型，提出了一種實時車流密度的路由協(xié)議RVDR（Real-time Vehicle Density Routing）。該協(xié)議通過與鄰居節(jié)點交換的速度信息，對相關道路車流密度進行預測，并給出基于車流密度信息的路徑選擇方法。仿真結果表明，與現(xiàn)有協(xié)議相比，RVDR協(xié)議在實時性和高效性等性能方面得到改進。

    標簽： VANET 密度 路由協(xié)議

    上傳時間： 2014-07-10

    上傳用戶：ZJX5201314

  • 基于多核處理器的彈載嵌入式系統(tǒng)設計研究

    基于實現(xiàn)目標探測識別以及高精度目標信息測量等復雜處理算法的目的，采用單片多核DSP TMS320C6678構成彈載高速多任務實時嵌入式處理平臺，通過數(shù)據(jù)流處理模式的并行軟件設計方法，將系統(tǒng)處理任務均衡分配到各處理器內核，以實現(xiàn)實時并行處理，提升彈載信息處理系統(tǒng)的功能和性能。開展基于多核處理器的并行軟件研制、充分發(fā)揮多核處理能力將成為彈載嵌入式系統(tǒng)軟件設計的新課題。

    標簽： 多核處理器 嵌入式系統(tǒng)設計

    上傳時間： 2013-11-23

    上傳用戶：璇珠官人

  • 基于NiosII多核智能交通車載終端的設計

    利用NiosII多核處理器，提出了基于Internet的實時路況查詢系統(tǒng)和智能車載終端。通過配置雙NiosII軟核，改善了MCU處理速度不高、外設資源有限、接口配置繁瑣、硬件設計和軟件設計編程復雜等問題，將大量控制以及對多種外設訪問的工作進行了合理分配。既具有普通導航設備的方便實用性，又能通過無線通訊及Internet與后臺服務器連接，獲取道路擁堵情況、停車場車位情況等動態(tài)實時信息，同時可作為智能交通的車載前端。

    標簽： NiosII 多核 智能交通 車載終端

    上傳時間： 2014-12-30

    上傳用戶：superman111

  • 基于FPGA的16位數(shù)據(jù)路徑的AESIP核

    基于FPGA的16位數(shù)據(jù)路徑的AESIP核

    標簽： AESIP FPGA 數(shù)據(jù)路徑

    上傳時間： 2013-11-12

    上傳用戶：zhangjinzj

  • Multicore Expert 系列： Multicore 2.0，來自飛思卡爾的下一代多核軟件

    本次會議，我們將討論加入下一代多核軟件開發(fā)包(SDK)的多個創(chuàng)新技術，包括簡潔、高可用API集的新基礎庫(FLIB)；重構的Netcomm軟件庫；支持SEC IP模塊以實現(xiàn)安全功能的新使能工具；具有參考應用的用戶空間DPAA (USDPAA)；新型虛擬化技術，包括現(xiàn)有Topaz+基于Kernel的虛擬機(KVM) ，用以優(yōu)化用戶空間的嵌入式容器支持；及非對稱多處理框架等。 本會是Multicore Expert系列的一部分，機會不容錯過。

    標簽： Multicore Expert 2.0 飛思卡爾

    上傳時間： 2013-11-02

    上傳用戶：wojiaohs

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