實(shí)現(xiàn)了三種乘法器，可以進(jìn)行性能比較，比較有較之
標(biāo)簽： 乘法器
上傳時(shí)間： 2017-06-25
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Galois域乘法器的Verilog源碼 廣泛用于信道編碼、計(jì)算機(jī)代數(shù)及橢圓曲線加密等
標(biāo)簽： Verilog Galois 乘法器 源碼
上傳時(shí)間： 2017-06-28
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VHDL 乘法器 源代碼，很好的VHDL 入門學(xué)習(xí)例程序
標(biāo)簽： VHDL 乘法器 源代碼
上傳時(shí)間： 2017-07-04
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用vhdl語(yǔ)言實(shí)現(xiàn)4位乘法器，已被測(cè)試過(guò)，可參考使用
標(biāo)簽： vhdl 語(yǔ)言 乘法器
上傳時(shí)間： 2017-07-09
上傳用戶：洛木卓
基于verilog的booth算法的乘法器
標(biāo)簽： verilog booth 算法 乘法器
上傳時(shí)間： 2017-07-15
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采用加法樹(shù)流水線乘法構(gòu)造八位乘法器，并分析設(shè)計(jì)的性能和結(jié)果在時(shí)鐘節(jié)拍上落后的影響因素。
標(biāo)簽： 加法 乘法 乘法器 樹(shù)
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RFID模擬TAG跟READER之間通訊的程式 用來(lái)模擬防碰撞機(jī)制DFS跟QTA兩種演算法 為於研判RFID TAG-COLLISION問(wèn)題的人應(yīng)該有些幫助
標(biāo)簽： RFID TAG-COLLISION READER DFS
上傳時(shí)間： 2013-12-31
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用VHDL語(yǔ)言仿真乘法器設(shè)計(jì)。能夠?qū)崿F(xiàn)一般乘法運(yùn)算。
標(biāo)簽： VHDL 語(yǔ)言 仿真 乘法器設(shè)計(jì)
上傳時(shí)間： 2017-07-18
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用VHDL語(yǔ)言描述的幾個(gè)乘法器實(shí)例，如串行陣列乘法器等
標(biāo)簽： VHDL 語(yǔ)言 乘法器
上傳時(shí)間： 2017-07-21
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VHDL語(yǔ)言編寫(xiě)8位乘法器非常實(shí)用語(yǔ)言絕對(duì)正確經(jīng)過(guò)仿真的
標(biāo)簽： VHDL 語(yǔ)言 8位 編寫(xiě)
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