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機(jī)器人<b>控制</b>

  • 基于DSP的新型PWM大功率感應加熱電源的研究.rar

    本文從感應加熱基本原理出發,概述了感應加熱技術的現狀及發展趨勢,在分析串聯諧振逆變器各種功率控制策略原理及優缺點的基礎上,對于移相調功輕載時的缺陷,本文將有限雙極性PWM法引入逆變器輕載時的輸出控制,通過DPLL鎖相,使滯后橋臂的電壓與電流始終保持一定的相位,同時結合非輕載時移相功率調節良好的特性,提出了一種基于DSP的新型功率控制策略,克服了傳統移相全橋的缺點,使得高頻逆變電源在輕載條件下仍能實現軟開關,且輕載時電流連續調節范圍廣,三角畸變程度輕于PSPWM,大幅度的擴大了負載的適用范圍,提高了電源整機效率。 在對新型PWM功率控制串聯諧振逆變器工作過程進行分析的基礎上,解決了所有開關管的軟開關問題;并通過分析功率輸出單元的輸出電壓、電流、功率等,進而得到一個脈沖周期的輸出電壓、電流及功率的計算式。在這些理論分析的基礎上,本文設計了基于新型PWM功率控制策略的感應加熱電源實驗系統,對主電路各元器件進行了精確計算與設計,設計了以TMS320LF2407A為核心的控制與保護電路,并對DSP外圍電路進行設計,同時編寫了基于新型PWM功率控制策略,以數字環相環及功率控制算法為核心的DSP程序,相關的仿真與實驗系統得到的輸出波形很好的驗證了新型PWM控制策略的可行性。

    標簽: DSP PWM 大功率

    上傳時間: 2013-04-24

    上傳用戶:gokk

  • 基于DSP的光伏并網發電系統研究.rar

    隨著能源消耗的不斷增長和生態環境的日益惡化,世界各國都在積極尋找一種可持續發展且無污染的新能源。太陽能作為一種高效無污染的新能源,尤其受到人類的重視。近年來,許多國家都非常重視發展太陽能光伏發電系統,光伏并網發電技術已成為太陽能光伏應用的主流。本文對光伏并網發電系統進行了詳細介紹,并對其控制方法進行了研究。太陽能光伏并網發電系統的兩大核心部分是太陽能電池板的最大功率點跟蹤(MPPT)控制和光伏并網逆變控制。首先,本文對太陽能電池的工作原理及工作特性進行介紹,詳細分析太陽能電池工作的等效電路和數學模型。其次,本文對幾種傳統的最大功率點跟蹤(MPPT)控制算法進行了研究、分析和比較,提出各自優缺點。基于最大功率跟蹤過程的快速性和穩定性,設計采用逐步逼近法實現光伏發電系統中太陽能電池的最大功率輸出,以提高系統的性能和最大功率點跟蹤速度。再次,基于光伏并網逆變器的控制目標,研究了光伏并網逆變器的常用控制方法,參考國內外資料,選擇重復-PI控制作為光伏并網逆變器的控制策略。最后,基于TMS320LF2407高速數字信號處理器,設計光伏并網發電系統,給出系統的硬件參數和軟件流程圖,并針對實驗和仿真波形進行分析。

    標簽: DSP 光伏并網發電 系統研究

    上傳時間: 2013-06-06

    上傳用戶:lo25643

  • 基于DSP在線式UPS的研究.rar

    不間斷電源(UPS)是一種能提供優質電源并保證電源供應連續的電力電子裝置。它的應用范圍廣泛,在很多領域,UPS已經成了標準配置。采用數字信號處理器(DSP)實現UPS的數字化控制是當前許多UPS設計者關注的問題。DSP在UPS中的應用主要集中在兩個方面:一是將各種先進的控制方法用于逆變實時數字控制;二是利用DSP實現更準確更迅速的鎖相環控制。 本文分析了當前逆變控制的各種方案,針對逆變的擾動及諧波周期出現的特點,采用了重復控制來提高逆變輸出的穩態特性。因為重復控制具有一個周期延遲控制的特點,本文也采用了PID控制來改善逆變控制的動態性能。本文分析了目前重復控制的常用方案,在建立UPS逆變濾波電路數學模型的基礎上設計了新的重復控制和PID控制結合的方案。對重復控制與PID復合控制方案在MATLAB中作了仿真。仿真試驗證明了控制方案的有效性。 在硬件方面,設計了在線式UPS系統中DSP的接口電路,其中包括DSP供電電路,蓄電池電壓過低檢測電路,市電及輸出電壓過零檢測等電路。對DSP的資源進行了分配,充分利用了DSP的外設多和速度快的特點。 在軟件方面,設計了各部分的程序,其中包括主程序,軟件鎖相及正弦參考信號生成程序,輸出有效值控制程序以及各種相關的中斷及保護程序。 本文結合實際,搭建了實驗線路,給出了實驗線路的原理及各部分的實驗電路。該實驗電路可對逆變控制過程和鎖相環節進行控制實驗。 本文將PID控制與重復控制相結合,對逆變器輸出進行控制,驗證了重復控制與PID復合控制的有效性。本文還對UPS的DSP數字化控制作了研究,這些都對UPS技術的進步有積極的作用。

    標簽: DSP UPS

    上傳時間: 2013-05-17

    上傳用戶:t1213121

  • 基于FPGA的ADC并行測試方法研究.rar

    高性能ADC產品的出現,給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化,減少了單個ADC的平均測試時間,從而降低ADC測試成本。 本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上,總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法,并對2個ADC在不同樣本數條件下進行并行測試。 通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統,完成音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent 33220A任意信號發生器提供模擬激勵信號,共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道,并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊,并行地實現了ADC參數的評估算法。 在樣本數分別為128和4096的實驗條件下,對WM8731L片內2個被測.ADC并行地進行參數評估,被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明,通過在FPGA內配置2個獨立的參數計算模塊,可并行地實現對2個相同ADC的參數評估,減小單個ADC的平均測試時間。 FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制,就可實現多個被測ADC在同一時刻并行地被評估,配置靈活。基于FPGA的ADC并行測試方法易于實現,具有可行性,但由于噪聲的影響,測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。 關鍵詞:ADC測試;并行;參數評估;FPGA;FFT

    標簽: FPGA ADC 并行測試

    上傳時間: 2013-07-11

    上傳用戶:tdyoung

  • 基于FPGA的圖像處理平臺及3D加速引擎的設計.rar

    3D加速引擎是3D圖形加速系統的重要組成部分,以往在軟件平臺上對3D引擎的研究,實現了復雜的渲染模型和渲染算法,但這些復雜算法與模型在FPGA上綜合實現具有一定難度,針對FPGA的3D加速引擎設計及其平臺實現需要進一步研究。 本文在研究3D加速引擎結構的基礎上,實現了基于FPGA的圖像處理平臺,使用模塊化的思想,利用IP核技術分析設計實現了3D加速管道及其他模塊,并進行了仿真、驗證、實現。 圖像處理平臺選用Virtex-Ⅳ FPGA為核心器件,并搭載了Hynix HY5DU573222F-25、AT91FR40162S、XCF32P VO48及其他組件。 為滿足3D加速引擎的實現與驗證,設計搭建的圖像處理平臺還實現了DDR-SDRAM控制器模塊、VGA輸出模塊、總線控制器模塊、命令解釋模塊、指令寄存器模塊及控制寄存器模塊。 3D加速引擎設計包含3D加速渲染管道、視角變換管道、基元讀取、頂點FIFO、基元FIFO、寫內存等模塊。針對FPGA的特性,簡化、設計、實現了光照管道、紋理管道、著色管道和Alpha融合管道。 最后使用Modelsim進行了仿真測試和圖像處理平臺上的驗證,其結果表明3D加速引擎設計的大部分功能得到實現,結果令人滿意。

    標簽: FPGA 3D加速 圖像

    上傳時間: 2013-07-30

    上傳用戶:lepoke

  • 基于FPGA的計算機組成原理實驗系統的設計與仿真.rar

    “計算機組成原理”是計算機專業的一門核心課程。傳統的計算機組成原理實驗是在指令格式、尋址方式、運算器、控制器、存儲器等都相對固定的情況下進行,學生主要進行功能實現和驗證,缺少自主設計和創新過程。 為改變這種狀況,須更新現有的計算機組成原理實驗系統。采用FPGA芯片作為載體,使用EDA開發工具,用硬件描述語言實現不同的硬件邏輯,再與硬件的輸入輸出接口線路相連,最終組成一臺可用于組成實驗教學的完整計算機系統。這期間學生將掌握組成原理實驗系統的各個部件的功能及其相互之間如何協作。本實驗系統能夠讓學生完成有關計算機組成原理的部件實驗和整機實驗:部件實驗包括加法器、乘法器、除法器、算術邏輯運算單元、控制器、存儲器等;整機實驗可以獨立實現各部件的功能描述。該系統能夠幫助學生鞏固課堂知識并增強設計能力。 為實現上述目的,依據EDA技術的開發流程和方法,建立了一個完整的體系,其中包括控制模塊、內存模塊、運算器模塊、通用寄存器組及其控制部件、程序計數器、地址寄存器、指令寄存器、時序部件、數據控制部件、狀態值控制部件,以及為幫學生調試而專門設計的輸出觀察部件。在Quartus Ⅱ開發環境下,使用Altera公司FPGA芯片,采用VHDL,語言設計并實現了上述模塊。經過仿真測試,所實現的各功能模塊作為獨立部件時能完成各自功能:而將這些部件組合起來的整機系統,可以執行程序段和進行各種運算處理,達到了設計要求。

    標簽: FPGA 計算機組成原理 實驗系統

    上傳時間: 2013-06-01

    上傳用戶:hebmuljb

  • 風光互補發電系統設計與實現

    本文對風光互補發電系統進行了設計,系統采用交流母線結構,可以隨意擴容,方便其它設備接入。論文主要對風光互補發電系統結構組成、控制器、逆變器、并網控制等進行了設計和研究分析。

    標簽: 風光互補發電 系統設計

    上傳時間: 2013-07-17

    上傳用戶:stewart·

  • 基于ARM的開關磁阻電機驅動系統設計

    開關磁阻電機是電機技術與現代電力電子技術、微機控制技術相結合的產物,既具有結構簡單堅固、成本低、容錯能力強,耐高溫等優點,又在高度發展的電力電子和微機控制技術的支持下獲得了良好的可控性能,目前己經在多個工業部門得到應用。因此,開關磁阻電機在驅動調速領域有著良好的發展前景。本論文在對前人成果的廣泛了解和研究基礎上,以philip公司生產的LPC2101為主控芯片,充分利用其高速運算能力和面向電機控制的高效控制能力,設計并制作了SRM控制器與系統軟件。本文以開關磁阻電機的調速控制策略及其控制實現方法為主要研究內容,對開關磁阻電機的數學模型、功率變換器技術、控制策略、控制方案的實現進行了全面深入的研究。 全文的研究工作分為五個部分,第一部分介紹了開關磁阻電機調速系統的構成及基本工作原理,綜述了開關磁阻電機的國內外發展現狀、特點及研究動向,總結了開關磁阻電機系統存在的技術問題,提出了本文的研究目的和主要研究內容。 第二部分引用并討論了SR電動機的基本數學模型和準線性數學模型,然后基于此重點分析了與電動機運行特性密切相關的相電流波形與轉子角位移的函數關系,最后根據課題所關心的控制系統設計,在理論分析的基礎上提出了SR電動機控制方案并進行了原理性分析,對SR電動機各個運行階段的特點進行分析并初步提出控制方案。 第三部分對SR電動機調速系統的硬件設計進行了詳細說明,主要包括以LPC2101為核心的控制系統的研究與設計,根據SR電機的控制特點,盡可能地開發了LPC2101的硬件資源和軟件資源,使控制系統具有很高的控制精度和靈活性,然后對功率變換器進行了設計和制作,分析了各種主電路形式的優缺點,采用了新型IGBT功率管作為主開關元器件,使功率變換器結構得到簡化,設計了IGBT的功率驅動電路,并專門設計了電壓鉗位電路和諸如過壓、過流保護等保護單元,保證了整個系統安全可靠地運行,然后分析了SR電動機控制系統位置傳感器檢測電路設計、電流及電壓斬波電路設計、電流檢測及保護電路設計等。 第四部分主要介紹了系統的總體控制思想,分析了各個運行階段的控制策略,對控制策略的軟件實現進行了設計,并給出了軟件實現的具體流程圖,直觀地體現了軟件編程思想。最后,對系統進行了實驗研究及分析。目前,該控制系統已調試完畢,基本實現預期功能。 本文對以ARM為控制核心的開關磁阻電動機控制系統進行了研究,得出了基于有位置傳感器檢測的控制方案。針對SR電機的控制特點,充分利用了ARM的硬件資源,采用PID數字調節,發出相通斷信號和PWM信號,并和電流、電壓等保護信號相結合,實現對主功率元件的通斷控制。并且設計了相應的外圍硬件檢測、保護、控制及人機接口電路,使控制系統結構緊湊,可靠性高;系統的控制軟件設計,采用模塊化的程序設計方法,增強了系統的可讀性及可維護性,實現了一種電壓斬波和電流斬波控制相結合的控制方式;結合系統的硬件設計,開發了相應的軟件模塊,使系統具有完善的保護和控制性能。 本系統經過試驗,調速范圍可達100~2000轉/分,效率較高,性能優良,驗證了控制思想和控制方法的正確性。

    標簽: ARM 開關磁阻 電機驅動 系統設計

    上傳時間: 2013-04-24

    上傳用戶:獨孤求源

  • FPGA用于160Gbs高速光纖通信系統中PMD補償的研究

    偏振模色散(PMD)是限制光通信系統向高速率和大容量擴展的主要障礙,尤其是160Gb/s光傳輸系統中,由PMD引起的脈沖畸變現象更加嚴重。為了克服PMD帶來的危害,國內外已經開始了對PMD補償的研究。但是目前的補償系統復雜、成本高且補償效果不理想,因此采用前向糾錯(FEC)和偏振擾偏器配合抑制PMD的方法,可以實現低成本的PMD補償。 在實驗中將擾偏器連入光時分復用系統,通過觀察其工作前后的脈沖波形,發現擾偏器的應用改善了系統的性能。隨著系統速率的提高,對擾偏器速率的要求也隨之提高,目前市場上擾偏器的速率無法滿足160Gb/s光傳輸系統要求。通過對偏振擾偏器原理的分析,決定采用高速控制電路驅動偏振控制器的方法來實現高速擾偏器的設計。擾偏器采用鈮酸鋰偏振控制器,其響應時間小于100ns,是目前偏振控制器能夠達到的最高速率,但是將其用于160Gb/s高速光通信系統擾偏時,這個速率仍然偏低,因此,提出采用多段鈮酸鋰晶體并行擾偏的方法,彌補鈮酸鋰偏振控制器速率低的問題。通過對幾種處理器的分析和比較,選擇DSP+FPGA作為控制端,DSP芯片用于產生隨機數據,FPGA芯片具有豐富的I/O引腳,工作頻率高,可以實現大量數據的快速并行輸出。這樣的方案可以充分發揮DSP和FPGA各自的優勢。另外對數模轉換芯片也要求響應速度快,本論文以FPGA為核心,完成了FPGA與其它芯片的接口電路設計。在QuartusⅡ集成環境中進行FPGA的開發,使用VHDL語言和原理圖輸入法進行電路設計。 本文設計的偏振擾偏器在高速控制電路的驅動下,可以實現大量的數據處理,采用多段鈮酸鋰晶體并行工作的方法,可以提高偏振擾偏器的速率。利用本方案制作的擾偏器具有高擾偏速率,適合應用于160Gb/s光通信系統中進行PMD補償。

    標簽: FPGA 160 Gbs PMD

    上傳時間: 2013-04-24

    上傳用戶:suxuan110425

  • 基于FPGA和PCI總線的WCDMA信號采集卡的研制

      本論文利用FPGA可編程邏輯器件和硬件描述語言Verilog,采用自頂向下的設計方法,開發了一款基于PCI總線的高速數據采集卡。本數據采集系統中,采用PLX公司生產的PLX9080作為PCI總線接口芯片。用4片每片容量為8MB的SDRAM作為數據采集的前端和PCI總線的數據緩沖。用ALTERA公司生產的Cyclone系列FPGA實現PCI接口芯片PLX9080的時序邏輯、對數據采集通道的前端控制以及對SDRAM的讀寫控制。  在本論文將重點放在了用硬件描述語言Verilog進行FPGA硬件邏輯編程上。本論文按照自頂向下的設計方法,詳細論述了PCI接口轉化電路模塊、SDRAM存儲片子讀寫控制電路模塊、FPGA內部寄存器讀寫控制電路模塊以及用于RF端的自動增益控制電路AGC模塊的設計。  

    標簽: WCDMA FPGA PCI 總線

    上傳時間: 2013-04-24

    上傳用戶:yhm_all

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