全國(guó)大學(xué)生電子設(shè)計(jì)競(jìng)賽教程 基于TI器件設(shè)計(jì)方法 自己制作的pdf文件，謹(jǐn)此一家，別無(wú)分店
標(biāo)簽： 器件 設(shè)計(jì)方法
上傳時(shí)間： 2013-08-04
上傳用戶：sk5201314
ORCAD傳遞分立器件Value值到PowerPCB的方法
標(biāo)簽： PowerPCB ORCAD Value 分立器件
上傳時(shí)間： 2013-06-28
上傳用戶：ynsnjs
復(fù)雜可編程邏輯器件的初步介紹，通過(guò)一系列的簡(jiǎn)單例子，幫助讀者熟悉開(kāi)發(fā)環(huán)境和開(kāi)發(fā)語(yǔ)言。
標(biāo)簽： 可編程邏輯器件
上傳時(shí)間： 2013-08-06
上傳用戶：silenthink
用VHDL語(yǔ)言設(shè)計(jì)基于FPGA器件的高采樣率FIR濾波器,基于VHDL與CPLD器件的FIR數(shù)字濾波器的設(shè)計(jì)
標(biāo)簽： VHDL FPGA FIR 語(yǔ)言
上傳時(shí)間： 2013-08-07
上傳用戶：ukuk
CPLD初始化程序,用于DSP5416與SAA7111A的時(shí)序控制初始化.
標(biāo)簽： 7111A CPLD 5416 7111
上傳時(shí)間： 2013-08-08
上傳用戶：cc1915
基于CPLD／FPGA的可編程邏輯器件，借助單片機(jī)AT89C51；利用標(biāo)準(zhǔn)頻率50～100MHz的周期信號(hào)實(shí)現(xiàn)系統(tǒng)計(jì)數(shù)的等精度測(cè)量技術(shù)。同時(shí)采用閘門(mén)測(cè)量技術(shù)完成脈寬,占空比的測(cè)量。
標(biāo)簽： CPLD FPGA 可編程邏輯器件
上傳時(shí)間： 2013-08-09
上傳用戶：yd19890720
可編程邏輯器件是一種可以通過(guò)編程，改變系統(tǒng)連線，達(dá)到系統(tǒng)重構(gòu)的器件，該器件\\\\\\\\r\\\\\\\\n可以現(xiàn)場(chǎng)編程，就是說(shuō)當(dāng)該器件安裝到電路板上后，可以對(duì)它的功能進(jìn)行重新設(shè)置，這樣\\\\\\\\r\\\\\\\\n就可以非常方便的進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)與制作
標(biāo)簽： 可編程邏輯器件 編程
上傳時(shí)間： 2013-08-10
上傳用戶：stella2015
用 ＦＰＧＡ 可編程器件和 ＶＨＤＬ 硬件描述語(yǔ)言來(lái)實(shí)現(xiàn) Ｆｌａｓｈ 編程器
標(biāo)簽： Flash FPGA VHDL 可編程器件
上傳用戶：450976175
利用一塊芯片完成除時(shí)鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語(yǔ)言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短（設(shè)計(jì)過(guò)程中即可實(shí)現(xiàn)時(shí)序仿真）、調(diào)試方便、故障率低、修改升級(jí)容易等特點(diǎn)
標(biāo)簽： CPLD VHDL 數(shù)字邏輯 器件
上傳時(shí)間： 2013-08-11
上傳用戶：hn891122
設(shè)計(jì)了一種基于ＣＰＬＤ（復(fù)雜可編程邏輯器件）的低頻數(shù)字相位測(cè)量?jī)x
標(biāo)簽： 可編程邏輯器件 低頻 數(shù)字 相位測(cè)量?jī)x
上傳用戶：a155166
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