飛飛,自動(dòng)打怪源碼,僅做學(xué)習(xí)之用! 飛飛,自動(dòng)打怪源碼,僅做學(xué)習(xí)之用!
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上傳時(shí)間： 2017-05-27
上傳用戶(hù)：as275944189
使用一排列對(duì)象接受類(lèi)型int、浮點(diǎn)和串的實(shí)體類(lèi)型3 attibutes 展示對(duì)constructor的用途。
標(biāo)簽： constructor attibutes int 對(duì)象
上傳時(shí)間： 2014-03-07
上傳用戶(hù)：yimoney
32位元浮點(diǎn)數(shù)加法器,用于以VHDL編寫(xiě)的32位元CPU
標(biāo)簽： VHDL CPU 浮點(diǎn)數(shù) 加法器
上傳時(shí)間： 2014-12-19
上傳用戶(hù)：壞天使kk
32位元浮點(diǎn)CPU,用VHDL語(yǔ)言以類(lèi)似組合語(yǔ)言的方式寫(xiě)成
標(biāo)簽： VHDL CPU 語(yǔ)言 浮點(diǎn)
上傳時(shí)間： 2017-06-05
上傳用戶(hù)：lizhen9880
16位元浮點(diǎn)數(shù)CPU,可作運(yùn)算,以VHDL編寫(xiě)
標(biāo)簽： VHDL CPU 浮點(diǎn)數(shù) 運(yùn)算
上傳用戶(hù)：ryb
行動(dòng)通訊上的的編程 這本書(shū)集中在三個(gè)主要的挑戰(zhàn) 1.更高的編程效率 2.降低計(jì)算的複雜度 2.提升容錯(cuò)性
標(biāo)簽： 效率
上傳用戶(hù)：diets
利用verilog hdl編寫(xiě)的浮點(diǎn)加法器運(yùn)算單元，單精度。
標(biāo)簽： verilog hdl 編寫(xiě) 浮點(diǎn)
上傳時(shí)間： 2013-11-29
上傳用戶(hù)：王慶才
這是一個(gè)可以自動(dòng)尋找圖像中的長(zhǎng)方形, 正方形, 圓形, 菱形的程式
標(biāo)簽： 圖像 正 程式
上傳時(shí)間： 2017-06-13
上傳用戶(hù)：duoshen1989
基于FPGA的高性能32位浮點(diǎn)FFTIP核的開(kāi)發(fā)，適合fpga工程技術(shù)人員參考
標(biāo)簽： FFTIP FPGA 性能 浮點(diǎn)
上傳時(shí)間： 2014-12-05
上傳用戶(hù)：semi1981
97浮點(diǎn)小波反變換，反變換時(shí)坐標(biāo)的對(duì)準(zhǔn)是關(guān)鍵
標(biāo)簽： 浮點(diǎn) 變換
上傳時(shí)間： 2017-06-23
上傳用戶(hù)：lanwei
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