第一章 概述 1.1 AVR 單片機(jī)GCC 開(kāi)發(fā)概述 1.2 一個(gè)簡(jiǎn)單的例子 1.3 用MAKEFILE 管理項(xiàng)目 1.4 開(kāi)發(fā)環(huán)境的配置 1.5 實(shí)驗(yàn)板CA-M8 第二章 存儲(chǔ)器操作編程 2.1 AVR 單片機(jī)存儲(chǔ)器組織結(jié)構(gòu) 2.2 I/O 寄存器操作 2.3 SRAM 內(nèi)變量的使用 2.4 在程序中訪(fǎng)問(wèn)FLASH 程序存儲(chǔ)器 2.5 EEPROM 數(shù)據(jù)存儲(chǔ)器操作 2.6 avr-gcc 段結(jié)構(gòu)與再定位 2.7 外部RAM 存儲(chǔ)器操作 2.8 堆應(yīng)用 第三章 GCC C 編譯器的使用 3.1 編譯基礎(chǔ) 3.2 生成靜態(tài)連接庫(kù) 第四章 AVR 功能模塊應(yīng)用實(shí)驗(yàn) 4.1 中斷服務(wù)程序 4.2 定時(shí)器/計(jì)數(shù)器應(yīng)用 4.3 看門(mén)狗應(yīng)用 4.4 UART 應(yīng)用 4.5 PWM 功能編程 4.6 模擬比較器 4.7 A/D 轉(zhuǎn)換模塊編程 4.8 數(shù)碼管顯示程序設(shè)計(jì) 4.9 鍵盤(pán)程序設(shè)計(jì) 4.10 蜂鳴器控制 第五章 使用C 語(yǔ)言標(biāo)準(zhǔn)I/O 流調(diào)試程序 5.1 avr-libc 標(biāo)準(zhǔn)I/O 流描述 5.2 利用標(biāo)準(zhǔn)I/0 流調(diào)試程序 5.3 最小化的格式化的打印函數(shù) 第六章 CA-M8 上實(shí)現(xiàn)AT89S52 編程器的實(shí)現(xiàn) 6.1 編程原理 6.2 LuckyProg2004 概述 6.3 AT989S52 isp 功能簡(jiǎn)介 6.4 下位機(jī)程序設(shè)計(jì) 第七章 硬件TWI 端口編程 7.1 TWI 模塊概述 7.2 主控模式操作實(shí)時(shí)時(shí)鐘DS1307 7.3 兩個(gè)Mega8 間的TWI 通信 第八章 BootLoader 功能應(yīng)用 8.1 BootLoader 功能介紹 8.2 avr-libc 對(duì)BootLoader 的支持 8.3 BootLoader 應(yīng)用實(shí)例 8.4 基于LuckyProg2004 的BootLoader 程序 第九章 匯編語(yǔ)言支持 9.1 C 代碼中內(nèi)聯(lián)匯編程序 9.2 獨(dú)立的匯編語(yǔ)言支持 9.3 C 與匯編混合編程 第十章 C++語(yǔ)言支持
標(biāo)簽： AVR GCC 單片機(jī) 程序設(shè)計(jì)
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高性能ADC產(chǎn)品的出現(xiàn)，給混合信號(hào)測(cè)試領(lǐng)域帶來(lái)前所未有的挑戰(zhàn)。并行ADC測(cè)試方案實(shí)現(xiàn)了多個(gè)ADC測(cè)試過(guò)程的并行化和實(shí)時(shí)化，減少了單個(gè)ADC的平均測(cè)試時(shí)間，從而降低ADC測(cè)試成本。本文實(shí)現(xiàn)了基于FPGA的ADC并行測(cè)試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上，總結(jié)了常用ADC參數(shù)測(cè)試方法和測(cè)試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評(píng)估算法和頻域參數(shù)評(píng)估算法，并對(duì)2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測(cè)試。 本研究通過(guò)在FPGA內(nèi)部實(shí)現(xiàn)ADC測(cè)試時(shí)域算法和頻域算法相結(jié)合的方法來(lái)搭建測(cè)試系統(tǒng)，完成了音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測(cè)試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測(cè)試系統(tǒng)使用Angilent33220A任意信號(hào)發(fā)生器提供模擬激勵(lì)信號(hào)，共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測(cè)試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道，并對(duì)其進(jìn)行串并轉(zhuǎn)換。然后對(duì)左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊，并行地實(shí)現(xiàn)了ADC參數(shù)的評(píng)估算法。在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下，對(duì)WM8731L片內(nèi)2個(gè)被測(cè).ADC并行地進(jìn)行參數(shù)評(píng)估，被測(cè)參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號(hào)與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明，通過(guò)在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊，可并行地實(shí)現(xiàn)對(duì)2個(gè)相同ADC的參數(shù)評(píng)估，減小單個(gè)ADC的平均測(cè)試時(shí)間。FPGA片內(nèi)實(shí)時(shí)評(píng)估算法的實(shí)現(xiàn)節(jié)省了測(cè)試樣本傳輸至自動(dòng)測(cè)試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制，就可實(shí)現(xiàn)多個(gè)被測(cè)ADC在同一時(shí)刻并行地被評(píng)估，配置靈活?；贔PGA的ADC并行測(cè)試方法易于實(shí)現(xiàn)，具有可行性，但由于噪聲的影響，測(cè)試精度有待進(jìn)一步提高。該方法可用于自動(dòng)測(cè)試機(jī)的混合信號(hào)選項(xiàng)卡或測(cè)試子系統(tǒng)。
標(biāo)簽： FPGA ADC 并行測(cè)試 方法研究
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廣嵌開(kāi)發(fā)板配套的教程。 實(shí)驗(yàn)1 ARM 匯編指令編程實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 1 實(shí)驗(yàn)2 C 和ARM 匯編混合編程實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 8 實(shí)驗(yàn)3 C 語(yǔ)言實(shí)現(xiàn)LED 控制實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 15 實(shí)驗(yàn)4 外部中斷應(yīng)用實(shí)驗(yàn) ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 22 實(shí)驗(yàn)5 看門(mén)狗定時(shí)器應(yīng)用實(shí)驗(yàn) ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 32 實(shí)驗(yàn)6 DMA 控制器實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 38 實(shí)驗(yàn)7 PWM 控制蜂鳴器實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 48 實(shí)驗(yàn)8 UART 通信實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 57 實(shí)驗(yàn)9 紅外模塊控制實(shí)驗(yàn) ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 68 實(shí)驗(yàn)10 實(shí)時(shí)時(shí)鐘設(shè)計(jì)實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 79 實(shí)驗(yàn)11 IIC 總線(xiàn)應(yīng)用實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 90 實(shí)驗(yàn)12 Nor flash 應(yīng)用實(shí)驗(yàn) ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 103 實(shí)驗(yàn)13 Nand flash 應(yīng)用實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 114 實(shí)驗(yàn)14 TFT LCD 顯示實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 138 實(shí)驗(yàn)15 觸摸屏控制實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 153 實(shí)驗(yàn)16 ADC 應(yīng)用實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 167 實(shí)驗(yàn)17 IIS 音頻總線(xiàn)實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 178 實(shí)驗(yàn)18 USB 設(shè)備實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 188 實(shí)驗(yàn)19 SD 卡接口實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 215 實(shí)驗(yàn)20 TFTP 以太網(wǎng)通訊 ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 228 實(shí)驗(yàn)21 Camera 應(yīng)用實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 239 實(shí)驗(yàn)22 BootLoader 實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 250 實(shí)驗(yàn)23 Linux-2.6 內(nèi)核移植實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 261 實(shí)驗(yàn)24 Linux 驅(qū)動(dòng)程序開(kāi)發(fā)實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 270 實(shí)驗(yàn)25 QT/Embedded 實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 280 實(shí)驗(yàn)26 WinCE5.0 開(kāi)發(fā)實(shí)驗(yàn)． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 294 附錄一 S3C2440A 啟動(dòng)代碼． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 314 附錄二 GEC2440 核心板電路圖． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 327 附錄三 GEC2440 主板電路圖． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． ． 335
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上傳用戶(hù)：jing911003
隨著經(jīng)濟(jì)的發(fā)展，科學(xué)技術(shù)的進(jìn)步，永磁電機(jī)的研發(fā)和控制技術(shù)都有了快速的發(fā)展。永磁電機(jī)的發(fā)展也帶來(lái)了永磁電機(jī)控制器的發(fā)展，電機(jī)控制器已經(jīng)由傳統(tǒng)的模擬元件控制器，逐漸轉(zhuǎn)向數(shù)?；旌峡刂破鳌⑷珨?shù)字控制器。基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA——Field Programmable Gate Array)的新一代數(shù)字電機(jī)控制技術(shù)得到越來(lái)越多的關(guān)注?，F(xiàn)在的FPGA不僅實(shí)現(xiàn)了軟件需求和硬件設(shè)計(jì)的完美集合，還實(shí)現(xiàn)了高速與靈活性的完美結(jié)合，使其已超越了ASIC器件的性能和規(guī)模。在工業(yè)控制領(lǐng)域，F(xiàn)PGA雖然起步較晚，但是發(fā)展勢(shì)頭迅猛。 本文在介紹了傳統(tǒng)無(wú)刷直流電機(jī)控制技術(shù)的基礎(chǔ)上，分析了采用FPGA實(shí)現(xiàn)電機(jī)控制的優(yōu)點(diǎn)。詳細(xì)介紹了使用硬件編程語(yǔ)言，在FPGA中編程實(shí)現(xiàn)永磁無(wú)刷直流電機(jī)速度閉環(huán)控制的各個(gè)關(guān)鍵環(huán)節(jié)，如：PI調(diào)節(jié)器、數(shù)字PWM等等。在實(shí)現(xiàn)永磁無(wú)刷直流電機(jī)速度閉環(huán)控制的同時(shí)，將速度檢測(cè)環(huán)節(jié)采用FPGA實(shí)現(xiàn)，減小了系統(tǒng)硬件開(kāi)銷(xiāo)。在實(shí)現(xiàn)單臺(tái)永磁無(wú)刷直流電機(jī)速度閉環(huán)控制的基礎(chǔ)上，本文在一片F(xiàn)PGA芯片上實(shí)現(xiàn)了多臺(tái)永磁無(wú)刷直流電機(jī)的速度閉環(huán)獨(dú)立控制系統(tǒng)。介紹了采用FPGA進(jìn)行多臺(tái)電機(jī)控制具有獨(dú)特的優(yōu)勢(shì)，這些優(yōu)勢(shì)使得FPGA在實(shí)現(xiàn)多臺(tái)電機(jī)控制時(shí)非常方便，具有單片機(jī)(MCU)和數(shù)字信號(hào)處理器(DSP)無(wú)法比擬的優(yōu)點(diǎn)。文中對(duì)基于FPGA的單臺(tái)和多臺(tái)永磁無(wú)刷直流電機(jī)控制系統(tǒng)分別進(jìn)行了實(shí)驗(yàn)驗(yàn)證。 FPGA編程靈活，設(shè)計(jì)方便，本文在FPGA中實(shí)現(xiàn)了各種不同的PWM調(diào)制方式。從電路方面詳細(xì)分析了采用不同的PWM調(diào)制，換相時(shí)無(wú)刷直流電機(jī)母線(xiàn)的反向電流問(wèn)題。借助FPGA平臺(tái)，對(duì)各種PWM調(diào)制方式進(jìn)行了實(shí)驗(yàn)，對(duì)理論分析進(jìn)行了驗(yàn)證。 另外，本文介紹了目前非常流行的一種FPGA圖形化設(shè)計(jì)方法，即基于XSG(Xilinx System Generator)的FPGA設(shè)計(jì)。這種設(shè)計(jì)方法具有圖形化、模塊化的優(yōu)點(diǎn)，大大方便了用戶(hù)的FPGA開(kāi)發(fā)設(shè)計(jì)。在XSG中建立的仿真系統(tǒng)，區(qū)別于傳統(tǒng)的Simulink仿真，可以直接生成相應(yīng)的硬件編程語(yǔ)言代碼下載到FPGA中運(yùn)行。本文借助XSG軟件設(shè)計(jì)在XSG/Simulink中實(shí)現(xiàn)了永磁同步電機(jī)矢量控制系統(tǒng)的混合建模算法，并進(jìn)行了仿真。
標(biāo)簽： FPGA 永磁電機(jī) 控制系統(tǒng)
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·詳細(xì)說(shuō)明：PSpice一本很好的教程。Pspice仿真器是一個(gè)全功能的模擬和混合信號(hào)仿真器,它支持從高頻系統(tǒng)到低功耗IC設(shè)計(jì)的任何電路
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上傳用戶(hù)：waizhang
·詳細(xì)說(shuō)明：VTK入門(mén)樣例，種類(lèi)齊全，包括醫(yī)學(xué)圖像顯示，點(diǎn)線(xiàn)平面類(lèi)、球類(lèi)、圓柱圓錐類(lèi)以及VTK和ＭＦＣ混合編程，適合初學(xué)者
標(biāo)簽： VTK
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PPT文檔，24頁(yè)，圖文結(jié)合 Modelsim仿真工具是Model公司開(kāi)發(fā)的。它支持Verilog、VHDL以及他們的混合仿真，它可以將整個(gè)程序分步執(zhí)行，使設(shè)計(jì)者直接看到他的程序下一步要執(zhí)行的語(yǔ)句，而且在程序執(zhí)行的任何步驟任何時(shí)刻都可以查看任意變量的當(dāng)前值，可以在Dataflow窗口查看某一單元或模塊的輸入輸出的連續(xù)變化等，比Quartus自帶的仿真器功能強(qiáng)大的多，是目前業(yè)界最通用的仿真器之一。 ModelSim分幾種不同的版本：SE、PE和OEM，其中 集成在 Actel、Atmel、Altera、Xilinx以及Lattice等FPGA廠(chǎng)商設(shè)計(jì)工具中的均是其OEM版本。比如為Altera提供的OEM版本是ModelSim-Altera,為Xilinx提供的版本為ModelSim XE. SE版本為最高級(jí)版本,在功能和性能方面比OEM版本強(qiáng)很多,比如仿真速度方面,還支持PC 、 UNIX 、 LIUNX混合平臺(tái).
上傳時(shí)間： 2013-05-25
上傳用戶(hù)：zhangzhenyu
以前，在使用單一能源設(shè)備滿(mǎn)足某一產(chǎn)品的用電規(guī)格時(shí)，要求設(shè)計(jì)人員或者針對(duì) 電力進(jìn)行設(shè)計(jì)（有時(shí)提供過(guò)量能源），或者針對(duì)能源進(jìn)行設(shè)計(jì)（有時(shí)提供不足量 的電力）。與其他能源儲(chǔ)存設(shè)備相比，超級(jí)電容，即人們熟知的電化學(xué)雙層電容， 具有獨(dú)一無(wú)二的功能。透過(guò)利用這些獨(dú)一無(wú)二的功能，可以更為靈活地設(shè)計(jì)供電 系統(tǒng)。 Maxwell公司的BOOSTCAP?超級(jí)電容可以使身系統(tǒng)設(shè)計(jì)人員開(kāi)發(fā)出比 非混合解決方案更節(jié)省成本然而性能卻更好的混合電源系統(tǒng)解決方案。
標(biāo)簽： 超級(jí)電容
上傳時(shí)間： 2013-06-09
上傳用戶(hù)：lksms
·【內(nèi)容簡(jiǎn)介】本書(shū)系統(tǒng)地?cái)⑹瞿M退火算法、遺傳算法、禁忌搜索、神經(jīng)網(wǎng)絡(luò)化算法、混沌 優(yōu)化、混合優(yōu)化策略等智能優(yōu)化算法的基本理論和實(shí)現(xiàn)技術(shù)以及最新進(jìn)展和應(yīng) 用，并從結(jié)構(gòu)上對(duì)算法進(jìn)行統(tǒng)一描述，著重強(qiáng)調(diào)混合策略的開(kāi)發(fā)與應(yīng)用.
標(biāo)簽： 優(yōu)化算法
上傳時(shí)間： 2013-05-24
上傳用戶(hù)：bcjtao
ADI實(shí)驗(yàn)室電路時(shí)經(jīng)過(guò)構(gòu)建和測(cè)試可以確保功能和性能的電路設(shè)計(jì) 借助ADI公司了眾多應(yīng)用專(zhuān)業(yè)技術(shù)，解決了多種常見(jiàn)的模擬、RF/IF和混合信號(hào)設(shè)計(jì)挑戰(zhàn)。 所以我覺(jué)得這個(gè)還是非常值得我們學(xué)習(xí)的，特此分享一下
標(biāo)簽： ADI 模塊 實(shí)驗(yàn)室電路 設(shè)計(jì)指南
上傳時(shí)間： 2013-06-20
上傳用戶(hù)：manlian
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