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無(wú)(wú)線數(shù)(shù)字

  • 數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語(yǔ)言描述

    數(shù)控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語(yǔ)言描述,集成在一個(gè)模塊中,提供VHDL源程序供大家學(xué)習(xí)和討論。\r\n

    標(biāo)簽: VHDL 寄存器 數(shù)控振蕩器 加法器

    上傳時(shí)間: 2013-09-04

    上傳用戶:a471778

  • pcb layout design(臺(tái)灣硬件工程師15年經(jīng)驗(yàn)

    PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計(jì)之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:?jiǎn)巍㈦p層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時(shí)所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號(hào)的 Power& GND plane 之間的分隔線13. Grid : 佈線時(shí)的走線格點(diǎn)2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用ICT 測(cè)試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個(gè)作為測(cè)試用之TEST PAD(測(cè)試點(diǎn)),其原則如下:1. 一般測(cè)試點(diǎn)大小均為30-35mil,元件分布較密時(shí),測(cè)試點(diǎn)最小可至30mil.測(cè)試點(diǎn)與元件PAD 的距離最小為40mil。2. 測(cè)試點(diǎn)與測(cè)試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時(shí)可使用50mil,3. 測(cè)試點(diǎn)必須均勻分佈於PCB 上,避免測(cè)試時(shí)造成板面受力不均。4. 多層板必須透過(guò)貫穿孔(VIA)將測(cè)試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測(cè)試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測(cè)率7. 測(cè)試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時(shí)間: 2013-10-22

    上傳用戶:pei5

  • IC封裝製程簡(jiǎn)介(IC封裝制程簡(jiǎn)介)

    半導(dǎo)體的產(chǎn)品很多,應(yīng)用的場(chǎng)合非常廣泛,圖一是常見(jiàn)的幾種半導(dǎo)體元件外型。半導(dǎo)體元件一般是以接腳形式或外型來(lái)劃分類(lèi)別,圖一中不同類(lèi)別的英文縮寫(xiě)名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導(dǎo)體元件的外型種類(lèi)很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導(dǎo)體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導(dǎo)體元件真正的的核心,是包覆在膠體或陶瓷內(nèi)一片非常小的晶片,透過(guò)伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內(nèi)部的晶片,圖三是以顯微鏡將內(nèi)部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請(qǐng)注意圖三中有一條銲線從中斷裂,那是使用不當(dāng)引發(fā)過(guò)電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見(jiàn)的LED,也就是發(fā)光二極體,其內(nèi)部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來(lái)做分別,晶片是貼附在負(fù)極的腳上,經(jīng)由銲線連接正極的腳。當(dāng)LED通過(guò)正向電流時(shí),晶片會(huì)發(fā)光而使LED發(fā)亮,如圖六所示。     半導(dǎo)體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產(chǎn)品,稱為IC封裝製程,又可細(xì)分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節(jié)中將簡(jiǎn)介這兩段的製造程序。

    標(biāo)簽: 封裝 IC封裝 制程

    上傳時(shí)間: 2014-01-20

    上傳用戶:蒼山觀海

  • 電路板維修相關(guān)技術(shù)資料

    電路板故障分析 維修方式介紹 ASA維修技術(shù) ICT維修技術(shù) 沒(méi)有線路圖,無(wú)從修起 電路板太複雜,維修困難 維修經(jīng)驗(yàn)及技術(shù)不足 無(wú)法維修的死板,廢棄可惜 送電中作動(dòng)態(tài)維修,危險(xiǎn)性極高 備份板太多,積壓資金 送國(guó)外維修費(fèi)用高,維修時(shí)間長(zhǎng) 對(duì)老化零件無(wú)從查起無(wú)法預(yù)先更換 維修速度及效率無(wú)法提升,造成公司負(fù)擔(dān),客戶埋怨 投資大量維修設(shè)備,操作複雜,績(jī)效不彰

    標(biāo)簽: 電路板維修 技術(shù)資料

    上傳時(shí)間: 2013-10-26

    上傳用戶:neu_liyan

  • 準(zhǔn)確的電源排序可防止系統(tǒng)受損

    諸如電信設(shè)備、存儲(chǔ)模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個(gè)電壓軌的數(shù)字 IC,這些電壓軌必須以一個(gè)特定的順序進(jìn)行啟動(dòng)和停機(jī)操作,否則 IC 就會(huì)遭到損壞。

    標(biāo)簽: 電源排序 防止

    上傳時(shí)間: 2014-12-24

    上傳用戶:packlj

  • 10A高性能負(fù)載點(diǎn)DCDC微型模塊

    電路板裝配、PCB 布局和數(shù)字 IC 集成的進(jìn)步造就了新一代的高密度安裝、高性能繫統(tǒng)。

    標(biāo)簽: DCDC 10A 性能 微型模塊

    上傳時(shí)間: 2013-10-17

    上傳用戶:RQB123

  • W波段反對(duì)稱漸變探針過(guò)渡轉(zhuǎn)換的設(shè)計(jì)

    介紹了一種反對(duì)稱漸變波導(dǎo)微帶探針過(guò)渡結(jié)構(gòu),采用高頻仿真軟件HFSS仿真分析了這個(gè)波導(dǎo)微帶過(guò)渡結(jié)構(gòu)在 W 頻段的特性,并對(duì)影響過(guò)渡性能的幾個(gè)因素進(jìn)行了敏感性分析,得出了可供工程應(yīng)用參考的設(shè)計(jì)曲線。在全波導(dǎo)帶寬內(nèi),實(shí)現(xiàn)了插入損耗小于0.088 dB,回波損耗大于27 dB。該結(jié)構(gòu)具有寬頻帶、結(jié)構(gòu)簡(jiǎn)單和易加工等優(yōu)點(diǎn),可廣泛用于毫米波固態(tài)電路系統(tǒng)中。

    標(biāo)簽: W波段 對(duì)稱 探針 轉(zhuǎn)換

    上傳時(shí)間: 2013-11-13

    上傳用戶:名爵少年

  • S8JX開(kāi)關(guān)電源(35/50/100/150-W型)

    符合全球標(biāo)準(zhǔn)的小巧電源•35~150 W容量支持5 V, 12 V和24 V輸出電壓(100 W, 150 W: 僅24 V型)• 支持DIN導(dǎo)軌安裝• 安全標(biāo)準(zhǔn)  :  UL 508/60950-1, EN 60950-1CSA C22.2 No. 60950-1

    標(biāo)簽: S8JX 100 150 35

    上傳時(shí)間: 2014-04-17

    上傳用戶:fklinran

  • HT45F23 ADC 功能應(yīng)用實(shí)例

    具備處理外部模擬信號(hào)功能是很多電子設(shè)備的基本要求。為了將模擬信號(hào)轉(zhuǎn)換為數(shù)字信 號(hào),就需要藉助A/D 轉(zhuǎn)換器。將A/D 功能和MCU 整合在一起,就可減少電路的元件數(shù)量和 電路板的空間使用。 HT45F23 微控制器內(nèi)建6 通道,12 位解析度的A/D 轉(zhuǎn)換器。在本應(yīng)用說(shuō)明中,將介紹如何 使用HT45F23 微控制器的A/D 功能。

    標(biāo)簽: 45F F23 ADC HT

    上傳時(shí)間: 2013-10-27

    上傳用戶:nostopper

  • 抽樣z變換頻率抽樣理論

    抽樣z變換頻率抽樣理論:我們將先闡明:(1)z變換與DFT的關(guān)系(抽樣z變換),在此基礎(chǔ)上引出抽樣z變換的概念,并進(jìn)一步深入討論頻域抽樣不失真條件。(2)頻域抽樣理論(頻域抽樣不失真條件)(3)頻域內(nèi)插公式一、z變換與DFT關(guān)系 (1)引入連續(xù)傅里葉變換引出離散傅里葉變換定義式。離散傅里葉變換看作是序列的傅里葉變換在 頻 域 再 抽 樣 后 的 變 換 對(duì).在Z變換與L變換中,又可了解到序列的傅里葉 變換就是單位圓上的Z 變 換.所以對(duì)序列的傅里葉變換進(jìn)行頻域抽樣時(shí), 自 然可以看作是對(duì)單位圓上的 Z變換進(jìn)行抽樣. (2)推導(dǎo)Z 變 換 的 定 義 式 (正 變 換) 重 寫(xiě) 如 下:  取z=ejw 代 入 定 義 式,  得 到 單 位 圓 上 Z 變 換 為w是 單 位 圓 上 各 點(diǎn) 的 數(shù) 字 角 頻 率.再 進(jìn) 行 抽 樣-- N 等 分.這 樣w=2kπ/N, 即w值為0,2π/N,4π/N,6π/N…, 考慮到x(n)是N點(diǎn)有限長(zhǎng)序列, 因而n只需0~N-1即可。將w=2kπ/N代入并改變上下限,  得 則這正是離散傅里葉變換 (DFT)正變換定義式.

    標(biāo)簽: 抽樣 變換 頻率

    上傳時(shí)間: 2014-12-28

    上傳用戶:zhaistone

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