步進(jìn)電機(jī)驅(qū)動(dòng)器選型表
標(biāo)簽： 步進(jìn)電機(jī) 驅(qū)動(dòng)器 選型
上傳時(shí)間： 2013-10-14
上傳用戶：蔣清華嗯
步進(jìn)電機(jī)驅(qū)動(dòng)器選型表
標(biāo)簽： 步進(jìn)電機(jī) 驅(qū)動(dòng)器 選型
上傳時(shí)間： 2013-11-19
上傳用戶：思琦琦
FPGA與ARM EPI通信，控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫(xiě)的，，，，，
上傳時(shí)間： 2013-10-31
上傳用戶：chaisz
NiosII軟核處理器是Altera公司開(kāi)發(fā)，基于FPGA操作平臺(tái)使用的一款高速處理器，為了適應(yīng)高速運(yùn)動(dòng)圖像采集，提出了一種基于NiosII軟核處理的步進(jìn)電機(jī)接口設(shè)計(jì)，使用verilog HDL語(yǔ)言完成該接口設(shè)計(jì)，最后通過(guò)QuartusII軟件，給出了實(shí)驗(yàn)仿真結(jié)果。
標(biāo)簽： NiosII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計(jì)
上傳時(shí)間： 2015-01-02
上傳用戶：妄想演繹師
PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: (1) ”P(pán)CB LAYOUT 基本規(guī)範(fàn)”:為R&D Layout時(shí)必須遵守的事項(xiàng), 否則SMT,DIP,裁板時(shí)無(wú)法生產(chǎn). (2) “錫偷LAYOUT RULE建議規(guī)範(fàn)”: 加適合的錫偷可降低短路及錫球. (3) “PCB LAYOUT 建議規(guī)範(fàn)”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout. (4) ”零件選用建議規(guī)範(fàn)”: Connector零件在未來(lái)應(yīng)用逐漸廣泛, 又是SMT生產(chǎn)時(shí)是偏移及置件不良的主因,故製造希望R&D及採(cǎi)購(gòu)在購(gòu)買異形零件時(shí)能顧慮製造的需求, 提高自動(dòng)置件的比例.
標(biāo)簽： LAYOUT PCB 設(shè)計(jì)規(guī)范
上傳時(shí)間： 2013-11-03
上傳用戶：tzl1975
文章詳細(xì)介紹了一種以Xilinx 公司生產(chǎn)的CPLD 器件XC9536 為核心來(lái)產(chǎn)生電機(jī)繞組參考電流, 進(jìn)而實(shí)現(xiàn)具有繞組電流補(bǔ)償功能的兩相混合式步進(jìn)電動(dòng)機(jī)10 細(xì)分和50 細(xì)分運(yùn)行方式的方法。實(shí)踐證明, 該方法可以有效地提高兩相混合式步進(jìn)電動(dòng)機(jī)系統(tǒng)的運(yùn)行效果。
標(biāo)簽： CPLD 器件 中的應(yīng)用 步進(jìn)電動(dòng)
上傳時(shí)間： 2013-11-16
上傳用戶：trepb001
教學(xué)提示：前章介紹的基本邏輯指令和梯形圖主要用于設(shè)計(jì)滿足一般控制要求的PLC程序。對(duì)于復(fù)雜控制系統(tǒng)來(lái)說(shuō)，系統(tǒng)輸入輸出點(diǎn)數(shù)較多，工藝復(fù)雜，每一工序的自鎖要求及工序與工序間的相互連鎖關(guān)系也復(fù)雜，直接采用邏輯指令和梯形圖進(jìn)行設(shè)計(jì)較為困難。在實(shí)際控制系統(tǒng)中，可將生產(chǎn)過(guò)程的控制要求以工序劃分成若干段，每一個(gè)工序完成一定的功能，在滿足轉(zhuǎn)移條件后，從當(dāng)前工序轉(zhuǎn)移到下道工序，這種控制通常稱為順序控制。為了方便地進(jìn)行順序控制設(shè)計(jì)，許多可編程控制器設(shè)置有專門(mén)用于順序控制或稱為步進(jìn)控制的指令，F(xiàn)X2N PLC在基本邏輯指令之外增加了兩條步進(jìn)指令，同時(shí)輔之以大量的狀態(tài)器S，結(jié)合狀態(tài)轉(zhuǎn)移圖就很容易編出復(fù)雜的順序控制程序 教學(xué)要求：本章要求學(xué)生熟練掌握FX2N的步進(jìn)指令和狀態(tài)轉(zhuǎn)移圖的功能、應(yīng)用范圍和使用方法。重點(diǎn)讓學(xué)生掌握步進(jìn)指令和狀態(tài)轉(zhuǎn)移圖編程的規(guī)則、步驟與編程方法，并能編寫(xiě)一些工程控制程序 第四章 狀態(tài)轉(zhuǎn)移圖及步進(jìn)指令 5.1 狀態(tài)轉(zhuǎn)移圖5.2 步進(jìn)梯形圖及步進(jìn)指令5.2.1 步進(jìn)梯形圖5.2.2 步進(jìn)指令5.3 步進(jìn)梯形圖指令編程基本方法5.4 狀態(tài)轉(zhuǎn)移圖常見(jiàn)流程狀態(tài)得編程5.4.1 單流程狀態(tài)編程5.4.2 跳轉(zhuǎn)與重復(fù)狀態(tài)編程5.4.3 選擇分支與匯合狀態(tài)編程5.4.4 并行分支與匯合狀態(tài)5.4.5 分支與匯合得組合5.5 狀態(tài)轉(zhuǎn)移圖及步進(jìn)指令的應(yīng)用實(shí)例
標(biāo)簽： 狀態(tài)轉(zhuǎn)移 步進(jìn) 指令
上傳時(shí)間： 2013-11-05
上傳用戶：釣鰲牧馬
基于GAL器件的步進(jìn)電機(jī)控制器的研究與設(shè)計(jì) 采用GAL控制脈沖分配的邏輯設(shè)計(jì) 若采用集成電路芯片來(lái)實(shí)現(xiàn)三相六拍步進(jìn)電機(jī)的 控制,所用器件較多! 電路一般比較復(fù)雜# 為了滿足電機(jī) 轉(zhuǎn)速的二分頻! 在同一時(shí)鐘頻率控制下! 必須利用一個(gè) 3 型觸發(fā)器! 通過(guò); 參與組合邏輯來(lái)實(shí)現(xiàn)# 其邏輯電路 如圖D 所示# ;H 為控制信號(hào)!
標(biāo)簽： GAL 器件 步進(jìn)電機(jī) 控制器
上傳時(shí)間： 2013-11-10
上傳用戶：非洲之星
半導(dǎo)體的產(chǎn)品很多，應(yīng)用的場(chǎng)合非常廣泛，圖一是常見(jiàn)的幾種半導(dǎo)體元件外型。半導(dǎo)體元件一般是以接腳形式或外型來(lái)劃分類別，圖一中不同類別的英文縮寫(xiě)名稱原文為 PDID：Plastic Dual Inline Package SOP：Small Outline Package SOJ：Small Outline J-Lead Package PLCC：Plastic Leaded Chip Carrier QFP：Quad Flat Package PGA：Pin Grid Array BGA：Ball Grid Array 雖然半導(dǎo)體元件的外型種類很多，在電路板上常用的組裝方式有二種，一種是插入電路板的銲孔或腳座，如PDIP、PGA，另一種是貼附在電路板表面的銲墊上，如SOP、SOJ、PLCC、QFP、BGA。 從半導(dǎo)體元件的外觀，只看到從包覆的膠體或陶瓷中伸出的接腳，而半導(dǎo)體元件真正的的核心，是包覆在膠體或陶瓷內(nèi)一片非常小的晶片，透過(guò)伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件，從上方的玻璃窗可看到內(nèi)部的晶片，圖三是以顯微鏡將內(nèi)部的晶片放大，可以看到晶片以多條銲線連接四周的接腳，這些接腳向外延伸並穿出膠體，成為晶片與外界通訊的道路。請(qǐng)注意圖三中有一條銲線從中斷裂，那是使用不當(dāng)引發(fā)過(guò)電流而燒毀，致使晶片失去功能，這也是一般晶片遭到損毀而失效的原因之一。 圖四是常見(jiàn)的LED，也就是發(fā)光二極體，其內(nèi)部也是一顆晶片，圖五是以顯微鏡正視LED的頂端，可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線，若以LED二支接腳的極性來(lái)做分別，晶片是貼附在負(fù)極的腳上，經(jīng)由銲線連接正極的腳。當(dāng)LED通過(guò)正向電流時(shí)，晶片會(huì)發(fā)光而使LED發(fā)亮，如圖六所示。 半導(dǎo)體元件的製作分成兩段的製造程序，前一段是先製造元件的核心─晶片，稱為晶圓製造；後一段是將晶中片加以封裝成最後產(chǎn)品，稱為IC封裝製程，又可細(xì)分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟，在本章節(jié)中將簡(jiǎn)介這兩段的製造程序。
上傳時(shí)間： 2013-11-04
上傳用戶：372825274
步進(jìn)電機(jī)驅(qū)動(dòng)電路L297與L298以及原理分析
標(biāo)簽： L297 L298 步進(jìn)電機(jī) 分
上傳時(shí)間： 2013-10-13
上傳用戶：shen1230
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